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74LVT162374DGG

更新时间： 2024-11-05 22:00:07
品牌 Logo 应用领域
恩智浦 - NXP 总线驱动器总线收发器触发器电阻器逻辑集成电路光电二极管信息通信管理
页数 文件大小 规格书
17页 89K
描述
3.3V LVT 16-bit edge-triggered D-type flip-flop with 30 ohm termination resistors 3-State

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74LVT162374DGG 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Transferred零件包装代码：TSSOP
包装说明：TSSOP, TSSOP48,.3,20针数：48
Reach Compliance Code：compliantHTS代码：8542.39.00.01
风险等级：5.19Is Samacsys：N
系列：LVTJESD-30 代码：R-PDSO-G48
JESD-609代码：e4长度：12.5 mm
逻辑集成电路类型：BUS DRIVER最大频率@ Nom-Sup：150000000 Hz
最大I（ol）：0.012 A湿度敏感等级：1
位数：8功能数量：2
端口数量：2端子数量：48
最高工作温度：85 °C最低工作温度：-40 °C
输出特性：3-STATE WITH SERIES RESISTOR输出极性：TRUE
封装主体材料：PLASTIC/EPOXY封装代码：TSSOP
封装等效代码：TSSOP48,.3,20封装形状：RECTANGULAR
封装形式：SMALL OUTLINE, THIN PROFILE, SHRINK PITCH峰值回流温度（摄氏度）：260
电源：3.3 VProp。Delay @ Nom-Sup：5.3 ns
传播延迟（tpd）：6.2 ns认证状态：Not Qualified
座面最大高度：1.2 mm子类别：FF/Latches
最大供电电压 (Vsup)：3.6 V最小供电电压 (Vsup)：2.7 V
标称供电电压 (Vsup)：3.3 V表面贴装：YES
技术：BICMOS温度等级：INDUSTRIAL
端子面层：NICKEL PALLADIUM GOLD端子形式：GULL WING
端子节距：0.5 mm端子位置：DUAL
处于峰值回流温度下的最长时间：30触发器类型：POSITIVE EDGE
宽度：6.1 mmBase Number Matches：1

74LVT162374DGG 数据手册

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74LVT162374  
3.3 V 16-bit edge-triggered D-type flip-flop with 30 Ω  
termination resistors; 3-state  
Rev. 03 — 17 January 2005  
Product data sheet  
1. General description  
The 74LVT162374 is a high performance BiCMOS product designed for VCC operation at  
3.3 V.  
The 74LVT162374 is designed with 30 Ω series resistance in both the HIGH and LOW  
states of the output. This design reduces line noise in applications such as memory  
address drivers, clock drivers, and bus receivers/transmitters.  
This device is a 16-bit edge-triggered D-type flip-flop featuring non-inverting 3-state  
outputs. The device can be used as two 8-bit flip-flops or one 16-bit flip-flop. On the  
positive transition of the clock (CP), the Q outputs of the flip-flop take on the logic levels  
set up at the D inputs.  
2. Features  
■ 16-bit edge-triggered flip-flop  
■ 3-state buffers  
■ Output capability: +12 mA and −12 mA  
■ TTL input and output switching levels  
■ Input and output interface capability to systems at 5 V supply  
■ Bus-hold data inputs eliminate the need for external pull-up resistors to hold unused  
inputs  
■ Live insertion and extraction permitted  
■ Outputs include series resistance of 30 Ω making external resistors unnecessary  
■ Power-up reset  
■ Power-up 3-state  
■ No bus current loading when output is tied to 5 V bus  
■ Latch-up protection exceeds 500 mA per JESD78  
■ ESD protection:  
◆ MIL STD 883 method 3015: exceeds 2000 V  
◆ Machine model: exceeds 200 V  
1234567...17

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