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74LVT14D-T

更新时间： 2024-09-15 20:19:51

品牌	Logo	应用领域
恩智浦 - NXP		栅输入元件信息通信管理光电二极管逻辑集成电路触发器
页数	文件大小	规格书
13页	85K
描述
IC LVT SERIES, HEX 1-INPUT INVERT GATE, PDSO14, 3.90 MM, PLASTIC, MS-012, SOT108-1, SOP-14, Gate

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74LVT14D-T 技术参数

Source Url Status Check Date：	2013-06-14 00:00:00	是否Rohs认证：	符合
生命周期：	Obsolete	零件包装代码：	SOIC
包装说明：	SOP, SOP14,.25	针数：	14
Reach Compliance Code：	unknown	HTS代码：	8542.39.00.01
风险等级：	5.29	系列：	LVT
JESD-30 代码：	R-PDSO-G14	JESD-609代码：	e4
长度：	8.65 mm	逻辑集成电路类型：	INVERTER
最大I（ol）：	0.032 A	湿度敏感等级：	1
功能数量：	6	输入次数：	1
端子数量：	14	最高工作温度：	85 °C
最低工作温度：	-40 °C	封装主体材料：	PLASTIC/EPOXY
封装代码：	SOP	封装等效代码：	SOP14,.25
封装形状：	RECTANGULAR	封装形式：	SMALL OUTLINE
包装方法：	TAPE AND REEL	峰值回流温度（摄氏度）：	260
电源：	3.3 V	最大电源电流（ICC）：	3 mA
Prop。Delay @ Nom-Sup：	5.7 ns	传播延迟（tpd）：	6.9 ns
认证状态：	Not Qualified	施密特触发器：	YES
座面最大高度：	1.75 mm	子类别：	Gates
最大供电电压 (Vsup)：	3.6 V	最小供电电压 (Vsup)：	2.7 V
标称供电电压 (Vsup)：	3.3 V	表面贴装：	YES
技术：	BICMOS	温度等级：	INDUSTRIAL
端子面层：	NICKEL PALLADIUM GOLD	端子形式：	GULL WING
端子节距：	1.27 mm	端子位置：	DUAL
处于峰值回流温度下的最长时间：	30	宽度：	3.9 mm
Base Number Matches：	1

74LVT14D-T 数据手册

74LVT14

3.3 V hex inverter Schmitt trigger

Rev. 02 — 25 April 2008

Product data sheet

1. General description

The 74LVT14 is a high-performance BiCMOS product designed for V_CCoperation at 3.3 V.

It is capable of transforming slowly changing input signals into sharply deﬁned, jitter free

output signals. In addition, it has a greater noise margin than conventional inverters.

Each circuit contains a Schmitt trigger followed by a Darlington level shifter and a phase

splitter driving a TTL totem-pole output. The Schmitt trigger uses positive feedback to

effectively speed-up slow input transitions, and provide different input threshold voltages

for positive-going and negative-going inputs. The threshold differential (typically 600 mV)

is determined internally by resistor ratios and is insensitive to temperature and supply

voltage variations.

2. Features

I Different positive and negative going input threshold voltages

I Tolerant of slow input transitions

I High noise immunity

I TTL input and output switching levels

I Output capability: +32 mA/−20 mA

I Latch-up protection exceeds 500 mA per JESD78 class II level A

I ESD protection:

N HBM JESD22-A114E exceeds 2000 V

N MM JESD22-A115-A exceeds 200 V

3. Ordering information

Table 1.

Ordering information

Type number

Package

Temperature range Name

Description

Version

74LVT14D

−40 °C to +85 °C

SO14

plastic small outline package; 14 leads;

body width 7.5 mm

SOT108-1

74LVT14DB

74LVT14PW

74LVT14BQ

SSOP14

TSSOP14

plastic shrink small outline package; 14 leads;

body width 5.3 mm

SOT337-1

SOT402-1

plastic thin shrink small outline package; 14 leads;

body width 4.4 mm

DHVQFN14 plastic dual in-line compatible thermal enhanced very SOT762-1

thin quad ﬂat package; no leads; 14 terminals;

body 2.5 × 4.5 × 0.85 mm

12 3 4 5 6 7...13

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与74LVT14D-T相关器件

型号	品牌	获取价格	描述	数据表
74LVT14PW	NXP	获取价格	3.3V Hex inverter Schmitt trigger
74LVT14PW	NEXPERIA	获取价格	3.3 V hex inverter Schmitt triggerProduction
74LVT14PW,112	NXP	获取价格	74LVT14 - 3.3 V hex inverter Schmitt trigger TSSOP 14-Pin
74LVT14PW,118	NXP	获取价格	74LVT14 - 3.3 V hex inverter Schmitt trigger TSSOP 14-Pin
74LVT14PWDH	NXP	获取价格	3.3V Hex inverter Schmitt trigger
74LVT14PWDH-T	NXP	获取价格	IC LVT SERIES, HEX 1-INPUT INVERT GATE, PDSO14, Gate
74LVT14PW-T	NXP	获取价格	IC LVT SERIES, HEX 1-INPUT INVERT GATE, PDSO14, 4.40 MM, PLASTIC, MO-153, SOT402-1, TSSOP-
74LVT162240	FAIRCHILD	获取价格	Low Voltage 16-Bit Inverting Buffer/Line Driv
74LVT162240A	NXP	获取价格	3.3V LVT 16-bit inverting buffer/driver with 30ohm termination resistors 3-State
74LVT162240ADDG	ETC	获取价格	BUFFER/DRIVER\|QUAD\|4-BIT\|LVT/ALVT-BICMOS\|TSSOP\|48PIN\|PLASTIC

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