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| 是否Rohs认证： | 不符合 | 生命周期： | Obsolete |
| 包装说明： | DIP, DIP14,.3 | Reach Compliance Code： | compliant |
| 风险等级： | 5.92 | JESD-30 代码： | R-PDIP-T14 |
| JESD-609代码： | e0 | 逻辑集成电路类型： | D FLIP-FLOP |
| 功能数量： | 2 | 端子数量： | 14 |
| 最高工作温度： | 70 °C | 最低工作温度： | |
| 封装主体材料： | PLASTIC/EPOXY | 封装代码： | DIP |
| 封装等效代码： | DIP14,.3 | 封装形状： | RECTANGULAR |
| 封装形式： | IN-LINE | 电源： | 5 V |
| 子类别： | FF/Latches | 标称供电电压 (Vsup)： | 5 V |
| 表面贴装： | NO | 技术： | TTL |
| 温度等级： | COMMERCIAL | 端子面层： | Tin/Lead (Sn/Pb) |
| 端子形式： | THROUGH-HOLE | 端子节距： | 2.54 mm |
| 端子位置： | DUAL | 触发器类型： | POSITIVE EDGE |
| Base Number Matches： | 1 |
| 型号 | 品牌 | 获取价格 | 描述 | 数据表 |
| 74LS75 | TI |
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4-BIT BISTABLE LATCHES |
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| 74LS75 | MOTOROLA |
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4-BIT D LATCH |
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| 74LS75 | FAIRCHILD |
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Quad Latch |
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| 74LS75 | HITACHI |
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Quadruple Bistable Latches |
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| 74LS75B | NXP |
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IC LS SERIES, DUAL HIGH LEVEL TRIGGERED D LATCH, COMPLEMENTARY OUTPUT, PDIP16, FF/Latch |
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| 74LS75F | NXP |
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LS SERIES, DUAL HIGH LEVEL TRIGGERED D LATCH, COMPLEMENTARY OUTPUT, CDIP16 |
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| 74LS75N | RAYTHEON |
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D Latch, 1-Func, 4-Bit, TTL, PDIP16, |
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| 74LS75NA+2 | RAYTHEON |
获取价格 |
D Latch, 1-Func, 4-Bit, TTL, PDIP16, |
|
| 74LS76 | HITACHI |
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Dual J-K Flip-Flop(with Preset and Clear) |
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| 74LS76 | ONSEMI |
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LOW POWER SCHOTTKY |
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