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| 是否Rohs认证： | 不符合 | 生命周期： | Obsolete |
| 零件包装代码： | DIP | 包装说明： | DIP, DIP16,.3 |
| 针数： | 16 | Reach Compliance Code： | unknown |
| HTS代码： | 8542.39.00.01 | 风险等级： | 5.56 |
| 其他特性： | MASTER SLAVE OPERATION | 系列： | LS |
| JESD-30 代码： | R-PDIP-T16 | JESD-609代码： | e0 |
| 逻辑集成电路类型： | J-K FLIP-FLOP | 位数： | 2 |
| 功能数量： | 2 | 端子数量： | 16 |
| 最高工作温度： | 70 °C | 最低工作温度： | |
| 输出极性： | COMPLEMENTARY | 封装主体材料： | PLASTIC/EPOXY |
| 封装代码： | DIP | 封装等效代码： | DIP16,.3 |
| 封装形状： | RECTANGULAR | 封装形式： | IN-LINE |
| 峰值回流温度（摄氏度）： | NOT SPECIFIED | 电源： | 5 V |
| 传播延迟（tpd）： | 30 ns | 认证状态： | Not Qualified |
| 子类别： | FF/Latches | 最大供电电压 (Vsup)： | 5.25 V |
| 最小供电电压 (Vsup)： | 4.75 V | 标称供电电压 (Vsup)： | 5 V |
| 表面贴装： | NO | 技术： | TTL |
| 温度等级： | COMMERCIAL | 端子面层： | Tin/Lead (Sn/Pb) |
| 端子形式： | THROUGH-HOLE | 端子节距： | 2.54 mm |
| 端子位置： | DUAL | 处于峰值回流温度下的最长时间： | NOT SPECIFIED |
| 触发器类型： | NEGATIVE EDGE | 最小 fmax： | 30 MHz |
| Base Number Matches： | 1 |
| 型号 | 品牌 | 描述 | 获取价格 | 数据表 |
| 74LS764A-T | YAGEO | DRAM Controller, TTL, PQCC44 |
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| 74LS764N | YAGEO | DRAM Controller, TTL, PDIP40 |
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| 74LS765N | YAGEO | DRAM Controller, TTL, PDIP40 |
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| 74LS76B | NXP | J-K Flip-Flop, LS Series, 2-Func, Negative Edge Triggered, 2-Bit, Complementary Output, TT |
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| 74LS76DCQM | FAIRCHILD | Jbar-Kbar Flip-Flop, 2-Func, Negative Edge Triggered, TTL, CDIP16, |
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| 74LS76DCQR | FAIRCHILD | Jbar-Kbar Flip-Flop, 2-Func, Negative Edge Triggered, TTL, CDIP16, |
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