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74AHC573PW,118

更新时间： 2024-11-05 14:40:15

品牌	Logo	应用领域
恩智浦 - NXP		驱动光电二极管逻辑集成电路
页数	文件大小	规格书
17页	89K
描述
74AHC(T)573 - Octal D-type transparant latch; 3-state TSSOP2 20-Pin

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74AHC573PW,118 技术参数

是否Rohs认证：	符合	生命周期：	Transferred
零件包装代码：	TSSOP2	包装说明：	TSSOP, TSSOP20,.25
针数：	20	Reach Compliance Code：	compliant
HTS代码：	8542.39.00.01	风险等级：	3.14
系列：	AHC/VHC/H/U/V	JESD-30 代码：	R-PDSO-G20
JESD-609代码：	e4	长度：	6.5 mm
负载电容（CL）：	50 pF	逻辑集成电路类型：	BUS DRIVER
最大I（ol）：	0.008 A	湿度敏感等级：	1
位数：	8	功能数量：	1
端口数量：	2	端子数量：	20
最高工作温度：	125 °C	最低工作温度：	-40 °C
输出特性：	3-STATE	输出极性：	TRUE
封装主体材料：	PLASTIC/EPOXY	封装代码：	TSSOP
封装等效代码：	TSSOP20,.25	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH	峰值回流温度（摄氏度）：	260
电源：	2/5.5 V	Prop。Delay @ Nom-Sup：	11 ns
传播延迟（tpd）：	19.5 ns	认证状态：	Not Qualified
座面最大高度：	1.1 mm	子类别：	FF/Latches
最大供电电压 (Vsup)：	5.5 V	最小供电电压 (Vsup)：	2 V
标称供电电压 (Vsup)：	5 V	表面贴装：	YES
技术：	CMOS	温度等级：	AUTOMOTIVE
端子面层：	Nickel/Palladium/Gold (Ni/Pd/Au)	端子形式：	GULL WING
端子节距：	0.65 mm	端子位置：	DUAL
处于峰值回流温度下的最长时间：	30	宽度：	4.4 mm
Base Number Matches：	1

74AHC573PW,118 数据手册

74AHC573; 74AHCT573

Octal D-type transparant latch; 3-state

Rev. 03 — 24 April 2008

Product data sheet

1. General description

The 74AHC573; 74AHCT573 is a high-speed Si-gate CMOS device and is pin compatible

with Low-power Schottky TTL (LSTTL). It is speciﬁed in compliance with JEDEC standard

No. 7A.

The 74AHC573; 74AHCT573 consists of eight D-type transparent latches featuring

separate D-type inputs for each latch and 3-state true outputs for bus oriented

applications. A latch enable input (LE) and an output enable input (OE) are common to all

latches.

When pin LE is HIGH, data at the Dn inputs enters the latches. In this condition the

latches are transparent, i.e. a latch output will change state each time its corresponding

Dn input changes. When pin LE is LOW, the latches store the information that is present

at the Dn inputs, after a set-up time preceding the HIGH-to-LOW transition of LE.

When pin OE is LOW, the contents of the 8 latches are available at the outputs. When

pin OE is HIGH, the outputs go to the high-impedance OFF-state. Operation of the OE

input does not affect the state of the latches.

The 74AHC573; 74AHCT573 is functionally identical to:

• 74AHC563; 74AHCT563 which has inverted outputs and a different pin arrangement

• 74AHC373; 74AHCT373 which has a different pin arrangement

2. Features

I Balanced propagation delays

I All inputs have a Schmitt-trigger action

I Common 3-state output enable input

I Functionally identical to the 74AHC563; 74AHCT563 and 74AHC373; 74AHCT373

I Inputs accept voltages higher than V_CC

I Input levels:

N For 74AHC573: CMOS input level

N For 74AHCT573: TTL input level

I ESD protection:

N HBM EIA/JESD22-A114E exceeds 2000 V

N MM EIA/JESD22-A115-A exceeds 200 V

N CDM EIA/JESD22-C101C exceeds 1000 V

I Multiple package options

I Speciﬁed from −40 °C to +85 °C and from −40 °C to +125 °C

12 3 4 5 6 7...17

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74AHC573PW,118 替代型号

型号	品牌	替代类型	描述	数据表
74AHC573PW,112	NXP	完全替代	74AHC(T)573 - Octal D-type transparant latch; 3-state TSSOP2 20-Pin
74VHC573MTCX	FAIRCHILD	功能相似	Octal D-Type Latch with 3-STATE Outputs
SN74AHC573PWR	TI	功能相似	OCTAL TRANSPARENT D- TYPE LATCHES WITH 3 STATE OUTPUTS

与74AHC573PW,118相关器件

型号	品牌	获取价格	描述	数据表
74AHC573PW/T3	NXP	获取价格	IC AHC/VHC/H/U/V SERIES, 8-BIT DRIVER, TRUE OUTPUT, PDSO20, 4.40 MM, PLASTIC, MO-153, SOT-
74AHC573PWDH	NXP	获取价格	Octal D-type transparent latch; 3-state
74AHC573PW-Q100	NXP	获取价格	IC DRIVER, Bus Driver/Transceiver
74AHC573PW-Q100	NEXPERIA	获取价格	Octal D-type transparant latch 3-state
74AHC573-Q100	NEXPERIA	获取价格	Octal D-type transparant latch 3-state
74AHC574	NXP	获取价格	Octal D-type flip-flop; positive edge-trigger; 3-state
74AHC574BQ	NXP	获取价格	Octal D-type flip-flop; positive edge-trigger; 3-state
74AHC574BQ	NEXPERIA	获取价格	Octal D-type flip-flop; positive-edge trigger; 3-stateProduction
74AHC574BQ,115	NXP	获取价格	74AHC(T)574 - Octal D-type flip-flop; positive edge-trigger; 3-state QFN 20-Pin
74AHC574BQ-G	NXP	获取价格	IC,FLIP-FLOP,OCTAL,D TYPE,AHC/VHC-CMOS,LLCC,20PIN,PLASTIC

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