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XC4005E-4PG156M PDF预览

XC4005E-4PG156M

更新时间： 2024-09-20 20:32:47
品牌 Logo 应用领域
赛灵思 - XILINX 时钟栅可编程逻辑
页数 文件大小 规格书
23页 138K
描述
Field Programmable Gate Array, 196 CLBs, 3000 Gates, 111MHz, 196-Cell, CMOS, CPGA156, CERAMIC, PGA-156

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XC4005E-4PG156M 技术参数

是否Rohs认证：符合生命周期：Obsolete
零件包装代码：PGA包装说明：PGA, PGA156,16X16
针数：156Reach Compliance Code：unknown
ECCN代码：3A001.A.2.CHTS代码：8542.39.00.01
风险等级：5.78Is Samacsys：N
其他特性：TYP. GATES = 3000-9000最大时钟频率：111 MHz
CLB-Max的组合延迟：2.7 nsJESD-30 代码：S-CPGA-P156
长度：42.164 mm可配置逻辑块数量：196
等效关口数量：3000输入次数：112
逻辑单元数量：196输出次数：112
端子数量：156最高工作温度：125 °C
最低工作温度：-55 °C组织：196 CLBS, 3000 GATES
封装主体材料：CERAMIC, METAL-SEALED COFIRED封装代码：PGA
封装等效代码：PGA156,16X16封装形状：SQUARE
封装形式：GRID ARRAY峰值回流温度（摄氏度）：NOT SPECIFIED
电源：5 V可编程逻辑类型：FIELD PROGRAMMABLE GATE ARRAY
认证状态：Not Qualified座面最大高度：4.318 mm
子类别：Field Programmable Gate Arrays最大供电电压：5.5 V
最小供电电压：4.5 V标称供电电压：5 V
表面贴装：NO技术：CMOS
温度等级：MILITARY端子形式：PIN/PEG
端子节距：2.54 mm端子位置：PERPENDICULAR
处于峰值回流温度下的最长时间：NOT SPECIFIED宽度：42.164 mm
Base Number Matches：1

XC4005E-4PG156M 数据手册

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0
XC4000E High-Reliability  
Field Programmable Gate Arrays  
0
8*  
November 21, 1997 (Version 1.3)  
Product Specification  
-
-
Program verification  
Internal node observability  
XC4000E High-Reliability Features  
•
System featured Field-Programmable Gate Arrays  
-
•
•
Backward Compatible with XC4000 Devices  
Development System runs on most common computer  
platforms  
-
-
-
Available in class Q fully compliant QML and Military  
temperature range only  
-
Select-RAMTM memory: on-chip ultra-fast RAM with  
-
-
synchronous write option  
dual-port RAM option  
Interfaces to popular design environments  
Fully automatic mapping, placement and routing  
Interactive design editor for design optimization  
-
-
-
-
-
-
-
Abundant flip-flops  
Flexible function generators  
Dedicated high-speed carry logic  
Wide edge decoders on each edge  
Hierarchy of interconnect lines  
Internal 3-state bus capability  
8 global low-skew clock or signal distribution  
networks  
•
Certified to MIL-PRF-38535, appendix A QML  
(Qualified Manufacturers Listing)  
•
•
•
•
System Performance beyond 60 MHz  
Flexible Array Architecture  
Low Power Segmented Routing Architecture  
Systems-Oriented Features  
Xilinx High-Reliability  
XC4000E family is supplied under the following standard  
microcircuit drawings (SMDs):  
-
IEEE 1149.1-compatible boundary scan logic  
support  
Individually programmable output slew rate  
Programmable input pull-up or pull-down resistors  
12-mA sink current per XC4000E output  
XC4005E 5962-97522  
XC4010E 5962-97523  
XC4013E 5962-97524  
XC4025E 5962-97525  
For more information contact DSCC (Defense Supply Cen-  
ter Columbus) Columbus, Ohio.  
-
-
-
•
•
Configured by Loading Binary File  
Unlimited reprogrammability  
Readback Capability  
-
Table 1: XC4000E Field Programmable Gate Arrays  
Max.  
Logic  
Gates  
Typical  
Max. RAM Gate Range  
Max.  
Decode  
Inputs  
Number  
of  
Bits  
(Logic and  
RAM)*  
CLB  
Total  
Max.  
Device  
(No RAM) (No Logic)  
Matrix CLBs Flip-Flops per side User I/O Packages  
XC4005E  
5,000  
10,000  
13,000  
25,000  
6,272  
12,800  
18,432  
32,768  
3,000 - 9,000 14 x 14  
196  
400  
576  
616  
42  
60  
72  
96  
112  
160  
192  
256  
PG156,  
CB164  
XC4010E  
XC4013E  
XC4025E  
7,000 - 20,000 20 x 20  
1,120  
1,536  
2,560  
PG191,  
CB196  
10,000 -  
30,000  
24 x 24  
PG223,  
CB228  
15,000 -  
45,000  
32 x 32 1,024  
PG299,  
CB228  
*
Max values of Typical Gate Range include 20-30% of CLBs used as RAM.  
November 21, 1997 (Version 1.3)  
8-11  
1234567...23

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