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TPIC5424LDW PDF预览

TPIC5424LDW

更新时间： 2024-11-30 19:58:59
品牌 Logo 应用领域
德州仪器 - TI 开关脉冲光电二极管晶体管
页数 文件大小 规格书
12页 182K
描述
H-bridge Driver 20-SOIC

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TPIC5424LDW 技术参数

是否无铅： 含铅是否Rohs认证： 不符合
生命周期：Obsolete零件包装代码：SOIC
包装说明：PLASTIC, SOIC-20针数：20
Reach Compliance Code：not_compliantECCN代码：EAR99
Factory Lead Time：1 week风险等级：5.89
其他特性：LOGIC LEVEL COMPATIBLE雪崩能效等级（Eas）：180 mJ
外壳连接：ISOLATED配置：COMPLEX
最小漏源击穿电压：60 V最大漏极电流 (Abs) (ID)：1 A
最大漏极电流 (ID)：1 A最大漏源导通电阻：0.48 Ω
FET 技术：METAL-OXIDE SEMICONDUCTOR最大反馈电容 (Crss)：125 pF
JEDEC-95代码：MS-013ACJESD-30 代码：R-PDSO-G20
元件数量：4端子数量：20
工作模式：ENHANCEMENT MODE最高工作温度：150 °C
封装主体材料：PLASTIC/EPOXY封装形状：RECTANGULAR
封装形式：SMALL OUTLINE峰值回流温度（摄氏度）：NOT SPECIFIED
极性/信道类型：N-CHANNEL功耗环境最大值：1.389 W
最大功率耗散 (Abs)：1.4 W最大脉冲漏极电流 (IDM)：3 A
认证状态：Not Qualified子类别：FET General Purpose Power
表面贴装：YES端子形式：GULL WING
端子位置：DUAL处于峰值回流温度下的最长时间：NOT SPECIFIED
晶体管应用：SWITCHING晶体管元件材料：SILICON
最大关闭时间（toff）：132 ns最大开启时间（吨）：110 ns
Base Number Matches：1

TPIC5424LDW 数据手册

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TPIC5424L  
H-BRIDGE LOGIC-LEVEL POWER DMOS ARRAY  
SLIS026A – JUNE 1994 – REVISED NOVEMBER 1994  
• Low r  
. . . 0.4 Ω Typ  
DW PACKAGE  
(TOP VIEW)  
DS(on)  
• High-Voltage Output . . . 60 V  
• Pulsed Current . . . 3 A Per Channel  
• Fast Commutation Speed  
GND  
SOURCE4/GND  
GATE4  
SOURCE2/GND  
GATE2  
NC  
1
2
3
4
5
6
7
8
9
10  
20  
19  
18  
17  
16  
• Direct Logic-Level Interface  
NC  
NC  
description  
DRAIN4  
SOURCE3  
DRAIN3  
GATE3  
DRAIN2  
15 SOURCE1  
The TPIC5424L is a monolithic logic-level power  
DMOS array that consists of four electrically  
isolated N-channel enhancement-mode DMOS  
transistors, two of which are configured with a  
common source.  
14  
13  
12  
11  
DRAIN1  
GATE1  
NC  
NC  
NC  
NC  
The TPIC5424L is offered in a 16-pin thermally  
enhanced dual-in-line (NE) package and a 20-pin  
wide-body surface-mount (DW) package. The  
TPIC5424L is characterized for operation over the  
case temperature range of –40°C to 125°C.  
NC – No internal connection  
NE PACKAGE  
(TOP VIEW)  
SOURCE1  
DRAIN1  
GATE1  
DRAIN2  
SOURCE2/GND  
GATE2  
1
2
3
4
5
6
7
8
16  
15  
14  
13 GND  
12 GND  
GND  
GND  
11  
10  
9
GATE3  
GATE4  
DRAIN3  
SOURCE3  
SOURCE4/GND  
DRAIN4  
schematic  
DRAIN1  
GATE1  
DRAIN3  
GATE3  
Q1  
Q3  
Z1  
D1  
D2  
Z3  
SOURCE1  
DRAIN2  
SOURCE3  
DRAIN4  
Q2  
Q4  
GATE4  
GATE2  
Z2  
Z4  
GND, SOURCE2, SOURCE4  
Copyright 1994, Texas Instruments Incorporated  
PRODUCTION DATA information is current as of publication date.  
Products conform to specifications per the terms of Texas Instruments  
standard warranty. Production processing does not necessarily include  
testing of all parameters.  
1
POST OFFICE BOX 655303 • DALLAS, TEXAS 75265  
1234567...12

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型号 品牌 获取价格 描述 数据表
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