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TMC2340AKEC2

更新时间： 2024-11-21 15:54:43
品牌 Logo 应用领域
飞兆/仙童 - FAIRCHILD 外围集成电路
页数 文件大小 规格书
19页 128K
描述
Microprocessor Circuit, CMOS, PQFP120, METRIC, QFP-120

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TMC2340AKEC2 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
零件包装代码：QFP包装说明：QFP,
针数：120Reach Compliance Code：unknown
HTS代码：8542.31.00.01风险等级：5.72
JESD-30 代码：S-PQFP-G120JESD-609代码：e0
长度：28 mm端子数量：120
最高工作温度：70 °C最低工作温度：
封装主体材料：PLASTIC/EPOXY封装代码：QFP
封装形状：SQUARE封装形式：FLATPACK
峰值回流温度（摄氏度）：NOT SPECIFIED认证状态：Not Qualified
座面最大高度：3.92 mm最大供电电压：5.25 V
最小供电电压：4.75 V标称供电电压：5 V
表面贴装：YES技术：CMOS
温度等级：COMMERCIAL端子面层：Tin/Lead (Sn/Pb)
端子形式：GULL WING端子节距：0.8 mm
端子位置：QUAD处于峰值回流温度下的最长时间：NOT SPECIFIED
宽度：28 mmuPs/uCs/外围集成电路类型：MICROPROCESSOR CIRCUIT
Base Number Matches：1

TMC2340AKEC2 数据手册

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www.fairchildsemi.com  
TMC2 3 4 0 A  
Dig it a l S yn t h e s ize r  
Du a l 1 6 Bit , 5 0 Ms p s  
Features  
• User-configurable phase accumulator for waveform  
synthesis, frequency modulation or phase modulation  
• Amplitude input for amplitude modulation and gain  
adjustment  
• Single +5V power supply  
• Available in a 120-pin ceramic pin grid array (CPGA),  
120-pin plastic pin grid array package (PPGA), and 120-pin  
metric quad flat pack (MQFP)  
• Guaranteed 50 Msps pipelined data throughput rate  
• 15-bit magnitude, 32-bit phase data input precision  
• 16-bit offset binary or 15-bit unsigned magnitude output  
data format  
• Input register clock enables simplify interfacing  
• Low power consumption CMOS process  
Applications  
• Digital waveform synthesis, including quadrature  
functions  
• Digital modulation and demodulation  
Description  
The TMC2340A performs waveform synthesis, modulation,  
and demodulation. When presented with a TTL clock signal  
and user-selected 15-bit amplitude and 32-bit phase incre-  
ment values, the TMC2340A automatically generates  
quadrature matched pairs of 16-bit sine and cosine waves in  
DAC-compatible 16-bit offset binary format. If desired,  
these waveforms are easily phase or frequency-modulated  
on-chip, and the amplitude input facilitates gain adjustment  
or amplitude modulation. Digital output frequencies are  
restricted only by the Nyquist limit of clock rate/2, with  
frequency resolution of 0.012 Hz at the guaranteed maximum  
50 MHz clock rate.  
A new data word pair is available at the output every clock  
cycle. All input and output data ports are registered, with a  
user-configurable phase accumulator structure and input  
register clock enables to simplify interfacing. The phase data  
range over a full 2π radians. All signals are TTL compatible.  
Fabricated in a submicron CMOS process, the TMC2340A  
operates at the 50 MHz maximum clock rate over the full  
commercial temperature (0 to 70°C) and supply (4.75 to  
5.25V) voltage ranges, and is available in 120 pin plastic pin  
grid array (PPGA), 120-pin ceramic pin grid array (CPGA),  
and a 120-lead metric quad flat pack (MQFP) package.  
Logic Symbol  
ENA  
TMC2340A  
15  
AM  
(14-0)  
DATA  
INPUTS  
2
ENP  
(1,0)  
OEI  
16  
16  
32  
I
(15-0)  
PH  
(31-0)  
DATA  
OUTPUTS  
OEQ  
FM  
PM  
Q
(15-0)  
CONTROLS  
OBIQ  
CLK  
REV. 1.1.2 5/9/00  
1234567...19

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与TMC2340AKEC2相关器件

型号 品牌 获取价格 描述 数据表
TMC2340AKEF FAIRCHILD

获取价格

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