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TDA8002G/3/C2

更新时间： 2024-02-29 16:21:36
品牌 Logo 应用领域
恩智浦 - NXP /
页数 文件大小 规格书
28页 131K
描述
IC card interface

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TDA8002G/3/C2 技术参数

是否Rohs认证： 不符合生命周期：Transferred
包装说明：QFP, QFP32,.28SQ,20Reach Compliance Code：unknown
风险等级：5.7JESD-30 代码：S-PQFP-G32
JESD-609代码：e0端子数量：32
最高工作温度：85 °C最低工作温度：-25 °C
封装主体材料：PLASTIC/EPOXY封装代码：QFP
封装等效代码：QFP32,.28SQ,20封装形状：SQUARE
封装形式：FLATPACK电源：3.3/5 V
认证状态：Not Qualified子类别：Other Microprocessor ICs
最大压摆率：12 mA表面贴装：YES
技术：CMOS温度等级：OTHER
端子面层：Tin/Lead (Sn/Pb)端子形式：GULL WING
端子节距：0.5 mm端子位置：QUAD
uPs/uCs/外围集成电路类型：MICROPROCESSOR CIRCUITBase Number Matches：1

TDA8002G/3/C2 数据手册

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Philips Semiconductors  
Product specification  
IC card interface  
TDA8002  
PINNING  
PIN  
TYPE A TYPE B TYPE G  
SYMBOL  
I/O  
DESCRIPTION  
XTAL1  
XTAL2  
I/OUC  
1
2
3
4
1
2
3
4
30  
31  
32  
1
I/O  
I/O  
I/O  
I/O  
crystal connection or input for external clock  
crystal connection  
data I/O line to and from microcontroller  
AUX1UC  
auxiliary line to and from microcontroller for synchronous  
applications  
AUX2UC  
5
−
2
I/O  
auxiliary line to and from microcontroller for synchronous  
applications  
ALARM  
ALARM  
−
5
6
3
4
O
O
open drain NMOS reset output for microcontroller (active LOW)  
6
open drain PMOS reset output for microcontroller (active  
HIGH)  
CLKSEL  
7
7
5
I
control input signal for CLK (LOW = XTAL oscillator;  
HIGH = STROBE input)  
CLKDIV1  
CLKDIV2  
STROBE  
CLKOUT  
DGND1  
AGND  
S2  
8
8
6
I
I
control input with CLKDIV2 for choosing CLK frequency  
control input with CLKDIV1 for choosing CLK frequency  
external clock input for synchronous applications  
clock output (see Table 1)  
9
9
7
10  
11  
12  
13  
14  
15  
16  
17  
18  
19  
20  
−
10  
11  
12  
13  
14  
15  
16  
17  
18  
−
8
I
9
O
10  
11  
12  
13  
14  
15  
16  
17  
18  
19  
20  
21  
22  
23  
24  
supply digital ground 1  
supply analog ground  
I/O  
capacitance connection for voltage doubler  
VDDA  
supply analog supply voltage  
S1  
I/O  
I/O  
I/O  
I/O  
I
capacitance connection for voltage doubler  
VUP  
output of voltage doubler (connect to 100 nF)  
data I/O line to and from card  
I/O  
AUX2  
PRES  
PRES  
AUX1  
CLK  
auxiliary I/O line to and from card  
active LOW card input presence contact  
active HIGH card input presence contact  
auxiliary I/O line to and from card  
clock to card output (C3) (see Table 1)  
card reset output (C2)  
19  
20  
21  
22  
23  
24  
25  
I
21  
22  
23  
24  
25  
I/O  
O
RST  
O
VCC  
O
supply for card (C1) (decouple with 100 nF)  
CMDVCC  
I
active LOW start activation sequence input from  
microcontroller  
RSTIN  
OFF  
26  
27  
26  
27  
25  
26  
I
card reset input from microcontroller  
O
open drain NMOS interrupt output to microcontroller (active  
LOW)  
MODE  
VDDD  
28  
−
28  
−
27  
28  
29  
I
operating mode selection input (HIGH = normal; LOW = sleep)  
supply digital supply voltage  
supply digital ground 2  
DGND2  
−
−
1997 Nov 04  
5
12345678...28

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