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PCS2I9942PG-32-LR

更新时间： 2024-11-01 05:59:55

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PULSECORE		时钟驱动器逻辑集成电路
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Low Voltage 1:18 Clock Distribution Chip

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PCS2I9942PG-32-LR 技术参数

生命周期：	Obsolete	包装说明：	7 X 7 MM, 0.80 MM HEIGHT, GREEN, LQFP-32
Reach Compliance Code：	unknown	风险等级：	5.84
Is Samacsys：	N	其他特性：	IT CAN ALSO OPERATE WITH 2.5V
系列：	9942	输入调节：	DIFFERENTIAL
JESD-30 代码：	S-PQFP-G32	长度：	7 mm
逻辑集成电路类型：	LOW SKEW CLOCK DRIVER	功能数量：	1
反相输出次数：		端子数量：	32
实输出次数：	18	最高工作温度：	85 °C
最低工作温度：	-40 °C	输出特性：	3-STATE
封装主体材料：	PLASTIC/EPOXY	封装代码：	LQFP
封装形状：	SQUARE	封装形式：	FLATPACK, LOW PROFILE
传播延迟（tpd）：	3.6 ns	认证状态：	Not Qualified
Same Edge Skew-Max（tskwd）：	0.15 ns	座面最大高度：	1.6 mm
最大供电电压 (Vsup)：	3.465 V	最小供电电压 (Vsup)：	3.135 V
标称供电电压 (Vsup)：	3.3 V	表面贴装：	YES
技术：	CMOS	温度等级：	INDUSTRIAL
端子形式：	GULL WING	端子节距：	0.8 mm
端子位置：	QUAD	宽度：	7 mm
最小 fmax：	250 MHz	Base Number Matches：	1

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September 2006

rev 0.4

PCS2I9942P

Low Voltage 1:18 Clock Distribution Chip

Features

With low output impedance (≈12Ω), in both the HIGH and

LOW logic states, the output buffers of the PCS2I9942P

are ideal for driving series terminated transmission lines.

With an output impedance of 12Ω, the PCS2I9942P can

drive two series terminated transmission lines from each

output. This capability gives the PCS2I9942P an effective

fanout of 1:36. The PCS2I9942P provides enough copies

of low skew clocks for most high performance synchronous

systems.

•

LVPECL Clock Input

2.5V LVCMOS

Microprocessor Support

Outputs

for

PentiumII^TM

•

200pS Maximum Targeted Output–to–Output

Skew

•

Maximum Output Frequency of 250MHz @3.3 V_CC

32–Lead LQFP and TQFP Packaging

Single 3.3V or 2.5V Supply

Pin and Function compatible with MPC942P

Functional Description

The differential LVPECL inputs of the PCS2I9942P allow

the device to interface directly with a LVPECL fanout buffer

to build very wide clock fanout trees or to couple to a high

frequency clock source. The OE pins will place the outputs

into a high impedance state. The OE pin has an internal

pullup resistor.

The PCS2I9942P is a 1:18 low voltage clock distribution

chip with 2.5V or 3.3V LVCMOS output capabilities. The

device is offered in two versions; the PCS2I9942C has an

LVCMOS input clock while the PCS2I9942P has a LVPECL

input clock. The 18 outputs are 2.5V or 3.3V LVCMOS

compatible and feature the drive strength to drive 50Ω

series or parallel terminated transmission lines. With

output-to-output skews of 200pS, the PCS2I9942P is ideal

as a clock distribution chip for the most demanding of

synchronous systems. The 2.5V outputs also make the

device ideal for supplying clocks for a high performance

Pentium II^TMmicroprocessor based design.

The PCS2I9942P is a single supply device. The V_CCpower

pins require either 2.5V or 3.3V. The 32 lead LQFP and

TQFP package is chosen to optimize performance, board

space and cost of the device. The 32–lead LQFP and

TQFP have a 7x7mm²body size with conservative 0.8mm

pin spacing.

* Pentium II is a trademark of Intel Corporation

Block Diagram

Table 1. Function Table

Output

PECL_CLK

Q1-Q16

Q17

HIGH IMPEDANCE

OUTPUTS ENABLED

(Int. Pullup)

PulseCore Semiconductor Corporation

1715 S. Bascom Ave Suite 200, Campbell, CA 95008 • Tel: 408-879-9077 • Fax: 408-879-9018

www.pulsecoresemi.com

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型号	品牌	获取价格	描述	数据表
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PCS2I99446G-32-ER	PULSECORE	获取价格	2.5V and 3.3V LVCMOS Clock Distribution Buffer
PCS2I99446G-32-ET	PULSECORE	获取价格	2.5V and 3.3V LVCMOS Clock Distribution Buffer
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