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NLSX3013BFCT1G

更新时间： 2024-11-02 05:53:59
品牌 Logo 应用领域
安森美 - ONSEMI 转换器电平转换器
页数 文件大小 规格书
10页 149K
描述
8-Bit 100 Mb/s Configurable Dual-Supply Level Translator

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NLSX3013BFCT1G 技术参数

是否无铅： 不含铅生命周期：Active
零件包装代码：BGA包装说明：VFBGA,
针数：20Reach Compliance Code：compliant
HTS代码：8542.39.00.01风险等级：5.59
系列：3013JESD-30 代码：R-PBGA-B20
长度：2.54 mm逻辑集成电路类型：BUS DRIVER
位数：8功能数量：1
端口数量：2端子数量：20
最高工作温度：85 °C最低工作温度：-40 °C
输出特性：3-STATE输出极性：TRUE
封装主体材料：PLASTIC/EPOXY封装代码：VFBGA
封装形状：RECTANGULAR封装形式：GRID ARRAY, VERY THIN PROFILE, FINE PITCH
传播延迟（tpd）：9.3 ns认证状态：Not Qualified
座面最大高度：0.66 mm最大供电电压 (Vsup)：4.5 V
最小供电电压 (Vsup)：1.3 V标称供电电压 (Vsup)：3.3 V
表面贴装：YES技术：CMOS
温度等级：INDUSTRIAL端子形式：BALL
端子节距：0.5 mm端子位置：BOTTOM
宽度：2.03 mmBase Number Matches：1

NLSX3013BFCT1G 数据手册

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NLSX3013  
8-Bit 100 Mb/s Configurable  
Dual-Supply Level  
Translator  
The NLSX3013 is a 8−bit configurable dual−supply bidirectional  
level translator without a direction control pin. The I/O V − and I/O  
http://onsemi.com  
MARKING DIAGRAM  
CC  
V −ports are designed to track two different power supply rails, V  
L
CC  
and V respectively. The V supply rail is configurable from 1.3 V  
L
CC  
to 4.5 V while the V supply rail is configurable from 0.9 V to (V  
L
CC  
for NLSX3013FCT1G  
− 0.4) V. This allows lower voltage logic signals on the V side to be  
L
3013F  
AYWW  
G
translated into higher voltage logic signals on the V  
side, and  
CC  
vice−versa. Both I/O ports are auto−sensing; thus, no direction pin is  
required.  
The Output Enable (EN) input, when Low, disables both I/O ports  
by putting them in 3−state. This significantly reduces the supply  
for NLSX3013BFCT1G  
A1  
20 PIN FLIP−CHIP  
CASE 766AK  
3013B  
AYWW  
G
currents from both V and V . The EN signal is designed to track  
CC  
L
V .  
L
A
Y
= Assembly Location  
= Year  
Features  
WW  
G
= Work Week  
= Pb−Free Package  
• Wide High−Side V Operating Range: 1.3 V to 4.5 V  
CC  
Wide Low−Side V Operating Range: 0.9 V to (V − 0.4) V  
L
CC  
• High−Speed with 100 Mb/s Guaranteed Date Rate for V > 1.8 V  
L
LOGIC DIAGRAM  
• Low Bit−to−Bit Skew  
V
V
CC  
GND  
L
• Overvoltage Tolerant Enable and I/O Pins  
• Non−preferential Powerup Sequencing  
• Small packaging: 2.03 mm x 2.54 mm 20 Pin Flip−Chip  
• This is a Pb−Free Device  
EN  
I/O V 1  
I/O V  
1
2
3
4
5
6
7
8
L
CC  
CC  
CC  
CC  
CC  
CC  
CC  
CC  
Typical Applications  
I/O V 2  
I/O V  
I/O V  
I/O V  
I/O V  
I/O V  
I/O V  
I/O V  
L
• Mobile Phones, PDAs, Other Portable Devices  
• PC and Laptops  
• ESD Protection for All Pins: Human Body Model (HBM) > 6000 V  
I/O V 3  
L
I/O V 4  
L
I/O V 5  
L
I/O V 6  
L
I/O V 7  
L
I/O V 8  
L
ORDERING INFORMATION  
See detailed ordering and shipping information in the package  
dimensions section on page 9 of this data sheet.  
©
Semiconductor Components Industries, LLC, 2009  
1
Publication Order Number:  
March, 2009 − Rev. 2  
NLSX3013/D  
1234567...10

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