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NB7L86MMNR2G PDF预览

NB7L86MMNR2G

更新时间： 2024-11-14 03:46:59
品牌 Logo 应用领域
安森美 - ONSEMI 栅时钟
页数 文件大小 规格书
12页 1728K
描述
2.5V/3.3V 12 Gb/s Differential Clock/Data SmartGate with CML Output and Internal Termination

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NB7L86MMNR2G 技术参数

是否无铅： 不含铅生命周期：Lifetime Buy
零件包装代码：QFN包装说明：HVQCCN, LCC16,.12SQ,20
针数：16Reach Compliance Code：compliant
HTS代码：8542.39.00.01风险等级：5.27
系列：7LJESD-30 代码：S-XQCC-N16
长度：3 mm逻辑集成电路类型：LOGIC CIRCUIT
湿度敏感等级：1功能数量：1
端子数量：16最高工作温度：85 °C
最低工作温度：-40 °C封装主体材料：UNSPECIFIED
封装代码：HVQCCN封装等效代码：LCC16,.12SQ,20
封装形状：SQUARE封装形式：CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE
包装方法：TAPE AND REEL峰值回流温度（摄氏度）：260
电源：2.5/3.3 V最大电源电流（ICC）：50 mA
Prop。Delay @ Nom-Sup：0.18 ns认证状态：Not Qualified
施密特触发器：NO座面最大高度：1 mm
子类别：Gates最大供电电压 (Vsup)：3.465 V
最小供电电压 (Vsup)：2.375 V标称供电电压 (Vsup)：2.5 V
表面贴装：YES技术：ECL
温度等级：INDUSTRIAL端子面层：Nickel/Gold/Palladium (Ni/Au/Pd)
端子形式：NO LEAD端子节距：0.5 mm
端子位置：QUAD处于峰值回流温度下的最长时间：40
宽度：3 mmBase Number Matches：1

NB7L86MMNR2G 数据手册

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NB7L86M  
2.5V/3.3V 12 Gb/s Differential  
Clock/Data SmartGate with  
CML Output and Internal  
Termination  
The NB7L86M is a multi−function differential Logic Gate, which  
can be configured as an AND/NAND, OR/NOR, XOR/XNOR, or 2:1  
MUX. This device is part of the GigaComm family of high  
performance Silicon Germanium products. The NB7L86M is an  
ultra−low jitter multi−logic gate with a maximum data rate of 12 Gb/s  
and input clock frequency of 8 GHz suitable for Data Communication  
Systems, Telecom Systems, Fiber Channel, and GigE applications.  
Differential inputs incorporate internal 50 W termination resistors  
and accept LVNECL (Negative ECL), LVPECL (Positive ECL),  
LVCMOS, LVTTL, CML, or LVDS. The differential 16 mA CML  
output provides matching internal 50 W termination, and 400 mV  
output swing when externally terminated 50 W to VCC.  
http://onsemi.com  
MARKING  
DIAGRAM*  
16  
1
NB7L  
86M  
ALYWG  
G
QFN−16  
MN SUFFIX  
CASE 485G  
A
L
Y
W
G
= Assembly Location  
= Wafer Lot  
= Year  
= Work Week  
= Pb−Free Package  
The device is housed in a low profile 3x3 mm 16−pin QFN package.  
Application notes, models, and support documentation are available  
on www.onsemi.com.  
Features  
• Maximum Input Clock Frequency up to 8 GHz  
• Maximum Input Data Rate up to 12 Gb/s Typical  
• < 0.5 ps of RMS Clock Jitter  
*For additional marking information, refer to  
Application Note AND8002/D.  
• < 10 ps of Data Dependent Jitter  
ORDERING INFORMATION  
See detailed ordering and shipping information in the package  
dimensions section on page 11 of this data sheet.  
• 30 ps Typical Rise and Fall Times  
• 90 ps Typical Propagation Delay  
• 2 ps Typical Within Device Skew  
• Operating Range: V = 2.375 V to 3.465 V with V = 0 V  
CC  
EE  
• CML Output Level (400 mV Peak−to−Peak Output) Differential Output  
• 50 W Internal Input and Output Termination Resistors  
• Functionally Compatible with Existing 2.5 V/3.3 V LVEL, LVEP, EP  
and SG Devices  
• Pb−Free Packages are Available  
50 W  
VTD0  
D0  
D0  
VTD0  
Q
Q
50 W  
50 W  
VTD1  
D1  
D1  
50 W  
50 W  
VTD1  
50 W  
VTSEL  
SEL  
SEL  
Figure 1. Simplified Logic Diagram  
©
Semiconductor Components Industries, LLC, 2006  
1
Publication Order Number:  
January, 2006 − Rev. 3  
NB7L86M/D  
1234567...12

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NB7L86MMNR2G 替代型号

型号 品牌 替代类型 描述 数据表
NB7L86MMNR2 ONSEMI

完全替代

 2.5V/3.3V 12 Gb/s Differential Clock/Data SmartGate with CML Output and Internal Terminati
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功能相似

 2.5V/3.3V 12 Gb/s Differential Clock/Data SmartGate with CML Output and Internal Terminati

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型号 品牌 获取价格 描述 数据表
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