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MT89L86

更新时间： 2024-01-30 17:53:26
品牌 Logo 应用领域
MITEL 开关
页数 文件大小 规格书
40页 175K
描述
CMOS ST-BUS⑩ FAMILY Multiple Rate Digital Switch

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MT89L86 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
包装说明：QCCJ,Reach Compliance Code：compliant
HTS代码：8542.39.00.01风险等级：5.27
JESD-30 代码：S-PQCC-J44JESD-609代码：e0
长度：16.585 mm湿度敏感等级：1
功能数量：1端子数量：44
最高工作温度：85 °C最低工作温度：-40 °C
封装主体材料：PLASTIC/EPOXY封装代码：QCCJ
封装形状：SQUARE封装形式：CHIP CARRIER
峰值回流温度（摄氏度）：225认证状态：Not Qualified
座面最大高度：4.57 mm标称供电电压：3.3 V
表面贴装：YES技术：CMOS
电信集成电路类型：DIGITAL TIME SWITCH温度等级：INDUSTRIAL
端子面层：TIN LEAD端子形式：J BEND
端子节距：1.27 mm端子位置：QUAD
处于峰值回流温度下的最长时间：30宽度：16.585 mm
Base Number Matches：1

MT89L86 数据手册

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MT89L86  
Advance Information  
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33  
32  
31  
30  
29  
28  
27  
26  
CSTo  
ODE  
STo0  
STo1  
STo2  
STi14/STo8  
STo3  
STo4  
V
SS  
DTA  
STi0  
STi1  
STi2  
AS/ALE  
STi3  
40  
6 5 4 3 2 1 44 43 42 41  
7
STi3  
STi4  
STi5  
STo3  
STo4  
STo5  
39  
STi4  
STi5  
8
38  
37  
36  
35  
34  
33  
32  
31  
30  
29  
STo5  
STo6/A6  
STo7/A7  
9
STi6/A6  
STi7/A7  
10  
11  
12  
13  
14  
15  
16  
STi6/A6  
STi7/A7  
STo6/A6  
STo7/A7  
V
V
V
DD  
V
DD  
SS  
SS  
FR  
CLK  
AD0  
AD1  
AD2  
AD3  
AD4  
RESET  
V
DD  
AD0  
AD1  
AD2  
AD3  
AD4  
STi15/STo9  
AD5  
AD6  
AD7  
FR  
CLK  
STi8/A0  
STi9/A1  
STi10/A2  
IM  
STi11/A3  
STi12/A4  
STi13/A5  
DS/RD  
STi8/A0  
STi9/A1  
STi10/A2  
17  
18 19 20 21 22 23 24 25 26 27 28  
CS  
V
25  
R/W\WR  
SS  
44 PIN PLCC  
48 PIN SSOP  
(JEDEC MO-118, 300mil Wide)  
Figure 2 - Pin Connections  
Pin Description  
Pin #  
Name  
Description  
44  
48  
PLCC SSOP  
2
2
DTA  
Data Acknowledgment (Open Drain Output). This active low output indicates that a  
data bus transfer is complete. A pull-up resistor is required at this output.  
3-5  
7-9  
3-5  
7-9  
STi0-5 ST-BUS Inputs 0 to 5 (5V-tolerant Inputs). Serial data input streams. These streams  
may have data rates of 2.048, 4.096 or 8.192 Mbit/s with 32, 64 or 128 channels,  
respectively.  
10  
10  
STi6/A6 ST-BUS Input 6/Addr.6 input (5V-tolerant Input). The function of this pin is determined  
by the switching configuration enabled. If non-multiplexed CPU bus is used along with  
a higher input rate of 8.192 or 4.096 Mb/s, this pin provides A6 address input function.  
For 2.048 and 4.096 Mb/s (8x4) applications or when the multiplexed CPU bus  
interface is selected, this pin assumes STi6 function. See Control Register bits  
description and Tables 1, 2, 6 & 7 for more details.  
Note that for applications where both A6 and STi6 inputs are required simultaneously  
(e.g., 8 x 4 switching configuration at 4.096 Mb/s or rate conversion between 2.048Mb/  
s to 4.196 or 8.192 Mb/s) the A6 input should be connected to pin STo6/A6.  
11  
11  
STi7/A7 ST-BUS Input 7/Addr.7 input (5V-tolerant Input): The function of this pin is determined  
by the switching configuration enabled. If non-multiplexed CPU bus is used along with  
a higher input rate of 8.192 Mb/s, this pin provides A7 address input function.  
For 2.048 and 4.096 Mb/s (8x4) applications or when the multiplexed CPU bus is  
selected, this pin assumes STi7 function. See Control Register bits description and  
Tables 1, 2, 6 & 7 for more details.  
Note that for applications where both A7 and STi7 inputs are required simultaneously  
(e.g., 2.048 to 8.192 Mb/s rate conversion) the A7 input should be connected to pin  
STo7/A7.  
2
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