ML87V2105

更新时间： 2024-01-12 07:32:02

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Video Signal Noise Reduction IC with a Built-in 5.6 Mbit Frame Memory

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ML87V2105 技术参数

生命周期：	Transferred	零件包装代码：	QFP
包装说明：	TFQFP,	针数：	100
Reach Compliance Code：	unknown	HTS代码：	8542.39.00.01
风险等级：	5.37	Is Samacsys：	N
商用集成电路类型：	CONSUMER CIRCUIT	JESD-30 代码：	S-PQFP-G100
长度：	14 mm	功能数量：	1
端子数量：	100	最高工作温度：	70 °C
最低工作温度：		封装主体材料：	PLASTIC/EPOXY
封装代码：	TFQFP	封装形状：	SQUARE
封装形式：	FLATPACK, THIN PROFILE, FINE PITCH	认证状态：	Not Qualified
座面最大高度：	1.2 mm	最大供电电压 (Vsup)：	3.6 V
最小供电电压 (Vsup)：	3 V	表面贴装：	YES
温度等级：	COMMERCIAL	端子形式：	GULL WING
端子节距：	0.5 mm	端子位置：	QUAD
宽度：	14 mm	Base Number Matches：	1

ML87V2105 数据手册

PEDL87V2105DIGEST-02

OKI Semiconductor

ML87V2105

PIN DESCRIPTIONS

No.

Symbol

N.C.

I/O

—

Pad Remarks

Pin Description

Unused pin

Ground

V_SS

—

Schmitt(IN)/

OpenDrain(OUT)

Schmitt

SDA

I/O

I²C-bus data pin

I²C-bus clock pin

SCL

SLA1

SLA2

YI7

Internal pull-down 50k Slave address setting pin

Luminance signal input pin bit 7 (MSB)

YI6

Luminance signal input pin bit 6

Luminance signal input pin bit 5

Luminance signal input pin bit 4

Luminance signal input pin bit 3

Luminance signal input pin bit 2

Luminance signal input pin bit 1

Luminance signal input pin bit 0 (LSB)

Power supply 3.3 V

YI5

YI4

YI3

YI2

YI1

YI0

V_DD

ICLK

V_SS

CI7

CI6

CI5

CI4

CI3

CI2

CI1

CI0

V_DD

N.C.

V_SS

—

Input system clock pin

—

Ground

Internal pull-down 50k Color difference signal input pin bit 7 (MSB)

Internal pull-down 50k Color difference signal input pin bit 6

Internal pull-down 50k Color difference signal input pin bit 5

Internal pull-down 50k Color difference signal input pin bit 4

Internal pull-down 50k Color difference signal input pin bit 3

Internal pull-down 50k Color difference signal input pin bit 2

Internal pull-down 50k Color difference signal input pin bit 1

Internal pull-down 50k Color difference signal input pin bit 0 (LSB)

Power supply 3.3 V

—

Unused pin

Ground

Schmitt

IVS

IHS

Input system vertical sync signal input pin

Internal pull-down 50k

Schmitt

Input system horizontal sync signal input pin

Internal pull-down 50k

MODE0

MODE1

N.C.

Internal pull-down 50k Mode setting pin – bit 0

Internal pull-down 50k Mode setting pin – bit 1

Unused pin

—

MODE2

CLKO

V_DD

Internal pull-down 50k Mode setting pin – bit 2

Clock output (I²C-bus control possible)

Power supply 3.3 V

O/(I)

—

V_SS

Ground

N.C.

Unused pin

N.C.

Unused pin

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