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MC74AC323NC

更新时间： 2024-11-26 12:59:19
品牌 Logo 应用领域
摩托罗拉 - MOTOROLA 存储输入元件
页数 文件大小 规格书
8页 305K
描述
AC SERIES, 8-BIT BIDIRECTIONAL PARALLEL IN PARALLEL OUT SHIFT REGISTER, TRUE OUTPUT, PDIP20, PLASTIC, DIP-20

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MC74AC323NC 技术参数

生命周期：Obsolete零件包装代码：DIP
包装说明：DIP,针数：20
Reach Compliance Code：unknownHTS代码：8542.39.00.01
风险等级：5.52Is Samacsys：N
其他特性：HOLD MODE计数方向：BIDIRECTIONAL
系列：ACJESD-30 代码：R-PDIP-T20
长度：26.415 mm逻辑集成电路类型：PARALLEL IN PARALLEL OUT
位数：8功能数量：1
端子数量：20最高工作温度：85 °C
最低工作温度：-40 °C输出特性：3-STATE
输出极性：TRUE封装主体材料：PLASTIC/EPOXY
封装代码：DIP封装形状：RECTANGULAR
封装形式：IN-LINE认证状态：Not Qualified
座面最大高度：4.57 mm最大供电电压 (Vsup)：6 V
最小供电电压 (Vsup)：2 V标称供电电压 (Vsup)：5 V
表面贴装：NO技术：CMOS
温度等级：INDUSTRIAL端子形式：THROUGH-HOLE
端子节距：2.54 mm端子位置：DUAL
触发器类型：POSITIVE EDGE宽度：7.62 mm
Base Number Matches：1

MC74AC323NC 数据手册

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8-INPUT UNIVERSAL SHIFT/  
STORAGE REGISTER WITH  
SYNCHRONOUS RESET  
AND COMMON I/O PINS  
Advance Information  
The MC74AC323/74ACT323 is an 8-bit universal shift/storage register with  
3-state outputs. Its function is similar to the MC74AC299/74ACT299 with the  
exception of Synchronous Reset. Parallel load inputs and flip-flop outputs are  
multiplexed to minimize pin count. Separate serial inputs and outputs are provided  
for Q and Q to allow easy cascading. Four operation modes are possible: hold  
0
7
N SUFFIX  
CASE 738-03  
PLASTIC  
(store), shift left, shift right and parallel load.  
• Common Parallel I/O for Reduced Pin Count  
• Additional Serial Inputs and Outputs for Expansion  
• Four Operating Modes: Shift Left, Shift Right, Load and Store  
• 3-State Outputs for Bus-Oriented Applications  
• Outputs Source/Sink 24 mA  
• ′ACT323 Has TTL Compatible Inputs  
V
S
DS  
Q
I/O  
I/O  
I/O  
I/O  
CP  
12  
DS  
0
CC  
1
7
7
7
5
3
1
DW SUFFIX  
CASE 751D-04  
PLASTIC  
20  
19  
18  
17  
16  
15  
14  
13  
11  
1
2
OE  
3
OE  
4
I/O  
5
I/O  
6
I/O  
7
I/O  
9
8
10  
LOGIC SYMBOL  
S
Q
0
SR  
GND  
0
1
2
6
4
2
0
PIN NAMES  
CP  
DS  
DS  
Clock Pulse Input  
DS  
DS  
7
S
S
0
0
Serial Data Input for Right Shift  
Serial Data Input for Left Shift  
Mode Select Inputs  
Synchronous Master Reset  
3-State Output Enable Inputs  
Multipled Parallel Data Inputs or  
3-State Parallel Data Outputs  
Serial Outputs  
0
7
1
Q
7
S , S  
CP  
OE  
0
1
SR  
1
2
OE OE  
1,  
2
7
SR  
Q
I/O I/O I/O I/O I/O I/O I/O I/O  
0 0 1 2 3 4 5 6 7  
I/O –I/O  
0
Q , Q  
0
7
This document contains information on a new product. Specifications and information herein are subject to change without notice.  
FACT DATA  
5-1  
12345678

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