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Datasheet > 逻辑 > 移位寄存器> MC10H141FNR2G
MC10H141FNR2G PDF预览

MC10H141FNR2G

更新时间： 2024-11-04 05:10:23
品牌 Logo 应用领域
安森美 - ONSEMI 移位寄存器触发器逻辑集成电路
页数 文件大小 规格书
6页 149K
描述
Four−Bit Universal Shift Register

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MC10H141FNR2G 技术参数

是否无铅：不含铅生命周期：Obsolete
零件包装代码：QLCC包装说明：QCCJ, LDCC20,.4SQ
针数：20Reach Compliance Code：compliant
HTS代码：8542.39.00.01Factory Lead Time：1 week
风险等级：5.65Is Samacsys：N
计数方向：BIDIRECTIONAL系列：10H
JESD-30 代码：S-PQCC-J20JESD-609代码：e3
长度：8.965 mm逻辑集成电路类型：PARALLEL IN PARALLEL OUT
最大频率@ Nom-Sup：250000000 Hz湿度敏感等级：3
位数：4功能数量：1
端子数量：20最高工作温度：75 °C
最低工作温度：输出极性：TRUE
封装主体材料：PLASTIC/EPOXY封装代码：QCCJ
封装等效代码：LDCC20,.4SQ封装形状：SQUARE
封装形式：CHIP CARRIER峰值回流温度（摄氏度）：260
传播延迟（tpd）：2 ns认证状态：Not Qualified
座面最大高度：4.57 mm子类别：Shift Registers
表面贴装：YES技术：ECL
温度等级：COMMERCIAL EXTENDED端子面层：Tin (Sn)
端子形式：J BEND端子节距：1.27 mm
端子位置：QUAD处于峰值回流温度下的最长时间：40
触发器类型：POSITIVE EDGE宽度：8.965 mm
最小 fmax：250 MHzBase Number Matches：1

MC10H141FNR2G 数据手册

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MC10H141  
Four−Bit Universal Shift  
Register  
Description  
The MC10H141 is a four−bit universal shift register. This device is a  
functional/pinout duplication of the standard MECL 10K™ part with  
100% improvement in propagation delay and operation frequency and  
no increase in power supply current.  
http://onsemi.com  
MARKING DIAGRAMS*  
Features  
16  
• Shift frequency, 250 MHz Min  
• Power Dissipation, 425 mW Typical  
• Improved Noise Margin 150 mV (Over Operating Voltage and  
Temperature Range)  
MC10H141L  
AWLYYWW  
1
CDIP−16  
L SUFFIX  
CASE 620A  
• Voltage Compensated  
• MECL 10K Compatible  
• Pb−Free Packages are Available*  
Table 1. TRUTH TABLE  
OUTPUTS  
Q2 Q3  
n + 1 n + 1  
SELECT  
OPERATING  
MODE  
16  
1
S1 S2  
Q0  
Q1  
n + 1  
n + 1  
MC10H141P  
AWLYYWWG  
L
L
Parallel Entry  
D0  
Q1  
D1  
D2  
D3  
16  
L
H
L
Shift Right*  
Shift Left*  
Q2  
Q0  
Q3  
Q1  
DR  
Q2  
n
n
n
n
n
1
H
DL  
Q0  
n
PDIP−16  
P SUFFIX  
CASE 648  
H
H
Stop Shift  
Q1  
Q2  
32  
n
n
n
n
*
Outputs as exist after pulse appears at “C” input with  
input conditions as shown (Pulse Positive transition of  
clock input).  
1 20  
10H141G  
AWLYYWW  
20  
1
V
V
CC2  
1
2
3
4
5
6
7
8
16  
15  
14  
13  
12  
11  
10  
9
CC1  
Q1  
Q0  
DL  
D0  
D1  
S1  
D2  
Q2  
PLLC−20  
FN SUFFIX  
CASE 775  
Q3  
C
DR  
D3  
S2  
A
= Assembly Location  
= Wafer Lot  
WL  
YY  
WW  
G
= Year  
= Work Week  
= Pb−Free Package  
V
EE  
Pin assignment is for Dual−in−Line Package.  
*For additional marking information, refer to  
Application Note AND8002/D.  
Figure 1. Pin Assignment  
*For additional information on our Pb−Free strategy and soldering details, please  
download the ON Semiconductor Soldering and Mounting Techniques  
Reference Manual, SOLDERRM/D.  
ORDERING INFORMATION  
See detailed ordering and shipping information in the package  
dimensions section on page 3 of this data sheet.  
©
Semiconductor Components Industries, LLC, 2006  
1
Publication Order Number:  
February, 2006 − Rev. 8  
MC10H141/D  
123456

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