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MC100E150FN

更新时间： 2024-11-18 22:46:23

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摩托罗拉 - MOTOROLA		/
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描述
6-BIT D LATCH

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MC100E150FN 技术参数

生命周期：	Transferred	零件包装代码：	QLCC
包装说明：	QCCJ, LDCC28,.5SQ	针数：	28
Reach Compliance Code：	unknown	HTS代码：	8542.39.00.01
风险等级：	5.36	其他特性：	WITH DUAL LATCH ENABLE
系列：	100E	JESD-30 代码：	S-PQCC-J28
JESD-609代码：	e0	长度：	11.505 mm
逻辑集成电路类型：	D LATCH	位数：	6
功能数量：	1	端子数量：	28
最高工作温度：	85 °C	最低工作温度：
输出特性：	OPEN-EMITTER	输出极性：	COMPLEMENTARY
封装主体材料：	PLASTIC/EPOXY	封装代码：	QCCJ
封装等效代码：	LDCC28,.5SQ	封装形状：	SQUARE
封装形式：	CHIP CARRIER	电源：	-4.5 V
最大电源电流（ICC）：	72 mA	Prop。Delay @ Nom-Sup：	0.55 ns
传播延迟（tpd）：	0.7 ns	认证状态：	Not Qualified
座面最大高度：	4.57 mm	子类别：	FF/Latches
表面贴装：	YES	技术：	ECL
温度等级：	OTHER	端子面层：	Tin/Lead (Sn/Pb)
端子形式：	J BEND	端子节距：	1.27 mm
端子位置：	QUAD	触发器类型：	LOW LEVEL
宽度：	11.505 mm	Base Number Matches：	1

MC100E150FN 数据手册

SEMICONDUCTOR TECHNICAL DATA

The MC10E/100E150 contains six D-type latches with differential

outputs. When both Latch Enables (LEN1, LEN2) are LOW, the latch is

transparent and input data transitions propagate through to the output. A

logic HIGH on either LEN1 or LEN2 (or both) latches the data. The Master

Reset (MR) overrides all other controls to set the Q outputs low.

• 800ps Max. Propagation Delay

6-BIT D LATCH

• Extended 100E V

Range of – 4.2V to – 5.46V

• 75kΩ Input Pulldown Resistors

LOGIC DIAGRAM

FN SUFFIX

PLASTIC PACKAGE

CASE 776-02

Pinout: 28-Lead PLCC (Top View)

MR LEN2 LEN1

CCO

LEN1

LEN2

PIN NAMES

Function

– D

Data Inputs

LEN1, LEN2

Latch Enables

Master Reset

True Outputs

CCO

– Q

* All V

and V

pins are tied together on the die.

CCO

Inverting Outputs

12/93

Motorola, Inc. 1996

REV 2

2–1

12 3 4

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