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MACH110-20JC

更新时间： 2024-10-27 22:37:19

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莱迪思 - LATTICE		可编程逻辑输入元件时钟
页数	文件大小	规格书
24页	190K
描述
High-Density EE CMOS Programmable Logic

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MACH110-20JC 技术参数

是否Rohs认证：	不符合	生命周期：	Obsolete
零件包装代码：	LCC	包装说明：	PLASTIC, LCC-44
针数：	44	Reach Compliance Code：	unknown
ECCN代码：	EAR99	HTS代码：	8542.39.00.01
风险等级：	5.78	其他特性：	NO
最大时钟频率：	38.5 MHz	系统内可编程：	NO
JESD-30 代码：	S-PQCC-J44	JESD-609代码：	e0
JTAG BST：	NO	长度：	16.5862 mm
湿度敏感等级：	3	专用输入次数：	4
I/O 线路数量：	32	宏单元数：	32
端子数量：	44	最高工作温度：	70 °C
最低工作温度：		组织：	4 DEDICATED INPUTS, 32 I/O
输出函数：	MACROCELL	封装主体材料：	PLASTIC/EPOXY
封装代码：	QCCJ	封装等效代码：	LDCC44,.7SQ
封装形状：	SQUARE	封装形式：	CHIP CARRIER
峰值回流温度（摄氏度）：	225	电源：	5 V
可编程逻辑类型：	EE PLD	传播延迟：	20 ns
认证状态：	Not Qualified	座面最大高度：	4.57 mm
子类别：	Programmable Logic Devices	最大供电电压：	5.25 V
最小供电电压：	4.75 V	标称供电电压：	5 V
表面贴装：	YES	技术：	CMOS
温度等级：	COMMERCIAL	端子面层：	Tin/Lead (Sn/Pb)
端子形式：	J BEND	端子节距：	1.27 mm
端子位置：	QUAD	处于峰值回流温度下的最长时间：	30
宽度：	16.5862 mm	Base Number Matches：	1

MACH110-20JC 数据手册

FINAL

COM’L: -12/15/20

IND: -14/18/24

Lattice Semiconductor

MACH110-12/15/20

High-Density EE CMOS Programmable Logic

DISTINCTIVE CHARACTERISTICS

■ 44 Pins

■ 32 Outputs

■ 32 Flip-flops; 2 clock choices

■ 32 Macrocells

■ 2 “PAL22V16” Blocks

■ 12 ns t_PDCommercial

14 ns t_PDIndustrial

■ Pin-compatible with MACH111, MACH210,

MACH211, MACH215

■ 77 MHz f_CNT

■ 38 Inputs

GENERAL DESCRIPTION

TheMACH110isamemberofourhigh-performance

EE CMOS MACH 1 family. This device has approxi-

mately three times the logic macrocell capability of the

popular PAL22V10 without loss of speed.

The MACH110 macrocell provides either registered or

combinatorial outputs with programmable polarity. If a

registered configuration is chosen, the register can be

configured as D-type or T-type to help reduce the

number of product terms. The register type decision can

be made by the designer or by the software. All

macrocells can be connected to an I/O cell. If a buried

macrocell is desired, the internal feedback path from the

macrocell can be used, which frees up the I/O pin for use

as an input.

The MACH110 consists of two PAL blocks intercon-

nected by a programmable switch matrix. The two PAL

blocks are essentially “PAL22V16” structures complete

with product-term arrays and programmable macro-

cells. The switch matrix connects the PAL blocks to

each other and to all input pins, providing a high degree

of connectivity between the fully-connected PAL blocks.

This allows designs to be placed and routed efficiently.

Publication# 14127 Rev. I

Issue Date: May 1995

Amendment/0

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型号	品牌	获取价格	描述	数据表
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MACH111-10	AMD	获取价格	High-Performance EE CMOS Programmable Logic
MACH111-10JC	LATTICE	获取价格	High-Performance EE CMOS Programmable Logic
MACH111-10JI	LATTICE	获取价格	High-Performance EE CMOS Programmable Logic
MACH111-10JI/1	LATTICE	获取价格	EE PLD, 12ns, CMOS, PQCC44,
MACH111-10VC	LATTICE	获取价格	High-Performance EE CMOS Programmable Logic
MACH111-10VC/1	LATTICE	获取价格	EE PLD, 10ns, CMOS, PQFP44,
MACH111-10VI/1	LATTICE	获取价格	EE PLD, 12ns, CMOS, PQFP44,
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