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M54HC137F1R

更新时间： 2024-09-30 22:46:39

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意法半导体 - STMICROELECTRONICS		锁存器
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11页	258K
描述
3 TO 8 LINE DECODER/LATCH INVERTING

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M54HC137F1R 技术参数

是否无铅：	含铅	是否Rohs认证：	不符合
生命周期：	Obsolete	零件包装代码：	DIP
包装说明：	DIP, DIP16,.3	针数：	16
Reach Compliance Code：	not_compliant	ECCN代码：	EAR99
HTS代码：	8542.39.00.01	风险等级：	5.27
其他特性：	ADDRESS LATCHES; 2 ENABLE INPUTS	系列：	HC/UH
JESD-30 代码：	R-GDIP-T16	JESD-609代码：	e0
负载电容（CL）：	50 pF	逻辑集成电路类型：	OTHER DECODER/DRIVER
最大I（ol）：	0.004 A	功能数量：	1
端子数量：	16	最高工作温度：	125 °C
最低工作温度：	-55 °C	输出极性：	INVERTED
封装主体材料：	CERAMIC, GLASS-SEALED	封装代码：	DIP
封装等效代码：	DIP16,.3	封装形状：	RECTANGULAR
封装形式：	IN-LINE	峰值回流温度（摄氏度）：	NOT SPECIFIED
电源：	2/6 V	Prop。Delay @ Nom-Sup：	41 ns
传播延迟（tpd）：	22 ns	认证状态：	Not Qualified
座面最大高度：	5.08 mm	子类别：	Decoder/Drivers
最大供电电压 (Vsup)：	6 V	最小供电电压 (Vsup)：	2 V
标称供电电压 (Vsup)：	5 V	表面贴装：	NO
技术：	CMOS	温度等级：	MILITARY
端子面层：	Tin/Lead (Sn/Pb)	端子形式：	THROUGH-HOLE
端子节距：	2.54 mm	端子位置：	DUAL
处于峰值回流温度下的最长时间：	NOT SPECIFIED	宽度：	7.62 mm

M54HC137F1R 数据手册

M54HC137

M74HC137

3 TO 8 LINE DECODER/LATCH (INVERTING)

HIGH SPEED

t_PD= 11 ns (TYP.) AT V_CC= 5 V

LOW POWER DISSIPATION

I_CC= 4 µA (MAX.) AT T_A= 25 °C

HIGH NOISE IMMUNITY

V_NIH= V_NIL= 28 % V_CC(MIN.)

OUTPUT DRIVE CAPABILITY

10 LSTTL LOADS

SYMMETRICAL OUTPUT IMPEDANCE

IOH = I_OL= 4 mA (MIN.)

BALANCED PROPAGATION DELAYS

t_PLH= t_PHL

WIDE OPERATING VOLTAGE RANGE

B1R

(Plastic Package)

F1R

(Ceramic Package)

M1R

(Micro Package)

C1R

(Chip Carrier)

V_CC(OPR) = 2 V TO 6 V

PIN AND FUNCTION COMPATIBLE

WITH 54/74LS137

ORDER CODES :

M54HC137F1R

M74HC137B1R

M74HC137M1R

M74HC137C1R

DESCRIPTION

The M54/74HC137 is a high speed CMOS 3 TO 8LINE

DECODER/LATCH (INVERTING) fabricated in silicon

gate C²MOS technology. It has the same high speed

performance of LSTTL combined with true CMOS low

power consumption. This device is a 3 to 8line decoder

withlatches on thethree address inputs. When GL goes

from low tohigh, theaddress present at theselect inputs

(A, B and C) is stored in the latches. As long as GL re-

mains high no address changes will be recognized. Out-

put enable pins G1 and G2, control the state of the

outputs independently of the select or latch-enable in-

puts. All the outputs are high unless G1 is high and G2

is low. The HC137 is ideally suited for the implementa-

tion of glitch-free decoders in stored-address applica-

tions in bus oriented systems. All inputs are equipped

withprotection circuits against staticdischarge and tran-

sient excess voltage.

PIN CONNECTIONS (top view)

INPUT AND OUTPUT EQUIVALENT CIRCUIT

NC =

No Internal

Connection

February 1993

1/11

12 3 4 5 6 7...11

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