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M2004-01I622.0800T

更新时间： 2024-11-29 14:38:11
品牌 Logo 应用领域
艾迪悌 - IDT ATM异步传输模式电信电信集成电路
页数 文件大小 规格书
10页 310K
描述
CLCC-36, Reel

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M2004-01I622.0800T 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Obsolete零件包装代码：CLCC
包装说明：QCCN,针数：36
Reach Compliance Code：compliantHTS代码：8542.39.00.01
风险等级：5.82JESD-30 代码：S-CQCC-N36
JESD-609代码：e4长度：8.99 mm
湿度敏感等级：1功能数量：1
端子数量：36最高工作温度：85 °C
最低工作温度：-40 °C封装主体材料：CERAMIC, METAL-SEALED COFIRED
封装代码：QCCN封装形状：SQUARE
封装形式：CHIP CARRIER峰值回流温度（摄氏度）：240
座面最大高度：3.1 mm标称供电电压：3.3 V
表面贴装：YES电信集成电路类型：ATM/SONET/SDH SUPPORT CIRCUIT
温度等级：INDUSTRIAL端子面层：GOLD
端子形式：NO LEAD端子节距：0.64 mm
端子位置：QUAD处于峰值回流温度下的最长时间：NOT SPECIFIED
宽度：8.99 mmBase Number Matches：1

M2004-01I622.0800T 数据手册

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P r o d u c t D a t a S h e e t  
Integrated  
Circuit  
Systems, Inc.  
M2004-01/-11  
FREQUENCY TRANSLATION PLL  
GENERAL DESCRIPTION  
PIN ASSIGNMENT (9 x 9 mm SMT)  
The M2004 variants -01 and -11 are VCSO (Voltage  
Controlled SAW Oscillator) based  
clock generator PLLs designed for  
clock frequency translation and jitter  
attenuation in a high-speed data  
communications system. The clock  
multiplication ratio and output  
divider ratio are pin selectable and  
M1  
M2  
M3  
M4  
M5  
VCC  
DNC  
DNC  
DNC  
S_CLOCK  
MR  
nFOUT  
FOUT  
GND  
N1  
28  
29  
30  
31  
32  
33  
18  
17  
16  
15  
14  
13  
12  
11  
M2004-01  
M2004-11  
also configurable through serial programming. External  
loop components allow the tailoring of PLL loop  
response. The M2004-11 adds Hitless Switching with  
Phase Build-out (HS/PBO) to ensure that reference  
clock reselection does not disrupt the output clock.  
( T o p V i e w )  
34  
35  
36  
N0  
VCC  
GND  
10  
Also read about device variants -21, -31, -41, and  
-51 in the M2004-x1 Preliminary Information sheet.  
FEATURES  
◆ Ideal for OC-48/192 data clock  
◆ Integrated SAW (surface acoustic wave) delay line  
Figure 1: Pin Assignment  
Example Input / Output Frequency Combinations  
◆ VCSO frequency from 300 to 700MHz  
(Specify VCSO center frequency at time of order)  
Input Clock VCSO 1  
Output  
Application  
(MHz)  
Freq (MHz) Freq (MHz)  
◆ Low phase jitter of < 0.5ps rms, typical (12kHz to  
20MHz or 50kHz to 80MHz)  
19.44  
77.76  
◆ Pin-selectable or serially programmed configuration  
38.80  
77.76  
155.52  
25.00  
155.52  
622.08  
OC-12 / 48 /192  
Gigabit Ethernet  
◆ The M2004-11 adds Hitless Switching with Phase  
Build-out (HS/PBO) to ensure SONET/SDH MTIE and  
TDEV compliance during reference clock reselection  
311.04  
622.08  
625.00  
156.25  
◆ Reference clock inputs support single-ended  
LVCMOS, LVTTL  
Table 1: Example Input / Output Frequency Combinations  
◆ Industrial temperature available  
◆ Single 3.3V power supply  
Note 1: Specify VCSO center frequency at time of order  
◆ Small 9 x 9 mm SMT (surface mount) package  
SIMPLIFIED BLOCK DIAGRAM  
Loop  
Filter  
M2004-01/-11  
1
0
REF_CLK1  
REF_CLK0  
VCSO  
REF_SEL  
M Divider  
FOUT  
N Divider  
nFOUT  
S_DATA  
Pin Configuration Register  
S_CLOCK  
S_LOAD  
nP_LOAD  
with  
Serial Programming Option  
6
2
MR  
M5:0  
N1:0  
Figure 2: Simplified Block Diagram  
M2004-01/-11 Datasheet Rev 1.0  
Revised 03Jul2003  
M2004-01/-11 Frequency Translation PLL  
Integrated Circuit Systems, Inc. ● Communications Modules ● www.icst.com ● tel (508) 852-5400  
 
 
 
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型号 品牌 获取价格 描述 数据表
M2004-01I640.0000 IDT

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 		CLCC-36, Tube
M2004-02-500.0000 ICSI

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 		Support Circuit, 1-Func
M2004-02-500.0000LF IDT

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 		Support Circuit, 1-Func
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 		CLCC-36, Tube
M2004-02-622.0800LF IDT

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 		Support Circuit, 1-Func
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