LMK03001ISQX

更新时间： 2024-11-14 03:51:43

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美国国家半导体 - NSC		调节器时钟
页数	文件大小	规格书
30页	629K
描述
Precision Clock Conditioner with Integrated VCO

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LMK03001ISQX 技术参数

是否Rohs认证：	不符合	生命周期：	Transferred
包装说明：	7 X 7 MM, 0.80 MM HEIGHT, LLP-48	Reach Compliance Code：	not_compliant
ECCN代码：	EAR99	HTS代码：	8542.39.00.01
风险等级：	5.29	JESD-30 代码：	S-XQCC-N48
JESD-609代码：	e0	长度：	7 mm
湿度敏感等级：	2	端子数量：	48
最高工作温度：	85 °C	最低工作温度：	-40 °C
最大输出时钟频率：	1570 MHz	封装主体材料：	UNSPECIFIED
封装代码：	HVQCCN	封装形状：	SQUARE
封装形式：	CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE	主时钟/晶体标称频率：	200 MHz
认证状态：	Not Qualified	座面最大高度：	0.8 mm
最大供电电压：	3.45 V	最小供电电压：	3.15 V
标称供电电压：	3.3 V	表面贴装：	YES
技术：	CMOS	温度等级：	INDUSTRIAL
端子面层：	Tin/Lead (Sn85Pb15)	端子形式：	NO LEAD
端子节距：	0.5 mm	端子位置：	QUAD
宽度：	7 mm	uPs/uCs/外围集成电路类型：	CLOCK GENERATOR, OTHER
Base Number Matches：	1

LMK03001ISQX 数据手册

March 26, 2008

LMK03000 Family

Precision Clock Conditioner with Integrated VCO

General Description

Features

The LMK03000 family of precision clock conditioners com-

bine the functions of jitter cleaning/reconditioning, multiplica-

tion, and distribution of a reference clock. The devices

integrate a Voltage Controlled Oscillator (VCO), a high per-

formance Integer-N Phase Locked Loop (PLL), a partially

integrated loop filter, and up to eight outputs in various LVDS

and LVPECL combinations.

Integrated VCO with very low phase noise floor

■

Integrated Integer-N PLL with outstanding normalized

phase noise contribution of -224 dBc/Hz

VCO divider values of 2 to 8 (all divides)

Channel divider values of 1, 2 to 510 (even divides)

3 LVDS and 5 LVPECL clock outputs

Partially integrated loop filter

■

The VCO output is optionally accessible on the Fout port. In-

ternally, the VCO output goes through a VCO Divider to feed

the various clock distribution blocks.

Dedicated divider and delay blocks on each clock output

Pin compatible family of clocking devices

3.15 to 3.45 V operation

Each clock distribution block includes a programmable di-

vider, a phase synchronization circuit, a programmable delay,

a clock output mux, and an LVDS or LVPECL output buffer.

This allows multiple integer-related and phase-adjusted

copies of the reference to be distributed to eight system com-

ponents.

Package: 48 pin LLP (7.0 x 7.0 x 0.8 mm)

200 fs RMS Clock generator performance (10 Hz to 20

MHz) with a clean input clock

VCO Frequency

Range (MHz)

The clock conditioners come in a 48-pin LLP package and are

footprint compatible with other clocking devices in the same

family.

Part

RMS Jitter (fs)

LMK03000C

LMK03000

LMK03000D

LMK03001C

LMK03001

LMK03001D

400

800

1185 - 1296

Target Applications

1200

400

Data Converter Clocking

■

Networking, SONET/SDH, DSLAM

1470 - 1570

800

Wireless Infrastructure

1200

Medical

Test and Measurement

Military / Aerospace

System Diagram

20211440

TRI-STATE^®is a registered trademark of National Semiconductor Corporation.

202114

www.national.com

12 3 4 5 6 7...30

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与LMK03001ISQX相关器件

型号	品牌	获取价格	描述	数据表
LMK03001ISQX/NOPB	NSC	获取价格	IC 800 MHz, OTHER CLOCK GENERATOR, QCC48, LEAD FREE, 7 X 7 MM, 0.80 MM HEIGHT, LLP-48, Clo
LMK03001ISQX/NOPB	TI	获取价格	Precision Clock Conditioner
LMK03001X	NSC	获取价格	Precision Clock Conditioner with Integrated VCO
LMK03002	NSC	获取价格	Precision Clock Conditioner with Integrated VCO
LMK03002	TI	获取价格	具有集成 VCO 的 1566 至 1724MHz、800FS RMS 抖动、精密时钟调节
LMK03002C	NSC	获取价格	Precision Clock Conditioner with Integrated VCO
LMK03002CISQ	NSC	获取价格	Precision Clock Conditioner with Integrated VCO
LMK03002CISQ/NOPB	TI	获取价格	具有集成 VCO 的 1566 至 1724MHz、800FS RMS 抖动、精密时钟调节
LMK03002CISQX	NSC	获取价格	Precision Clock Conditioner with Integrated VCO
LMK03002CISQX/NOPB	TI	获取价格	具有集成 VCO 的 1566 至 1724MHz、800FS RMS 抖动、精密时钟调节

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