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LMK03200ISQ

更新时间： 2024-11-14 05:42:27

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美国国家半导体 - NSC		调节器时钟
页数	文件大小	规格书
40页	757K
描述
Precision 0-Delay Clock Conditioner with Integrated VCO

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LMK03200ISQ 技术参数

是否Rohs认证：	不符合	生命周期：	Transferred
包装说明：	HVQCCN, LCC48,.27SQ,20	Reach Compliance Code：	compliant
HTS代码：	8542.39.00.01	风险等级：	5.33
系列：	03200	输入调节：	DIFFERENTIAL
JESD-30 代码：	S-XQCC-N48	JESD-609代码：	e0
长度：	7 mm	逻辑集成电路类型：	PLL BASED CLOCK DRIVER
最大I（ol）：	0.0005 A	功能数量：	1
反相输出次数：		端子数量：	48
实输出次数：	8	最高工作温度：	85 °C
最低工作温度：	-40 °C	输出特性：	3-STATE
封装主体材料：	UNSPECIFIED	封装代码：	HVQCCN
封装等效代码：	LCC48,.27SQ,20	封装形状：	SQUARE
封装形式：	CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE	峰值回流温度（摄氏度）：	NOT SPECIFIED
电源：	3.3 V	认证状态：	Not Qualified
Same Edge Skew-Max（tskwd）：	0.03 ns	座面最大高度：	0.8 mm
子类别：	Clock Drivers	最大供电电压 (Vsup)：	3.45 V
最小供电电压 (Vsup)：	3.15 V	标称供电电压 (Vsup)：	3.3 V
表面贴装：	YES	温度等级：	INDUSTRIAL
端子面层：	Tin/Lead (Sn/Pb)	端子形式：	NO LEAD
端子节距：	0.5 mm	端子位置：	QUAD
处于峰值回流温度下的最长时间：	NOT SPECIFIED	宽度：	7 mm
最小 fmax：	1296 MHz	Base Number Matches：	1

LMK03200ISQ 数据手册

August 20, 2009

LMK03200 Family

Precision 0-Delay Clock Conditioner with Integrated VCO

General Description

Features

The LMK03200 family of precision clock conditioners com-

bine the functions of jitter cleaning/reconditioning, multiplica-

tion, and 0-delay distribution of a reference clock. The devices

integrate a Voltage Controlled Oscillator (VCO), a high per-

formance Integer-N Phase Locked Loop (PLL), a partially

integrated loop filter, and up to eight outputs in various LVDS

and LVPECL combinations.

Integrated VCO with very low phase noise floor

■

Integrated Integer-N PLL with outstanding normalized

phase noise contribution of -224 dBc/Hz

VCO divider values of 2 to 8 (all divides)

■

Bypassable with VCO Mux when not in 0-delay mode

—

Channel divider values of 1, 2 to 510 (even divides)

■

The VCO output is optionally accessible on the Fout port. In-

ternally, the VCO output goes through a VCO divider to feed

the various clock distribution blocks.

LVDS and LVPECL clock outputs

Partially integrated loop filter

Dedicated divider and delay blocks on each clock output

0-delay outputs

Each clock distribution block includes a programmable di-

vider, a phase synchronization circuit, a programmable delay,

a clock output mux, and an LVDS or LVPECL output buffer.

The PLL also features delay blocks to permit global phase

adjustment of clock output phase. This allows multiple inte-

ger-related and phase-adjusted copies of the reference to be

distributed to eight system components.

Internal or external feedback of output clock

Delay blocks on N and R phase detector inputs for lead/

lag global skew adjust

Pin compatible family of clocking devices

3.15 to 3.45 V operation

■

The clock conditioners come in a 48-pin LLP package and are

footprint compatible with other clocking devices in the same

family.

Package: 48 pin LLP (7.0 x 7.0 x 0.8 mm)

200 fs RMS Clock generator performance (10 Hz to 20

MHz) with a clean input clock

Target Applications

VCO

Data Converter Clocking

■

Device

Outputs

Tuning Range RMS Jitter

Networking, SONET/SDH, DSLAM

(MHz)

(fs)

Wireless Infrastructure

3 LVDS

5 LVPECL

LMK03200

1185 - 1296

800

Medical

Test and Measurement

■

Military / Aerospace

■

System Diagram

30088740

TRI-STATE^®is a registered trademark of National Semiconductor Corporation.

300887

www.national.com

12 3 4 5 6 7...40

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型号	品牌	获取价格	描述	数据表
LMK03200ISQ/NOPB	TI	获取价格	具有集成 VCO 的精密 0 延迟时钟调节器 \| RHS \| 48 \| -40 to 85
LMK03200ISQE	NSC	获取价格	Precision 0-Delay Clock Conditioner with Integrated VCO
LMK03200ISQE/NOPB	TI	获取价格	具有集成 VCO 的精密 0 延迟时钟调节器 \| RHS \| 48 \| -40 to 85
LMK03200ISQX	NSC	获取价格	Precision 0-Delay Clock Conditioner with Integrated VCO
LMK03200ISQX/NOPB	TI	获取价格	具有集成 VCO 的精密 0 延迟时钟调节器 \| RHS \| 48 \| -40 to 85
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LMK03318RHSR	TI	获取价格	具有单个 PLL 的超低抖动时钟发生器系列 \| RHS \| 48 \| -40 to 85
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