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KMM372C804BS-5

更新时间： 2024-11-11 15:36:27
品牌 Logo 应用领域
三星 - SAMSUNG 动态存储器内存集成电路
页数 文件大小 规格书
19页 422K
描述
Fast Page DRAM Module, 8MX72, 50ns, CMOS, GLASS EPOXY, DIMM-168

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KMM372C804BS-5 技术参数

生命周期：Obsolete零件包装代码：DIMM
包装说明：DIMM, DIMM168针数：168
Reach Compliance Code：unknownECCN代码：EAR99
HTS代码：8542.32.00.32风险等级：5.84
访问模式：FAST PAGE最长访问时间：50 ns
I/O 类型：COMMONJESD-30 代码：R-XDMA-N168
内存密度：603979776 bit内存集成电路类型：FAST PAGE DRAM MODULE
内存宽度：72功能数量：1
端口数量：2端子数量：168
字数：8388608 words字数代码：8000000
工作模式：ASYNCHRONOUS最高工作温度：70 °C
最低工作温度：组织：8MX72
输出特性：3-STATE封装主体材料：UNSPECIFIED
封装代码：DIMM封装等效代码：DIMM168
封装形状：RECTANGULAR封装形式：MICROELECTRONIC ASSEMBLY
电源：5 V认证状态：Not Qualified
刷新周期：4096座面最大高度：25.4 mm
最大待机电流：0.03 A子类别：Other Memory ICs
最大压摆率：0.76 mA最大供电电压 (Vsup)：5.5 V
最小供电电压 (Vsup)：4.5 V标称供电电压 (Vsup)：5 V
表面贴装：NO技术：CMOS
温度等级：COMMERCIAL端子形式：NO LEAD
端子节距：1.27 mm端子位置：DUAL
Base Number Matches：1

KMM372C804BS-5 数据手册

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KMM372C804BS  
DRAM MODULE  
KMM372C804BS Fast Page Mode  
8M x 72 DRAM DIMM with ECC Using 4Mx16 & 4Mx4, 4K Refresh, 5V  
GENERAL DESCRIPTION  
FEATURES  
The Samsung KMM372C804B is a 8Mx72bits Dynamic RAM  
high density memory module. The Samsung KMM372C804B  
consists of eight 4Mx16bits & four 4Mx4bits CMOS DRAMs in  
TSOP-II 400mil packages and two 16 bits driver IC in TSSOP  
package mounted on a 168-pin glass-epoxy substrate. A 0.1  
or 0.22uF decoupling capacitor is mounted on the printed cir-  
cuit board for each DRAM. The KMM372C804B is a Dual In-  
line Memory Module and is intended for mounting into 168 pin  
edge connector sockets.  
• Part Identification  
- KMM372C804BS(4096cycles/64ms Ref. TSOP ll)  
• Fast Page Mode Operation  
• CAS-before-RAS Refresh capability  
• RAS-only and Hidden refresh capability  
• TTL compatible inputs and outputs  
• Single 5V±10% power supply  
• JEDEC standard pinout & Buffered PDpin  
• Buffered input except RAS and DQ  
• PCB : Height(1000mil), double sided component  
PERFORMANCE RANGE  
Speed  
tRAC  
50ns  
60ns  
tCAC  
18ns  
20ns  
tRC  
tPC  
-5  
90ns  
110ns  
35ns  
40ns  
-6  
PIN NAMES  
PIN CONFIGURATIONS  
Pin  
Pin Front Pin Front  
Front Pin Back Pin Back Pin Back  
Pin Names  
Function  
A0, B0, A1 - A11 Address Input(4K ref.)  
57  
58  
59  
60  
61  
62  
63  
64  
65  
66  
67  
68  
69  
70  
71  
72  
73  
74  
75  
76  
77  
78  
79  
80  
81  
82  
83  
84  
1
2
3
4
5
6
7
8
9
VSS  
29 *CAS2  
DQ22 85  
DQ23 86 DQ36 114 RAS1 142 DQ59  
87 DQ37 115 RFU 143 VCC  
DQ24 88 DQ38 116 VSS 144 DQ60  
VSS 113 *CAS3 141 DQ58  
DQ0 - DQ71  
W0, W2  
OE0, OE2  
RAS0 - RAS3  
CAS0, 1,4,5  
VCC  
Data In/Out  
DQ0 30 RAS0  
DQ1 31 OE0  
DQ2 32  
DQ3 33  
VCC  
Read/Write Enable  
Output Enable  
VSS  
A0  
RFU 89 DQ39 117  
RFU 90 VCC 118  
RFU 91 DQ40 119  
RFU 92 DQ41 120  
DQ25 93 DQ42 121  
A1  
A3  
A5  
A7  
A9  
145 RFU  
146 RFU  
147 RFU  
148 RFU  
149 DQ61  
Row Address Strobe  
Column Address Strobe  
Power(+5V)  
VCC  
34  
A2  
DQ4 35  
DQ5 36  
DQ6 37  
A4  
A6  
A8  
VSS  
Ground  
10 DQ7 38  
11 DQ8 39  
12  
13 DQ9 41 RFU  
14 DQ10 42 RFU  
15 DQ11 43  
16 DQ12 44 OE2  
17 DQ13 45 RAS2  
18  
19 DQ14 47 *CAS6  
20 DQ15 48  
21 DQ16 49  
22 DQ17 50 RSVD  
23 51 RSVD  
24 RSVD 52 DQ18  
25 RSVD 53 DQ19  
26  
27  
A10  
A12  
VCC  
DQ26 94 DQ43 122 A11 150 DQ62  
DQ27 95 DQ44 123 *A13 151 DQ63  
NC  
No Connection  
Presence Detect Enable  
Presence Detect  
ID bit  
VSS  
40  
VSS  
96  
DQ28 97 DQ45 125 RFU 153 DQ64  
DQ29 98 DQ46 126 B0 154 DQ65  
VSS 124 VCC 152 VSS  
PDE  
PD1 - 8  
ID0 - 1  
VSS  
DQ30 99 DQ47 127 VSS 155 DQ66  
DQ31 100 DQ48 128 RFU 156 DQ67  
VCC 101 DQ49 129 RAS3 157 VCC  
DQ32 102 VCC 130 CAS5 158 DQ68  
DQ33 103 DQ50 131 *CAS7 159 DQ69  
DQ34 104 DQ51 132 PDE 160 DQ70  
DQ35 105 DQ52 133 VCC 161 DQ71  
VSS 106 DQ53 134 RSVD 162 VSS  
PD1 107 VSS 135 RSVD 163 PD2  
PD3 108 RSVD 136 DQ54 164 PD4  
PD5 109 RSVD 137 DQ55 165 PD6  
PD7 110 VCC 138 VSS 166 PD8  
ID0 111 RFU 139 DQ56 167 ID1  
VCC 112 CAS1 140 DQ57 168 VCC  
RSVD  
Reserved Use  
RFU  
Reserved for Future Use  
VCC  
46 CAS4  
Pins marked ¢*¢ are not used in this module.  
W2  
VCC  
PD & ID Table  
Pin  
50NS  
60NS  
VSS  
PD1  
PD2  
PD3  
PD4  
PD5  
PD6  
PD7  
PD8  
0
0
1
1
0
0
0
0
0
0
1
1
0
1
1
0
VCC  
W0  
54  
VSS  
55 DQ20  
28 CAS0 56 DQ21  
ID0  
ID1  
0
0
0
0
PD Note :PD & ID Terminals must each be pulled up through a register to V CC at the next higher  
level assembly. PDs will be either open (NC) or driven to V SS via on-board buffer circuits.  
ID Note : IDs will be either open (NC) or connected directly to V SS without a buffer.  
PD : 0 for Vol of Drive IC & 1 for N.C  
ID : 0 for Vss & 1 for N.C  
1234567...19

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