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IDT74ALVCH16701PV8

更新时间： 2024-11-26 21:02:47

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艾迪悌 - IDT		先进先出芯片光电二极管
页数	文件大小	规格书
8页	149K
描述
FIFO, 4X18, 5.5ns, Synchronous, CMOS, PDSO56, 0.635 MM PITCH, SSOP-56

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IDT74ALVCH16701PV8 技术参数

生命周期：	Obsolete	零件包装代码：	SSOP
包装说明：	SSOP,	针数：	56
Reach Compliance Code：	unknown	ECCN代码：	EAR99
HTS代码：	8542.32.00.71	风险等级：	5.84
最长访问时间：	5.5 ns	其他特性：	CAN ALSO BE OPERATED AT 2.5V+/-0.2V
周期时间：	12 ns	JESD-30 代码：	R-PDSO-G56
JESD-609代码：	e0	长度：	18.415 mm
内存密度：	72 bit	内存宽度：	18
功能数量：	1	端子数量：	56
字数：	4 words	字数代码：	4
工作模式：	SYNCHRONOUS	最高工作温度：	85 °C
最低工作温度：	-40 °C	组织：	4X18
可输出：	YES	封装主体材料：	PLASTIC/EPOXY
封装代码：	SSOP	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE, SHRINK PITCH	并行/串行：	PARALLEL
认证状态：	Not Qualified	座面最大高度：	2.794 mm
最大供电电压 (Vsup)：	3.6 V	最小供电电压 (Vsup)：	2.7 V
标称供电电压 (Vsup)：	3.3 V	表面贴装：	YES
技术：	CMOS	温度等级：	INDUSTRIAL
端子面层：	TIN LEAD	端子形式：	GULL WING
端子节距：	0.635 mm	端子位置：	DUAL
宽度：	7.5 mm	Base Number Matches：	1

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IDT74ALVCH16701

3.3V CMOS 18-BIT READ/WRITE BUFFER WITH BUS-HOLD

EXTENDED COMMERCIAL TEMPERATURE RANGE

IDT74ALVCH16701

3.3V CMOS 18-BIT

READ/WRITE BUFFER

WITH BUS-HOLD

FEATURES:

DESCRIPTION:

–

0.5 MICRON CMOS Technology

Typical t^SK(0)(Output Skew) < 250ps

This 18-bit read/write buffer is built using advanced dual metal CMOS

technology. The ALVCH16701 is equipped with a four deep FIFO and

a read-back latch. It can be used as a read/write buffer between a CPU

and a memory or to interface a high-speed bus and a slow peripheral.

The A-to-B (write) path has a four deep FIFO for pipelined operations.

The FIFO can be reset and a FIFO full condition is indicated by the full

flag (FF). The B-to-A (read) path has a latch.

ESD > 2000V per MIL-STD-883, Method 3015;

> 200V using machine model (C = 200pF, R = 0)

0.635mm pitch SSOP, 0.50mm pitch TSSOP,

and 0.40mm pitch TVSOP packages

Extended commercial range of – 40°C to + 85°C

V^CC= 3.3V ± 0.3V, Normal Range

V^CC= 2.7V to 3.6V, Extended Range

V^CC= 2.5V ± 0.2V

CMOS power levels (0.4µW typ. static)

Rail-to-Rail output swing for increased noise margin

–

The ALVCH16701 has been designed with a ±24mA output driver.

This driver is capable of driving a moderate to heavy load while

maintaining speed performance.

The ALVCH16701 has “bus-hold” which retains the inputs’ last state

whenever the input goes to a high impedance. This prevents floating

inputs and eliminates the need for pull-up/down resistor.

Drive Features for ALVCH16701:

–

High Output Drivers: ±24mA

Suitable for heavy loads

APPLICATIONS:

• 3.3V High Speed Systems

• 3.3V and lower voltage computing systems

FUNCTIONAL BLOCK DIAGRAM

A1:18

OEBA

RESET

CLK

FIFO

(4 deep)

WCE

LATCH

RCE

OEAB

B1:18

EXTENDEDCOMMERCIALTEMPERATURERANGE

SEPTEMBER 1999

1999 Integrated Device Technology, Inc.

DSC-4222/-

12 3 4 5 6 7 8

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