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IDT70T9359L7BF

更新时间： 2024-10-29 05:12:11
品牌 Logo 应用领域
艾迪悌 - IDT 存储内存集成电路静态存储器
页数 文件大小 规格书
16页 203K
描述
HIGH-SPEED 2.5V 8/4K x 18 SYNCHRONOUS PIPELINED DUAL-PORT STATIC RAM

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IDT70T9359L7BF 技术参数

是否无铅：含铅是否Rohs认证：不符合
生命周期：Obsolete零件包装代码：BGA
包装说明：FPBGA-100针数：100
Reach Compliance Code：not_compliantECCN代码：EAR99
HTS代码：8542.32.00.41风险等级：5.92
Is Samacsys：N最长访问时间：18 ns
其他特性：FLOW-THROUGH OR PIPELINED ARCHITECTUREJESD-30 代码：S-PBGA-B100
JESD-609代码：e0长度：10 mm
内存密度：147456 bit内存集成电路类型：DUAL-PORT SRAM
内存宽度：18功能数量：1
端子数量：100字数：8192 words
字数代码：8000工作模式：SYNCHRONOUS
最高工作温度：70 °C最低工作温度：
组织：8KX18封装主体材料：PLASTIC/EPOXY
封装代码：LFBGA封装形状：SQUARE
封装形式：GRID ARRAY, LOW PROFILE, FINE PITCH并行/串行：PARALLEL
峰值回流温度（摄氏度）：225认证状态：Not Qualified
座面最大高度：1.5 mm最大供电电压 (Vsup)：2.6 V
最小供电电压 (Vsup)：2.4 V标称供电电压 (Vsup)：2.5 V
表面贴装：YES技术：CMOS
温度等级：COMMERCIAL端子面层：TIN LEAD
端子形式：BALL端子节距：0.8 mm
端子位置：BOTTOM处于峰值回流温度下的最长时间：30
宽度：10 mmBase Number Matches：1

IDT70T9359L7BF 数据手册

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PRELIMINARY  
IDT70T9359/49L  
HIGH-SPEED 2.5V 8/4K x 18  
SYNCHRONOUS PIPELINED  
DUAL-PORT STATIC RAM  
◆
ꢀeatures:  
Full synchronous operation on both ports  
– 4.0ns setup to clock and 0.5ns hold on all control, data, and  
addressinputs  
– Data input, address, and control registers  
– Fast 7.5ns clock to data out in the Pipelined output mode  
– Self-timedwriteallowsfastcycletime  
– 12ns cycle time, 83MHz operation in Pipelined output mode  
Separate upper-byte and lower-byte controls for  
multiplexed bus and bus matching compatibility  
LVTTL- compatible, single 2.5V (±100mV) power supply  
Industrial temperature range (–40°C to +85°C) is  
available for 66MHz  
◆
True Dual-Ported memory cells which allow simultaneous  
access of the same memory location  
High-speed clock to data access  
– Commercial:7.5/9/12ns(max.)  
– Industrial:9ns (max.)  
◆
◆
Low-power operation  
◆
– IDT70T9359/49L  
Active:225mW(typ.)  
◆
◆
Standby: 1.5mW (typ.)  
Flow-Through or Pipelined output mode on either port via  
the FT/PIPE pins  
Counter enable and reset features  
Dual chip enables allow for depth expansion without  
additional logic  
◆
◆
◆
◆
Available in a 100-pin Thin Quad Flatpack (TQFP) and 100-  
pin fine pitch Ball Grid Array (fpBGA) packages.  
ꢀunctionalBlockDiagram  
R/WL  
UBL  
R/WR  
UBR  
CE0L  
CE1L  
CE0R  
CE1R  
1
0
1
0
0/1  
0/1  
LBL  
LBR  
OEL  
OER  
1b 0b  
0a 1a  
0b 1b  
1a 0a  
a
FT/PIPEL  
0/1  
0/1  
b
a
b
FT/PIPER  
I/O9L-I/O17L  
I/O0L-I/O8L  
I/O9R-I/O17R  
I/O0R-I/O8R  
I/O  
Control  
I/O  
Control  
(1)  
(1)  
A12L  
A12R  
Counter/  
Address  
Reg.  
Counter/  
Address  
Reg.  
MEMORY  
ARRAY  
A0R  
A0L  
CLKL  
ADSL  
CLKR  
ADSR  
CNTENR  
CNTENL  
CNTRSTL  
CNTRSTR  
5640 drw 01  
NOTE:  
1. A12 is a NC for IDT70T9349.  
JULY 2002  
1
©2002 IntegratedDeviceTechnology,Inc.  
DSC-5640/1  
1234567...16

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型号 品牌 获取价格 描述 数据表
IDT70T9359L7BFG IDT

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 		Dual-Port SRAM, 8KX18, 18ns, CMOS, PBGA100, FPBGA-100
IDT70T9359L7BFI IDT

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 		HIGH-SPEED 2.5V 8/4K x 18 SYNCHRONOUS PIPELINED DUAL-PORT STATIC RAM
IDT70T9359L7PF IDT

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 		HIGH-SPEED 2.5V 8/4K x 18 SYNCHRONOUS PIPELINED DUAL-PORT STATIC RAM
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