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IDT70T9359L9PF

更新时间： 2024-10-29 05:12:11
品牌 Logo 应用领域
艾迪悌 - IDT /
页数 文件大小 规格书
16页 203K
描述
HIGH-SPEED 2.5V 8/4K x 18 SYNCHRONOUS PIPELINED DUAL-PORT STATIC RAM

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IDT70T9359L9PF 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
零件包装代码：QFP包装说明：TQFP-100
针数：100Reach Compliance Code：not_compliant
ECCN代码：EAR99HTS代码：8542.32.00.41
风险等级：5.92最长访问时间：20 ns
其他特性：FLOW-THROUGH OR PIPELINED ARCHITECTUREJESD-30 代码：S-PQFP-G100
JESD-609代码：e0长度：14 mm
内存密度：147456 bit内存集成电路类型：DUAL-PORT SRAM
内存宽度：18湿度敏感等级：3
功能数量：1端子数量：100
字数：8192 words字数代码：8000
工作模式：SYNCHRONOUS最高工作温度：70 °C
最低工作温度：组织：8KX18
封装主体材料：PLASTIC/EPOXY封装代码：LFQFP
封装形状：SQUARE封装形式：FLATPACK, LOW PROFILE, FINE PITCH
并行/串行：PARALLEL峰值回流温度（摄氏度）：240
认证状态：Not Qualified座面最大高度：1.6 mm
最大供电电压 (Vsup)：2.6 V最小供电电压 (Vsup)：2.4 V
标称供电电压 (Vsup)：2.5 V表面贴装：YES
技术：CMOS温度等级：COMMERCIAL
端子面层：Tin/Lead (Sn85Pb15)端子形式：GULL WING
端子节距：0.5 mm端子位置：QUAD
处于峰值回流温度下的最长时间：20宽度：14 mm
Base Number Matches：1

IDT70T9359L9PF 数据手册

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PRELIMINARY  
IDT70T9359/49L  
HIGH-SPEED 2.5V 8/4K x 18  
SYNCHRONOUS PIPELINED  
DUAL-PORT STATIC RAM  
◆
ꢀeatures:  
Full synchronous operation on both ports  
– 4.0ns setup to clock and 0.5ns hold on all control, data, and  
addressinputs  
– Data input, address, and control registers  
– Fast 7.5ns clock to data out in the Pipelined output mode  
– Self-timedwriteallowsfastcycletime  
– 12ns cycle time, 83MHz operation in Pipelined output mode  
Separate upper-byte and lower-byte controls for  
multiplexed bus and bus matching compatibility  
LVTTL- compatible, single 2.5V (±100mV) power supply  
Industrial temperature range (–40°C to +85°C) is  
available for 66MHz  
◆
True Dual-Ported memory cells which allow simultaneous  
access of the same memory location  
High-speed clock to data access  
– Commercial:7.5/9/12ns(max.)  
– Industrial:9ns (max.)  
◆
◆
Low-power operation  
◆
– IDT70T9359/49L  
Active:225mW(typ.)  
◆
◆
Standby: 1.5mW (typ.)  
Flow-Through or Pipelined output mode on either port via  
the FT/PIPE pins  
Counter enable and reset features  
Dual chip enables allow for depth expansion without  
additional logic  
◆
◆
◆
◆
Available in a 100-pin Thin Quad Flatpack (TQFP) and 100-  
pin fine pitch Ball Grid Array (fpBGA) packages.  
ꢀunctionalBlockDiagram  
R/WL  
UBL  
R/WR  
UBR  
CE0L  
CE1L  
CE0R  
CE1R  
1
0
1
0
0/1  
0/1  
LBL  
LBR  
OEL  
OER  
1b 0b  
0a 1a  
0b 1b  
1a 0a  
a
FT/PIPEL  
0/1  
0/1  
b
a
b
FT/PIPER  
I/O9L-I/O17L  
I/O0L-I/O8L  
I/O9R-I/O17R  
I/O0R-I/O8R  
I/O  
Control  
I/O  
Control  
(1)  
(1)  
A12L  
A12R  
Counter/  
Address  
Reg.  
Counter/  
Address  
Reg.  
MEMORY  
ARRAY  
A0R  
A0L  
CLKL  
ADSL  
CLKR  
ADSR  
CNTENR  
CNTENL  
CNTRSTL  
CNTRSTR  
5640 drw 01  
NOTE:  
1. A12 is a NC for IDT70T9349.  
JULY 2002  
1
©2002 IntegratedDeviceTechnology,Inc.  
DSC-5640/1  
1234567...16

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IDT70T9359L9PF 替代型号

型号 品牌 替代类型 描述 数据表
IDT70V9359L7PFI IDT

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