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IDT70T35L20BF

更新时间： 2024-10-28 22:57:19
品牌 Logo 应用领域
艾迪悌 - IDT 存储内存集成电路静态存储器
页数 文件大小 规格书
21页 159K
描述
HIGH-SPEED 2.5V 8/4K x 18 DUAL-PORT 8/4K x 16 DUAL-PORT STATIC RAM

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IDT70T35L20BF 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
零件包装代码：BGA包装说明：FPBGA-100
针数：100Reach Compliance Code：not_compliant
ECCN代码：EAR99HTS代码：8542.32.00.41
风险等级：5.92Is Samacsys：N
最长访问时间：20 nsJESD-30 代码：S-PBGA-B100
JESD-609代码：e0长度：10 mm
内存密度：147456 bit内存集成电路类型：DUAL-PORT SRAM
内存宽度：18功能数量：1
端子数量：100字数：8192 words
字数代码：8000工作模式：ASYNCHRONOUS
最高工作温度：70 °C最低工作温度：
组织：8KX18封装主体材料：PLASTIC/EPOXY
封装代码：LFBGA封装形状：SQUARE
封装形式：GRID ARRAY, LOW PROFILE, FINE PITCH并行/串行：PARALLEL
峰值回流温度（摄氏度）：225认证状态：Not Qualified
座面最大高度：1.5 mm最大供电电压 (Vsup)：2.6 V
最小供电电压 (Vsup)：2.4 V标称供电电压 (Vsup)：2.5 V
表面贴装：YES技术：CMOS
温度等级：COMMERCIAL端子面层：TIN LEAD
端子形式：BALL端子节距：0.8 mm
端子位置：BOTTOM处于峰值回流温度下的最长时间：30
宽度：10 mmBase Number Matches：1

IDT70T35L20BF 数据手册

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HIGH-SPEED 2.5V  
8/4K x 18 DUAL-PORT  
8/4K x 16 DUAL-PORT  
STATIC RAM  
PRELIMINARY  
IDT70T35/34L  
IDT70T25/24L  
Features  
◆
width to 36 bits (32 bits) or more using the Master/Slave  
select when cascading more than one device  
M/S = VIH for BUSY output flag on Master  
M/S = VIL for BUSY input on Slave  
BUSY and Interrupt Flag  
On-chip port arbitration logic  
True Dual-Ported memory cells which allow simultaneous  
reads of the same memory location  
High-speed access  
◆
◆
IDT70T35/34L (IDT70T25/24L)  
– Commercial:20/25ns (max.)  
– Industrial:25ns (max.)  
◆
◆
◆
◆
Full on-chip hardware support of semaphore signaling  
between ports  
Low-power operation  
– IDT70T35/34L (IDT70T25/24L)  
Active:200mW(typ.)  
◆
◆
◆
Fully asynchronous operation from either port  
LVTTL-compatible, single 2.5V (±100mV) power supply  
Available in a 100-pin Thin Quad Flatpack (TQFP) package  
and 100-pin fine pitch Ball Grid Array (fpBGA)  
Industrial temperature range (-40°C to +85°C) is available  
for selected speeds  
Standby: 600µW (typ.)  
Separate upper-byte and lower-byte control for multiplexed  
◆
bus compatibility  
IDT70T35/34L (IDT70T25/24L) easily expands data bus  
◆
◆
Functional Block Diagram  
R/W  
L
R/W  
R
R
UBL  
UB  
LB  
CE  
OE  
R
LB  
CE  
OE  
L
R
R
L
L
,
(5)  
(5)  
(4)  
I/O9R-I/O17R  
I/O9L-I/O17L  
I/O  
Control  
I/O  
Control  
(4)  
I/O0R-I/O8R  
I/O0L-I/O8L  
(2,3)  
L
(2,3)  
BUSY  
R
BUSY  
(1)  
12L  
(1)  
A
A
12R  
Address  
Decoder  
MEMORY  
ARRAY  
Address  
Decoder  
A0L  
A0R  
13  
13  
ARBITRATION  
INTERRUPT  
SEMAPHORE  
LOGIC  
CE  
OE  
R/W  
R
CE  
OE  
R/W  
L
R
L
R
L
SEM  
R
SEM  
L
(3)  
(3)  
INTR  
M/S  
INTL  
5639 drw 01  
NOTES:  
1. A12 is a NC for IDT70T34 and IDT70T24.  
2. (MASTER): BUSY is output; (SLAVE): BUSY is input.  
3. BUSY outputs and INT outputs are non-tri-stated push-pull.  
4. I/O0x - I/O7x for IDT70T25/24.  
5. I/O8x - I/O15x for IDT70T25/24.  
DECEMBER 2002  
1
DSC-5639/2  
©2002 IntegratedDeviceTechnology,Inc.  
1234567...21

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与IDT70T35L20BF相关器件

型号 品牌 获取价格 描述 数据表
IDT70T35L20BFG IDT

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 		Dual-Port SRAM, 8KX18, 20ns, CMOS, PBGA100, FPBGA-100
IDT70T35L20BFI IDT

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 		HIGH-SPEED 2.5V 8/4K x 18 DUAL-PORT 8/4K x 16 DUAL-PORT STATIC RAM
IDT70T35L20PF IDT

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IDT70T35L20PF8 IDT

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