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EPM570M100I4N

更新时间： 2024-09-14 15:42:19
品牌 Logo 应用领域
英特尔 - INTEL LTE输入元件可编程逻辑
页数 文件大小 规格书
86页 1210K
描述
Flash PLD, 7ns, 440-Cell, CMOS, PBGA100, 6 X 6 MM, 0.50 MM PITCH, LEAD FREE, MICRO, FBGA-100

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EPM570M100I4N 技术参数

是否Rohs认证： 符合生命周期：Active
包装说明：BGA, BGA100,11X11,20Reach Compliance Code：compliant
HTS代码：8542.39.00.01风险等级：5.06
其他特性：IT CAN ALSO OPERATE AT 3.3V系统内可编程：YES
JESD-30 代码：S-PBGA-B100JESD-609代码：e1
JTAG BST：YES专用输入次数：
I/O 线路数量：76宏单元数：440
端子数量：100组织：0 DEDICATED INPUTS, 76 I/O
输出函数：MACROCELL封装主体材料：PLASTIC/EPOXY
封装代码：BGA封装等效代码：BGA100,11X11,20
封装形状：SQUARE封装形式：GRID ARRAY
峰值回流温度（摄氏度）：260电源：1.5/3.3,2.5/3.3 V
可编程逻辑类型：FLASH PLD传播延迟：7 ns
认证状态：Not Qualified子类别：Programmable Logic Devices
最大供电电压：2.625 V最小供电电压：2.375 V
标称供电电压：2.5 V表面贴装：YES
技术：CMOS端子面层：TIN SILVER COPPER
端子形式：BALL端子节距：0.5 mm
端子位置：BOTTOM处于峰值回流温度下的最长时间：40
Base Number Matches：1

EPM570M100I4N 数据手册

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Section I. MAX II Device Family Data  
Sheet  
®
This section provides designers with the data sheet specifications for MAX II devices.  
The chapters contain feature definitions of the internal architecture, Joint Test Action  
Group (JTAG) and in-system programmability (ISP) information, DC operating  
conditions, AC timing parameters, and ordering information for MAX II devices.  
This section includes the following chapters:  
■
■
■
■
■
■
Chapter 1, Introduction  
Chapter 2, MAX II Architecture  
Chapter 3, JTAG and In-System Programmability  
Chapter 4, Hot Socketing and Power-On Reset in MAX II Devices  
Chapter 5, DC and Switching Characteristics  
Chapter 6, Reference and Ordering Information  
Revision History  
Refer to each chapter for its own specific revision history. For information about when  
each chapter was updated, refer to the Chapter Revision Dates section, which appears  
in the complete handbook.  
© October 2008 Altera Corporation  
MAX II Device Handbook  
1234567...86

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