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EPF6016AFC256-3

更新时间： 2024-01-19 11:20:19
品牌 Logo 应用领域
阿尔特拉 - ALTERA 时钟LTE栅输入元件可编程逻辑
页数 文件大小 规格书
52页 375K
描述
Loadable PLD, CMOS, PBGA256, FINE LINE, BGA-256

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EPF6016AFC256-3 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Transferred零件包装代码：BGA
包装说明：BGA,针数：256
Reach Compliance Code：compliantHTS代码：8542.39.00.01
风险等级：5.14最大时钟频率：133 MHz
JESD-30 代码：S-PBGA-B256JESD-609代码：e1
长度：17 mm专用输入次数：4
I/O 线路数量：171端子数量：256
最高工作温度：85 °C最低工作温度：
组织：4 DEDICATED INPUTS, 171 I/O输出函数：MACROCELL
封装主体材料：PLASTIC/EPOXY封装代码：BGA
封装形状：SQUARE封装形式：GRID ARRAY
峰值回流温度（摄氏度）：260可编程逻辑类型：LOADABLE PLD
认证状态：Not Qualified座面最大高度：2.1 mm
最大供电电压：3.6 V最小供电电压：3 V
标称供电电压：3.3 V表面贴装：YES
温度等级：OTHER端子面层：TIN SILVER COPPER
端子形式：BALL端子节距：1 mm
端子位置：BOTTOM处于峰值回流温度下的最长时间：40
宽度：17 mmBase Number Matches：1

EPF6016AFC256-3 数据手册

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FLEX 6000  
Programmable Logic  
Device Family  
®
March 2001, ver. 4.1  
Data Sheet  
■
■
Provides an ideal low-cost, programmable alternative to high-  
volume gate array applications and allows fast design changes  
during prototyping or design testing  
Features...  
Product features  
–
–
–
–
–
Register-rich, look-up table- (LUT-) based architecture  
OptiFLEX® architecture that increases device area efficiency  
Typical gates ranging from 5,000 to 24,000 gates (see Table 1)  
Built-in low-skew clock distribution tree  
100% functional testing of all devices; test vectors or scan chains  
are not required  
■
System-level features  
–
In-circuit reconfigurability (ICR) via external configuration  
device or intelligent controller  
–
5.0-V devices are fully compliant with peripheral component  
interconnect Special Interest Group (PCI SIG) PCI Local Bus  
Specification, Revision 2.2  
–
Built-in Joint Test Action Group (JTAG) boundary-scan test  
(BST) circuitry compliant with IEEE Std. 1149.1-1990, available  
without consuming additional device logic  
–
–
–
MultiVoltTM I/O interface operation, allowing a device to bridge  
between systems operating at different voltages  
Low power consumption (typical specification less than 0.5 mA  
in standby mode)  
3.3-V devices support hot-socketing  
Table 1. FLEX 6000 Device Features  
Feature  
EPF6010A  
EPF6016  
EPF6016A  
EPF6024A  
Typical gates (1)  
10,000  
880  
16,000  
1,320  
204  
16,000  
1,320  
171  
24,000  
1,960  
218  
Logic elements (LEs)  
Maximum I/O pins  
Supply voltage (VCCINT  
102  
)
3.3 V  
5.0 V  
3.3 V  
3.3 V  
Note:  
(1) The embedded IEEE Std. 1149.1 JTAG circuitry adds up to 14,000 gates in addition to the listed typical gates.  
Altera Corporation  
1
A-DS-F6000-04.1  
 
 
1234567...52

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