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CY7C056V-20BBC

更新时间： 2024-09-17 22:17:35

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赛普拉斯 - CYPRESS		/
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23页	461K
描述
3.3V 16K/32K x 36 FLEx36 Asynchronous Dual-Port Static RAM

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CY7C056V-20BBC 技术参数

是否Rohs认证：	不符合	生命周期：	Obsolete
零件包装代码：	BGA	包装说明：	15 X 15 MM, 1.25 MM HEIGHT, 1 MM PITCH, BGA-172
针数：	172	Reach Compliance Code：	not_compliant
ECCN代码：	3A991.B.2.B	HTS代码：	8542.32.00.41
风险等级：	5.84	最长访问时间：	20 ns
I/O 类型：	COMMON	JESD-30 代码：	S-PBGA-B172
JESD-609代码：	e0	长度：	15 mm
内存密度：	589824 bit	内存集成电路类型：	DUAL-PORT SRAM
内存宽度：	36	功能数量：	1
端口数量：	2	端子数量：	172
字数：	16384 words	字数代码：	16000
工作模式：	ASYNCHRONOUS	最高工作温度：	70 °C
最低工作温度：		组织：	16KX36
输出特性：	3-STATE	封装主体材料：	PLASTIC/EPOXY
封装代码：	LBGA	封装等效代码：	BGA172,14X14,40
封装形状：	SQUARE	封装形式：	GRID ARRAY, LOW PROFILE
并行/串行：	PARALLEL	峰值回流温度（摄氏度）：	NOT SPECIFIED
电源：	3.3 V	认证状态：	Not Qualified
座面最大高度：	1.25 mm	最大待机电流：	0.00005 A
最小待机电流：	2 V	子类别：	SRAMs
最大压摆率：	0.34 mA	最大供电电压 (Vsup)：	3.465 V
最小供电电压 (Vsup)：	3.135 V	标称供电电压 (Vsup)：	3.3 V
表面贴装：	YES	技术：	CMOS
温度等级：	COMMERCIAL	端子面层：	Tin/Lead (Sn/Pb)
端子形式：	BALL	端子节距：	1 mm
端子位置：	BOTTOM	处于峰值回流温度下的最长时间：	NOT SPECIFIED
宽度：	15 mm	Base Number Matches：	1

CY7C056V-20BBC 数据手册

25/0251

CY7C056V

CY7C057V

3.3V 16K/32K x 36

FLEx36™ Asynchronous Dual-Port Static RAM

• Expandable data bus to 72 bits or more using Mas-

ter/Slave Chip Select when using more than one device

Features

• True dual-ported memory cells which allow simulta-

neous access of the same memory location

• On-Chip arbitration logic

• Semaphores included to permit software handshaking

between ports

• 16K x 36 organization (CY7C056V)

• 32K x 36 organization (CY7C057V)

• 0.25-micron CMOS for optimum speed/power

• High-speed access: 12/15/20 ns

• Low operating power

• INT flag for port-to-port communication

• Byte Select on Left Port

• Bus Matching on Right Port

• Depth Expansion via dual chip enables

• Pin select for Master or Slave

• Commercial and Industrial Temperature Ranges

• Compact package

— Active: I_CC= 250 mA (typical)

— Standby: I_SB3= 10 µA (typical)

• Fully asynchronous operation

• Automatic power-down

—144-Pin TQFP (20 x 20 x 1.4 mm)

—172-Ball BGA (1.0-mm pitch) (15 x 15 x.51 mm)

Logic Block Diagram

R/W_L

R/W_R

B₀–B₃

CE_0L

CE_1L

Left

Port

Control

Logic

Right

CE_0R

CE_1R

Port

Control

Logic

CE_L

CE_R

OE_L

OE_R

I/O_0L–I/O_8L

9/18/36

I/O_9L–I/O_17L

I/O_18L–I/O_26L

I/O_27L–I/O_35L

Bus

Match

I/O_R

I/O

Control

I/O

Control

SIZE

14/15

[1]

Address

Decode

Address

Decode

True Dual-Ported

A_0L–A_13/14L

A_0R–A_13/14R

RAM Array

14/15

Interrupt

Semaphore

Arbitration

SEM_L

SEM_R

[2]

BUSY_L^[2]

INT_L

BUSY_R

INT_R

M/S

Notes:

1. A₀–A₁₃for 16K; A₀–A₁₄for 32K devices.

2. BUSY is an output in Master mode and an input in Slave mode.

For the most recent information, visit the Cypress web site at www.cypress.com

Cypress Semiconductor Corporation

•

3901 North First Street

•

San Jose

•

CA 95134

•

408-943-2600

Document #: 38-06055 Rev. **

Revised September 7, 2001

12 3 4 5 6 7...23

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型号	品牌	获取价格	描述	数据表
CY7C057	CYPRESS	获取价格	3.3V 16K/32K x 36 FLEx36 Asynchronous Dual-Port Static RAM
CY7C057V	CYPRESS	获取价格	3.3V 16K/32K x 36 FLEx36 Asynchronous Dual-Port Static RAM
CY7C057V-10BAC	CYPRESS	获取价格	Dual-Port SRAM, 32KX36, 10ns, CMOS, PBGA172, 15 X 15 MM, 0.51 MM HEIGHT, 1 MM PITCH, BGA-1
CY7C057V-12AC	CYPRESS	获取价格	3.3V 16K/32K x 36 FLEx36 Asynchronous Dual-Port Static RAM
CY7C057V-12ACT	CYPRESS	获取价格	Dual-Port SRAM, 32KX36, 12ns, CMOS, PQFP144, 20 X 20 MM, 1.40 MM HEIGHT, PLASTIC, TQFP-144
CY7C057V-12AXC	CYPRESS	获取价格	3.3V 16K/32K x 36 FLEx36⑩ Asynchronous Dual-P
CY7C057V-12AXCT	CYPRESS	获取价格	Dual-Port SRAM, 32KX36, 12ns, CMOS, PQFP144, 20 X 20 MM, 1.40 MM HEIGHT, LEAD FREE, PLASTI
CY7C057V-12BBC	CYPRESS	获取价格	3.3V 16K/32K x 36 FLEx36 Asynchronous Dual-Port Static RAM
CY7C057V-15AC	CYPRESS	获取价格	3.3V 16K/32K x 36 FLEx36 Asynchronous Dual-Port Static RAM
CY7C057V-15ACT	CYPRESS	获取价格	Dual-Port SRAM, 32KX36, 15ns, CMOS, PQFP144, 20 X 20 MM, 1.40 MM HEIGHT, PLASTIC, TQFP-144

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