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CY7C057V-15ACT

更新时间： 2024-09-18 20:00:59

品牌	Logo	应用领域
赛普拉斯 - CYPRESS		静态存储器内存集成电路
页数	文件大小	规格书
23页	773K
描述
Dual-Port SRAM, 32KX36, 15ns, CMOS, PQFP144, 20 X 20 MM, 1.40 MM HEIGHT, PLASTIC, TQFP-144

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CY7C057V-15ACT 技术参数

是否Rohs认证：	不符合	生命周期：	Obsolete
零件包装代码：	QFP	包装说明：	LFQFP,
针数：	144	Reach Compliance Code：	unknown
ECCN代码：	3A991.B.2.A	HTS代码：	8542.32.00.41
风险等级：	5.84	最长访问时间：	15 ns
其他特性：	AUTOMATIC POWER DOWN	JESD-30 代码：	S-PQFP-G144
JESD-609代码：	e0	长度：	20 mm
内存密度：	1179648 bit	内存集成电路类型：	DUAL-PORT SRAM
内存宽度：	36	功能数量：	1
端子数量：	144	字数：	32768 words
字数代码：	32000	工作模式：	ASYNCHRONOUS
最高工作温度：	70 °C	最低工作温度：
组织：	32KX36	封装主体材料：	PLASTIC/EPOXY
封装代码：	LFQFP	封装形状：	SQUARE
封装形式：	FLATPACK, LOW PROFILE, FINE PITCH	并行/串行：	PARALLEL
峰值回流温度（摄氏度）：	225	认证状态：	Not Qualified
座面最大高度：	1.6 mm	最大供电电压 (Vsup)：	3.465 V
最小供电电压 (Vsup)：	3.135 V	标称供电电压 (Vsup)：	3.3 V
表面贴装：	YES	技术：	CMOS
温度等级：	COMMERCIAL	端子面层：	TIN LEAD
端子形式：	GULL WING	端子节距：	0.5 mm
端子位置：	QUAD	处于峰值回流温度下的最长时间：	30
宽度：	20 mm	Base Number Matches：	1

CY7C057V-15ACT 数据手册

CY7C056V CY7C057V CY7C037V CY7C038V3.3V 16K/32K

FLEx36™ Asynchronous Dual-Port Static RAM

x 36

CY7C056V

CY7C057V

3.3V 16K/32K x 36

FLEx36™ Asynchronous Dual-Port Static

• On-Chip arbitration logic

Features

• Semaphores included to permit software handshaking

between ports

• True dual-ported memory cells that allow simultaneous

access of the same memory location

• INT flag for port-to-port communication

• Byte Select on Left Port

• 16K x 36 organization (CY7C056V)

• 32K x 36 organization (CY7C057V)

• 0.25-micron CMOS for optimum speed/power

• High-speed access: 12/15/20 ns

• Low operating power

• Bus Matching on Right Port

• Depth Expansion via dual chip enables

• Pin select for Master or Slave

• Commercial and Industrial Temperature Ranges

• Available in 144-Pin TQFP or 172-Ball BGA

• Pb-Free packages available

— Active: I_CC= 250 mA (typical)

— Standby: I_SB3= 10 µA (typical)

• Fully asynchronous operation

• Automatic power-down

• Compact packages:

— 144-Pin TQFP (20 x 20 x 1.4 mm)

— 172-Ball BGA (1.0-mm pitch) (15 x 15 x.51 mm)

• Expandable data bus to 72 bits or more using

Master/Slave Chip Select when using more than one

device

Logic Block Diagram

R/W_L

R/W_R

B₀–B₃

CE_0L

CE_1L

Left

Port

Control

Logic

Right

CE_0R

CE_1R

Port

Control

Logic

CE_L

CE_R

OE_L

OE_R

I/O_0L–I/O_8L

9/18/36

I/O_9L–I/O_17L

I/O_18L–I/O_26L

I/O_27L–I/O_35L

Bus

Match

I/O

Control

I/O

Control

I/O_R

SIZE

14/15

Address

Decode

Address

Decode

True Dual-Ported

[1]

A_0L–A_13/14L

A_0R–A_13/14R

RAM Array

14/15

Interrupt

Semaphore

Arbitration

SEM_L

SEM_R

[2]

BUSY_L

INT_L

BUSY_R

INT_R

M/S

Notes:

1. A –A for 16K; A –A for 32K devices.

2. BUSY is an output in Master mode and an input in Slave mode.

Cypress Semiconductor Corporation

Document #: 38-06055 Rev. *B

•

198 Champion Court

•

San Jose, CA 95134-1709

•

408-943-2600

Revised September 6, 2005

[+] Feedback

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型号	品牌	获取价格	描述	数据表
CY7C057V-15AI	CYPRESS	获取价格	3.3V 16K/32K x 36 FLEx36 Asynchronous Dual-Port Static RAM
CY7C057V-15AXC	CYPRESS	获取价格	3.3V 16K/32K x 36 FLEx36⑩ Asynchronous Dual-P
CY7C057V-15AXCT	CYPRESS	获取价格	Multi-Port SRAM, 32KX36, 15ns, CMOS, PQFP144, 20 X 20 MM, 1.40 MM HEIGHT, ROHS COMPLIANT,
CY7C057V-15AXI	CYPRESS	获取价格	3.3V 16K/32K x 36 FLEx36⑩ Asynchronous Dual-P
CY7C057V-15BAC	CYPRESS	获取价格	Dual-Port SRAM, 32KX36, 15ns, CMOS, PBGA172, 15 X 15 MM, 0.51 MM HEIGHT, 1 MM PITCH, BGA-1
CY7C057V-15BAI	CYPRESS	获取价格	Dual-Port SRAM, 32KX36, 15ns, CMOS, PBGA172, 15 X 15 MM, 0.51 MM HEIGHT, 1 MM PITCH, BGA-1
CY7C057V-15BBC	CYPRESS	获取价格	3.3V 16K/32K x 36 FLEx36 Asynchronous Dual-Port Static RAM
CY7C057V-15BBI	CYPRESS	获取价格	3.3V 16K/32K x 36 FLEx36 Asynchronous Dual-Port Static RAM
CY7C057V-15BBXC	CYPRESS	获取价格	3.3 V 16K/32K x 36 FLEx36â¢ Asynchronous Dua
CY7C057V-20AC	CYPRESS	获取价格	3.3V 16K/32K x 36 FLEx36 Asynchronous Dual-Port Static RAM

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