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CY7C037AV-20AXI

更新时间： 2024-09-18 12:52:47
品牌 Logo 应用领域
赛普拉斯 - CYPRESS /
页数 文件大小 规格书
24页 641K
描述
3.3 V 32 K / 64 K × 16 / 18 Dual-Port Static RAM

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CY7C037AV-20AXI 技术参数

是否Rohs认证： 符合生命周期：Obsolete
包装说明：LFQFP, QFP100,.63SQ,20Reach Compliance Code：compliant
ECCN代码：3A991.B.2.BHTS代码：8542.32.00.41
风险等级：5.81最长访问时间：20 ns
I/O 类型：COMMONJESD-30 代码：S-PQFP-G100
JESD-609代码：e3长度：14 mm
内存密度：589824 bit内存集成电路类型：DUAL-PORT SRAM
内存宽度：18湿度敏感等级：3
功能数量：1端口数量：2
端子数量：100字数：32768 words
字数代码：32000工作模式：ASYNCHRONOUS
最高工作温度：85 °C最低工作温度：-40 °C
组织：32KX18输出特性：3-STATE
封装主体材料：PLASTIC/EPOXY封装代码：LFQFP
封装等效代码：QFP100,.63SQ,20封装形状：SQUARE
封装形式：FLATPACK, LOW PROFILE, FINE PITCH并行/串行：PARALLEL
峰值回流温度（摄氏度）：260电源：3.3 V
认证状态：Not Qualified座面最大高度：1.6 mm
最大待机电流：0.00005 A最小待机电流：2 V
子类别：SRAMs最大压摆率：0.195 mA
最大供电电压 (Vsup)：3.6 V最小供电电压 (Vsup)：3 V
标称供电电压 (Vsup)：3.3 V表面贴装：YES
技术：CMOS温度等级：INDUSTRIAL
端子面层：Matte Tin (Sn)端子形式：GULL WING
端子节距：0.5 mm端子位置：QUAD
处于峰值回流温度下的最长时间：30宽度：14 mm

CY7C037AV-20AXI 数据手册

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CY7C027V/027AV/028V  
CY7C037AV/038V  
3.3 V 32 K / 64 K × 16 / 18 Dual-Port  
Static RAM  
3.3  
V 32 K / 64 K × 16 / 18 Dual-Port Static RAM  
■ Fully asynchronous operation  
■ Automatic power-down  
Features  
■ True dual-ported memory cells which allow simultaneous  
access of the same memory location  
■ Expandable data bus to 32/36 bits or more using Master/Slave  
chip select when using more than one device  
■ 32K x 16 organization (CY7C027V/027AV [1]  
■ 64K x 16 organization (CY7C028V)  
■ 32K x 18 organization (CY7C037AV)  
■ 64K x 18 organization (CY7C038V)  
)
■ On-chip arbitration logic  
■ Semaphores included to permit software handshaking  
between ports  
■ INT flag for port-to-port communication  
■ Separate upper-byte and lower-byte control  
■ Dual chip enables  
■ 0.35 micron Complementary metal oxide semiconductor  
(CMOS) for optimum speed and power  
■ High speed access: 15, 20, and 25 ns  
■ Low operating power  
■ Pin select for Master or Slave  
■ Commercial and Industrial temperature ranges  
■ Active: ICC = 115 mA (typical)  
■ Standby: ISB3 = 10 A (typical)  
■ 100-pin Pb-free Thin quad plastic flatpack (TQFP) and 100-pin  
TQFP  
Logic Block Diagram  
R/W  
R/W  
UB  
L
R
R
UB  
L
CE  
CE  
CE  
CE  
0L  
1L  
0R  
1R  
CE  
CE  
R
L
LB  
LB  
R
L
L
OE  
OE  
R
8/9  
8/9  
[2]  
15/17L  
[3]  
I/O  
–I/O  
I/O  
–I/O [2]  
8/9L  
8/9L  
15/17R  
[3]  
8/9  
8/9  
I/O  
Control  
I/O  
Control  
I/O –I/O  
I/O –I/O  
0L  
7/8L  
0L  
7/8R  
15/16  
15/16  
[4]  
A
A
–A[4]  
A
A
–A  
Address  
Decode  
Address  
Decode  
True Dual-Ported  
0L  
14/15L  
0R  
14/15R  
14/15R  
RAM Array  
15/16  
15/16  
–A[4]  
[4]  
–A  
0L  
14/15L  
0R  
CE  
CE  
R
Interrupt  
Semaphore  
Arbitration  
L
OE  
OE  
R
L
R/W  
SEM  
R/W  
SEM  
L
R
R
L
[5]  
[5]  
BUSY  
INT  
UB  
BUSY  
INT  
UB  
L
R
R
R
R
L
L
LB  
M/S  
LB  
L
Notes  
1. CY7C027V, and CY7C027AV are functionally identical.  
2. I/O –I/O for x16 devices; I/O –I/O for x18 devices.  
8
15  
9
17  
3. I/O –I/O for x16 devices; I/O –I/O for x18 devices.  
0
7
0
8
4. A –A for 32K; A –A for 64K devices.  
0
14  
0
15  
5. BUSY is an output in master mode and an input in slave mode.  
Cypress Semiconductor Corporation  
Document Number: 38-06078 Rev. *G  
•
198 Champion Court  
•
San Jose, CA 95134-1709  
•
408-943-2600  
Revised February 5, 2013  
1234567...24

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CY7C037AV-20AXI 替代型号

型号 品牌 替代类型 描述 数据表
CY7C037AV-20AXC CYPRESS

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