CY2DL814SXCT

更新时间： 2024-10-01 04:13:19

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赛普拉斯 - CYPRESS		/
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ComLink⑩ Series

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CY2DL814SXCT 技术参数

是否Rohs认证：	符合	生命周期：	Obsolete
零件包装代码：	SOIC	包装说明：	0.150 INCH, LEAD FREE, MS-012, SOIC-16
针数：	16	Reach Compliance Code：	unknown
HTS代码：	8542.39.00.01	风险等级：	5.69
系列：	2DL	输入调节：	DIFFERENTIAL
JESD-30 代码：	R-PDSO-G16	JESD-609代码：	e4
长度：	9.893 mm	逻辑集成电路类型：	LOW SKEW CLOCK DRIVER
湿度敏感等级：	3	功能数量：	1
反相输出次数：		端子数量：	16
实输出次数：	4	最高工作温度：	70 °C
最低工作温度：		封装主体材料：	PLASTIC/EPOXY
封装代码：	SOP	封装等效代码：	SOP16,.25
封装形状：	RECTANGULAR	封装形式：	SMALL OUTLINE
峰值回流温度（摄氏度）：	260	电源：	3.3 V
Prop。Delay @ Nom-Sup：	5 ns	传播延迟（tpd）：	5 ns
认证状态：	Not Qualified	Same Edge Skew-Max（tskwd）：	0.2 ns
座面最大高度：	1.72 mm	子类别：	Clock Drivers
最大供电电压 (Vsup)：	3.465 V	最小供电电压 (Vsup)：	3.135 V
标称供电电压 (Vsup)：	3.3 V	表面贴装：	YES
技术：	CMOS	温度等级：	COMMERCIAL
端子面层：	Nickel/Palladium/Gold (Ni/Pd/Au)	端子形式：	GULL WING
端子节距：	1.27 mm	端子位置：	DUAL
处于峰值回流温度下的最长时间：	20	宽度：	3.9 mm
Base Number Matches：	1

CY2DL814SXCT 数据手册

ComLink™ Series

CY2DL814

1:4 Clock Fanout Buffer

Features

Description

• Low-voltage operation

• V_DD= 3.3V

• 1:4 Fanout

• Single-input configurable for

— LVDS, LVPECL, or LVTTL

The Cypress CY2 series of network circuits is produced using

advanced 0.35-micron CMOS technology, achieving the

industry’s fastest logic.

The Cypress CY2DL814 fanout buffer features a single

LVDS-, LVPECL-, or LVTTL-compatible input and four LVDS

output pairs.

Designed for data-communication clock management applica-

tions, the fanout from a single input reduces loading on the

input clock.

The CY2DL814 is ideal for both level translations from single

ended to LVDS and/or for the distribution of LVDS-based clock

signals. The Cypress CY2DL814 has configurable input and

output functions. The input can be selectable for

LVPECL/LVTTL or LVDS signals while the output driver’s

support standard and high drive LVDS. Drive either a 50-ohm

or 100-ohm line with a single part number/device.

— Four differential pairs of LVDS outputs

• Drives 50- or 100-ohm load (selectable)

• Low input capacitance

• 85 ps typical output-to-output skew

• <4 ns typical propagation delay

• Does not exceed Bellcore 802.3 standards

• Operation at ⇒ 350 MHz – 700 Mbps

• Industrial versions available

• Packages available include TSSOP/SOIC

Block Diagram

Pin Configuration

EN1

EN2

EN1

Q1A

Q1B

CONFIG

CNTRL

VDD

Q1A

Q1B

Q2A

Q2B

Q3A

Q3B

Q4A

Q4B

GND

IN+

IN-

Q2A

Q2B

IN+

IN-

EN2

LVDS /

LVPECL /

LVTTL

Q3A

Q3B

16-pin TSSOP/SOIC

CONFIG

Q4A

Q4B

CNTRL

OUTPUT

LVDS

Cypress Semiconductor Corporation

•

3901 North First Street

•

San Jose, CA 95134

•

408-943-2600

Document #: 38-07057 Rev. *B

Revised June 20, 2005

12 3 4 5 6 7 8

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型号	品牌	替代类型	描述	数据表
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