CY2CC910OCT

更新时间： 2024-11-24 22:07:59

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赛普拉斯 - CYPRESS		时钟
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1:10 Clock Fanout Buffer

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CY2CC910OCT 技术参数

是否Rohs认证：	不符合	生命周期：	Obsolete
零件包装代码：	SSOP	包装说明：	SSOP-20
针数：	20	Reach Compliance Code：	not_compliant
HTS代码：	8542.39.00.01	风险等级：	5.76
其他特性：	ALSO OPERATES WITH 2.5V AND 3.3V SUPPLY	系列：	2CC
输入调节：	SCHMITT TRIGGER	JESD-30 代码：	R-PDSO-G20
JESD-609代码：	e0	长度：	7.2 mm
逻辑集成电路类型：	LOW SKEW CLOCK DRIVER	最大I（ol）：	0.012 A
湿度敏感等级：	1	功能数量：	1
反相输出次数：		端子数量：	20
实输出次数：	10	最高工作温度：	70 °C
最低工作温度：		封装主体材料：	PLASTIC/EPOXY
封装代码：	SSOP	封装等效代码：	SSOP20,.3
封装形状：	RECTANGULAR	封装形式：	SMALL OUTLINE, SHRINK PITCH
峰值回流温度（摄氏度）：	220	电源：	1.8/3.3 V
Prop。Delay @ Nom-Sup：	3.5 ns	传播延迟（tpd）：	3.5 ns
认证状态：	Not Qualified	Same Edge Skew-Max（tskwd）：	0.2 ns
座面最大高度：	2 mm	子类别：	Clock Drivers
最大供电电压 (Vsup)：	1.89 V	最小供电电压 (Vsup)：	1.71 V
标称供电电压 (Vsup)：	1.8 V	表面贴装：	YES
技术：	CMOS	温度等级：	COMMERCIAL
端子面层：	TIN LEAD	端子形式：	GULL WING
端子节距：	0.65 mm	端子位置：	DUAL
处于峰值回流温度下的最长时间：	NOT SPECIFIED	宽度：	5.3 mm
Base Number Matches：	1

CY2CC910OCT 数据手册

COMLINK™ SERIES

CY2CC910

1:10 Clock Fanout Buffer

— 650 MHz@2.5V/3.3V

Features

• Low-voltage operation

• Full-range support:

• Industrial versions available

• Available packages include: SOIC, SSOP

— 3.3V

— 2.5V

Description

The Cypress series of network circuits are produced using

advanced 0.35 micron CMOS technology, achieving the indus-

tries fastest logic and buffers.

— 1.8V

• Over voltage tolerant input hot swappable

• 1:10 fanout

• Drives either a 50-Ohm or 75-Ohm load

• Low-input capacitance

• Low-output skew

• Low-propagation delay

• Typical (tpd < 4 ns)

• High-speed operation:

— -200 MHz@1.8V

The Cypress CY2CC910 fanout buffer features one input and

ten outputs. Ideal for conversion from/to 3.3V/2.5V/1.8V

Designed for Data Communications clock management appli-

cations, the large fanout from a single input reduces loading

on the input clock.

Cypress employs unique AVCMOS type outputs VOI™

(Variable Output Impedance) that dynamically adjust for

variable impedance matching and eliminate the need for

series damping resistors and reduce noise overall.

Pin Configuration

Block Diagram

VDD

Q10

GND

VDD

GND

VDD

4,8

15,20

GND

VDD

INPUT

(AVCMOS)

2,6,10

GND

20 pin SOIC/SSOP

13,17

GND

OUTPUT

(AVCMOS)

Pin Description

Pin Number

Pin Name

Description

Input

2,6,10,13,17

GND

V_DD

Ground

4,8,15,20

Power Supply

Output

3,5,7,9,11,12,14,16,18,19

Q1,Q2,Q3,Q4,Q5,Q6,Q7,Q8,Q9,Q10

Cypress Semiconductor Corporation

•

3901 North First Street

•

San Jose

•

CA 95134

•

408-943-2600

Document #: 38-07348 Rev. *A

Revised October 3, 2002

12 3 4 5 6 7 8

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