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CY28330OC

更新时间： 2024-11-30 02:58:15
品牌 Logo 应用领域
赛普拉斯 - CYPRESS 晶体时钟发生器外围集成电路光电二极管
页数 文件大小 规格书
15页 124K
描述
Clock Generator for AMD⑩ Hammer

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CY28330OC 技术参数

是否Rohs认证： 不符合生命周期：Transferred
零件包装代码：SSOP包装说明：SSOP, SSOP48,.4
针数：48Reach Compliance Code：compliant
ECCN代码：EAR99HTS代码：8542.39.00.01
Factory Lead Time：1 week风险等级：5.48
JESD-30 代码：R-PDSO-G48JESD-609代码：e0
长度：15.875 mm湿度敏感等级：1
端子数量：48最高工作温度：70 °C
最低工作温度：最大输出时钟频率：200 MHz
封装主体材料：PLASTIC/EPOXY封装代码：SSOP
封装等效代码：SSOP48,.4封装形状：RECTANGULAR
封装形式：SMALL OUTLINE, SHRINK PITCH峰值回流温度（摄氏度）：220
电源：3.3 V主时钟/晶体标称频率：14.31818 MHz
认证状态：Not Qualified座面最大高度：2.794 mm
子类别：Clock Generators最大供电电压：3.465 V
最小供电电压：3.135 V标称供电电压：3.3 V
表面贴装：YES技术：CMOS
温度等级：COMMERCIAL端子面层：TIN LEAD
端子形式：GULL WING端子节距：0.635 mm
端子位置：DUAL处于峰值回流温度下的最长时间：NOT SPECIFIED
宽度：7.5 mmuPs/uCs/外围集成电路类型：CLOCK GENERATOR, PROCESSOR SPECIFIC
Base Number Matches：1

CY28330OC 数据手册

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CY28330  
Clock Generator for AMD™ Hammer  
Table 1. Frequency Table (MHz)[1]  
Features  
FS  
PCI_HT  
SEL  
CPU PCI_H PCI  
Div T Div Div  
• Supports AMD Hammer CPU  
• 2 differential Pair of CPU Clocks  
• 6 Low Skew/Jitter PCI Clocks  
• 1 Free-running PCI Clock  
• 3 Low Skew/Jitter AGP/HT Clocks  
• 148M Output for USB  
(3:0)  
CPU  
PCI_HT  
PCI  
VC0  
0000 Hi-Z  
0001 XIN  
0001 XIN  
X
0
1
Hi-Z  
Hi-Z  
XIN/3 XIN/6  
XIN/6 XIN/6  
0010 100.0 0/1 66.7/33.3 33.31 200  
0011 100.0 0/1 66.7/33.3 33.31 200  
0100 100.0 0/1 66.7/33.3 33.31 200  
0101 133.3 0/1 66.7/33.3 33.31 266.6  
0110 166.7 0/1 66.7/33.3 33.31 333.3  
0111 200.0 0/1 66.7/33.3 33.31 400.0  
1000 105.0 0/1 70.0/35.0 35.00 210.0  
1001 110.0 0/1 73.3/36.7 36.67 220.0  
1010 115.0 0/1 76.7/38.3 38.33 230.0  
1011 120.0 0/1 60.0/30.0 30.00 240.0  
1100 140.0 0/1 70.0/35.0 35.00 280.0  
1101 150.0 0/1 60.0/30.0 30.00 300.0  
1110 160.0 0/1 64.0/32.0 32.00 320.0  
1111 180.0 0/1 60.0/30.0 30.00 360.0  
2
2
2
2
2
2
2
2
2
2
2
2
2
2
3/6  
3/6  
3/6  
4/8  
6
6
6
8
• 1 programmable 24M or 48M for FDC  
• 3 REF 14.318MHz Clocks  
• Dial-a-Frequency Programmability  
• Cypress Spread Spectrum for Best EMI Reduction  
• SMBus Register Programmable Options  
• 5V Tolerance SCLK and SDATA Lines  
• 3.3V Operation  
5/10 10  
6/12 12  
3/6  
3/6  
3/6  
4/8  
4/8  
6
6
6
8
8
• Power Management Control Pins  
• 48 Pin SSOP Package  
5/10 10  
5/10 10  
6/12 12  
=
Pin Configuration  
Block Diagram  
XIN  
14.31818MHz  
XTAL  
FS0/REF0  
VDD  
1
2
3
4
5
6
7
8
48  
47  
46  
45  
44  
43  
42  
41  
40  
39  
38  
37  
36  
35  
34  
33  
32  
31  
30  
29  
28  
27  
26  
25  
FS1/REF1  
VSS  
VDD  
FS2/REF2  
*SPREAD  
VDDA  
VSSA  
CPUT0  
CPUC0  
VSS  
REF(0:2)  
USB  
XOUT  
XIN  
XOUT  
VSS  
/4  
/2  
PLL1  
*PCI33HT66SEL#  
PCI33_HT66_0  
PCI33_HT66_1  
VDD  
24_48MH  
9
24_48MH/  
24_48SEL#  
VSS  
10  
11  
12  
13  
14  
15  
16  
17  
18  
19  
20  
21  
22  
23  
24  
PCI33_HT66_2  
*SRESET#/PD#  
PCI33_0  
PCI33_1  
VSS  
VDD  
CPUT1  
CPUC1  
VDD  
FS(0:3)  
PCISTOP#  
CPUT(0:1)  
CPUC(0:1)  
PLL2  
VSS  
VDD  
VSSF  
VDDF  
USB  
VSS  
VDD  
24_48MHz/SEL#  
VSS  
SDATA  
SPREAD  
PCI33_2  
PCI33_3  
VDD  
Control Logic  
PCI33_F  
/N  
SRESET#/PD#  
SCLK  
VSS  
STOP  
CNTL  
PCI33_(0:5)  
PCI33_4  
PCI33_5  
FS3/PCI33_F  
PCISTOP#  
SDATA  
PCI33_HT66_(0:2)  
SCLK  
* = 150 KΩPull-up  
Note:  
1. All outputs except XOUT will be three-stated when FS(3:0) = 0000.  
Cypress Semiconductor Corporation  
•
3901 North First Street  
•
San Jose  
•
CA 95134  
•
408-943-2600  
Document #: 38-07366 Rev. *B  
Revised December 26, 2002  
1234567...15

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