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Datasheet > 微控制器和处理器 > 时钟发生器> CY2545CXXX

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CY2545CXXX

更新时间： 2024-10-01 06:51:35

品牌	Logo	应用领域
赛普拉斯 - CYPRESS		晶体时钟发生器微控制器和处理器外围集成电路
页数	文件大小	规格书
15页	334K
描述
Quad PLL Programmable Spread Spectrum Clock Generator with Serial I2C Interface

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CY2545CXXX 技术参数

是否Rohs认证：	符合	生命周期：	Obsolete
零件包装代码：	QFN	包装说明：	4 X 4 MM, LEAD FREE, MO-220, QFN-24
针数：	24	Reach Compliance Code：	compliant
ECCN代码：	EAR99	HTS代码：	8542.39.00.01
风险等级：	5.76	Is Samacsys：	N
JESD-30 代码：	S-XQCC-N24	JESD-609代码：	e3
长度：	4 mm	湿度敏感等级：	3
端子数量：	24	最高工作温度：	70 °C
最低工作温度：		最大输出时钟频率：	166 MHz
封装主体材料：	UNSPECIFIED	封装代码：	HVQCCN
封装等效代码：	LCC24,.16SQ,20	封装形状：	SQUARE
封装形式：	CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE	峰值回流温度（摄氏度）：	260
电源：	2.5/3.3 V	主时钟/晶体标称频率：	48 MHz
认证状态：	Not Qualified	座面最大高度：	1 mm
子类别：	Clock Generators	最大供电电压：	2.75 V
最小供电电压：	2.25 V	标称供电电压：	2.5 V
表面贴装：	YES	技术：	CMOS
温度等级：	COMMERCIAL	端子面层：	Matte Tin (Sn)
端子形式：	NO LEAD	端子节距：	0.5 mm
端子位置：	QUAD	处于峰值回流温度下的最长时间：	20
宽度：	4 mm	uPs/uCs/外围集成电路类型：	CLOCK GENERATOR, PROCESSOR SPECIFIC
Base Number Matches：	1

CY2545CXXX 数据手册

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CY2545

CY2547

Quad PLL Programmable Spread Spectrum

2

Clock Generator with Serial I C Interface

■ Glitch-free outputs while frequency switching

■ 24-pin QFN package

Features

■ Four fully integrated phase locked loops (PLLs)

■ Commercial and industrial temperature ranges

■ Input frequency range

❐ External crystal: 8 to 48 MHz

❐ External reference: 8 to 166 MHz clock

Benefits

■ Multiple high performance PLLs allow synthesis of unrelated

frequencies

■ Wide operating output frequency range

❐ 3 to 166 MHz

■ Nonvolatile programming for personalization of PLL

frequencies,spreadspectrumcharacteristics,drivestrength,

■ Serial programmable over 2-wire I²C interface

crystal load capacitance, and output frequencies

■ Programmable spread spectrum with center and down

spread option and Lexmark and Linear modulation profiles

■ Application specific programmable EMI reduction using

Spread Spectrum for clocks

■ V_DDsupply voltage options:

❐ 2.5V, 3.0V, and 3.3V for CY2545

❐ 1.8V for CY2547

■ Programmable PLLs for system frequency margin tests

■ Meets critical timing requirements in complex system

designs

■ Selectable output clock voltages independent of V_DDsupply:

❐ 2.5V, 3.0V, and 3.3V for CY2545

❐ 1.8V for CY2547

■ Suitability for PC, consumer, portable, and networking appli-

cations

■ Power down, output enable, or frequency select features

■ Low jitter, high accuracy outputs

■ Capable of Zero PPM frequency synthesis error

■ Uninterrupted system operation during clock frequency

switch

■ Ability to synthesize nonstandard frequencies with

Fractional-N capability

■ Application compatibility in standard and low power systems

■ Up to eight clock outputs with programmable drive strength

Logic Block Diagram

CLKIN/RST

Crossbar

Switch

CLK1

XIN/

EXCLKIN

Bank

1

CLK2

Output

OSC

PLL1

XOUT

Dividers

and

CLK3

CLK4

CLK5

CLK6

CLK7

CLK8

Bank

2

Drive

PLL2

Strength

Control

MUX

and

Control

Logic

FS

Bank

3

PLL3

(SS)

SCL

SDA

PLL4

(SS)

I2C

PD#/OE

SSON

Cypress Semiconductor Corporation

Document #: 001-13196 Rev. *A

•

198 Champion Court

•

San Jose, CA 95134-1709

•

408-943-2600

Revised October 05, 2007

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