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CAT28C64BH13-90T PDF预览

CAT28C64BH13-90T

更新时间： 2024-09-15 05:08:39
品牌 Logo 应用领域
CATALYST 可编程只读存储器电动程控只读存储器电可擦编程只读存储器
页数 文件大小 规格书
13页 415K
描述
64K-Bit CMOS PARALLEL EEPROM

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CAT28C64BH13-90T 技术参数

是否Rohs认证： 符合生命周期：Transferred
零件包装代码：TSOP包装说明：TSOP1, TSSOP28,.53,22
针数：28Reach Compliance Code：unknown
ECCN代码：EAR99HTS代码：8542.32.00.51
风险等级：5.12最长访问时间：90 ns
命令用户界面：NO数据轮询：YES
耐久性：1000000 Write/Erase CyclesJESD-30 代码：R-PDSO-G28
JESD-609代码：e3长度：11.8 mm
内存密度：65536 bit内存集成电路类型：EEPROM
内存宽度：8湿度敏感等级：2
功能数量：1端子数量：28
字数：8192 words字数代码：8000
工作模式：ASYNCHRONOUS最高工作温度：70 °C
最低工作温度：组织：8KX8
封装主体材料：PLASTIC/EPOXY封装代码：TSOP1
封装等效代码：TSSOP28,.53,22封装形状：RECTANGULAR
封装形式：SMALL OUTLINE, THIN PROFILE页面大小：32 words
并行/串行：PARALLEL峰值回流温度（摄氏度）：260
电源：5 V编程电压：5 V
认证状态：Not Qualified座面最大高度：1.2 mm
最大待机电流：0.0001 A子类别：EEPROMs
最大压摆率：0.03 mA最大供电电压 (Vsup)：5.5 V
最小供电电压 (Vsup)：4.5 V标称供电电压 (Vsup)：5 V
表面贴装：YES技术：CMOS
温度等级：COMMERCIAL端子面层：MATTE TIN
端子形式：GULL WING端子节距：0.55 mm
端子位置：DUAL处于峰值回流温度下的最长时间：40
切换位：YES宽度：8 mm
最长写入周期时间 (tWC)：5 msBase Number Matches：1

CAT28C64BH13-90T 数据手册

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E
CAT28C64B  
64K-Bit CMOS PARALLEL EEPROM  
TM  
FEATURES  
I Fast read access times:  
I Commercial, industrial and automotive  
– 90/120/150ns  
temperature ranges  
I Low power CMOS dissipation:  
– Active: 25 mA max.  
I Automatic page write operation:  
– 1 to 32 bytes in 5ms  
– Standby: 100 µA max.  
– Page load timer  
I Simple write operation:  
I End of write detection:  
– Toggle bit  
– On-chip address and data latches  
– Self-timed write cycle with auto-clear  
– DATA polling  
I Fast write cycle time:  
I 100,000 program/erase cycles  
I 100 year data retention  
– 5ms max.  
I CMOS and TTL compatible I/O  
I Hardware and software write protection  
DESCRIPTION  
The CAT28C64B is manufactured using Catalyst’s  
advancedCMOSfloatinggatetechnology.Itisdesigned  
to endure 100,000 program/erase cycles and has a data  
retentionof100years.ThedeviceisavailableinJEDEC-  
approved 28-pin DIP, TSOP, SOIC, or, 32-pin PLCC  
package .  
The CAT28C64B is a fast, low power, 5V-only CMOS  
Parallel EEPROM organized as 8K x 8-bits. It requires a  
simple interface for in-system programming. On-chip  
address and data latches, self-timed write cycle with  
auto-clear and VCC power up/down write protection  
eliminate additional timing and protection hardware.  
DATA Polling and Toggle status bits signal the start and  
end of the self-timed write cycle. Additionally, the  
CAT28C64B features hardware and software write  
protection.  
BLOCK DIAGRAM  
8,192 x 8  
EEPROM  
ARRAY  
ROW  
DECODER  
ADDR. BUFFER  
& LATCHES  
A –A  
5
12  
INADVERTENT  
WRITE  
PROTECTION  
HIGH VOLTAGE  
GENERATOR  
32 BYTE PAGE  
REGISTER  
V
CC  
CE  
OE  
WE  
CONTROL  
LOGIC  
I/O BUFFERS  
DATA POLLING  
AND  
TIMER  
TOGGLE BIT  
I/O –I/O  
0
7
ADDR. BUFFER  
& LATCHES  
A –A  
COLUMN  
DECODER  
0
4
Doc. No. 1011, Rev. F  
© 2005 by Catalyst Semiconductor, Inc.  
Characteristics subject to change without notice  
1
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