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ATF1508BE-7AU100

更新时间： 2024-01-10 22:39:42

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Highperformance CPLD

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ATF1508BE-7AU100 技术参数

是否Rohs认证：	符合	生命周期：	Obsolete
零件包装代码：	QFP	包装说明：	TFQFP, TQFP100,.63SQ
针数：	100	Reach Compliance Code：	compliant
ECCN代码：	EAR99	HTS代码：	8542.31.00.01
风险等级：	5.73	其他特性：	YES
最大时钟频率：	210 MHz	系统内可编程：	YES
JESD-30 代码：	S-PQFP-G100	JTAG BST：	YES
长度：	14 mm	专用输入次数：	4
I/O 线路数量：	80	宏单元数：	128
端子数量：	100	最高工作温度：	85 °C
最低工作温度：	-40 °C	组织：	4 DEDICATED INPUTS, 80 I/O
输出函数：	MACROCELL	封装主体材料：	PLASTIC/EPOXY
封装代码：	TFQFP	封装等效代码：	TQFP100,.63SQ
封装形状：	SQUARE	封装形式：	FLATPACK, THIN PROFILE, FINE PITCH
电源：	1.5/3.3,1.8 V	可编程逻辑类型：	EE PLD
传播延迟：	6 ns	认证状态：	Not Qualified
座面最大高度：	1.2 mm	子类别：	Programmable Logic Devices
最大供电电压：	1.9 V	最小供电电压：	1.7 V
标称供电电压：	1.8 V	表面贴装：	YES
技术：	CMOS	温度等级：	INDUSTRIAL
端子形式：	GULL WING	端子节距：	0.5 mm
端子位置：	QUAD	宽度：	14 mm
Base Number Matches：	1

ATF1508BE-7AU100 数据手册

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1.6

1.7

Global Bus/Switch Matrix

The global bus contains all input and I/O pin signals as well as the buried feedback signal from

all 128 macrocells. The switch matrix in each logic block receives as its inputs all signals from

the global bus. Under software control, up to 40 of these signals can be selected as inputs to the

logic block.

Foldback Bus

Each macrocell also generates a foldback product term. This signal goes to the regional bus and

is available to all 16 macrocells within the logic block. The foldback is an inverse polarity of one

of the macrocell’s product terms. The 16 foldback terms in each logic block allow generation of

high fan-in sum terms or other complex logic functions with little additional delay.

2. Input and I/O Pins

2.1

Programmable Pin-keeper Option for Inputs and I/Os

The ATF1508BE offers the option of individually programming each of its input or I/O pin so that

pin-keeper circuit can be utilized. When any pin is driven high or low and then subsequently left

floating, it will stay at that previous high or low level. This circuitry prevents undriven input and

I/O lines from floating to intermediate voltage levels, which causes unnecessary power con-

sumption and system noise. The keeper circuits eliminate the need for external pull-up resistors

and eliminate their DC power consumption.

Figure 2-1 shows the pin-keeper circuit for an Input Pin and Figure 2-2 shows the same for an

I/O pin. The pin-keeper circuit is a weak feedback latch and has an effective resistance that is

approximately 50 kΩ.

Figure 2-1. Input with Programmable Pin-keeper

V_CCINT

50K

ATF1508BE

3663A–PLD–1/08

1...5 6 789 10 11...30

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