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AS7C4098

更新时间: 2024-01-04 13:05:29
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ALSC 静态存储器
页数 文件大小 规格书
10页 235K
描述
5V/3.3V 256K x 16 CMOS SRAM

AS7C4098 数据手册

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AS7C4098  
AS7C34098  
®
Read waveform 2 (CE, OE, UB, LB controlled)6,8,9  
tRC  
Address  
tAA  
OE  
tOHZ  
tOE  
tOH  
tOLZ  
CE  
tACE  
tLZ  
tCHZ  
LB, UB  
tBA  
tBHZ  
tBLZ  
DataOUT  
Data valid  
Write cycle (over the operating range)11  
–10  
–12  
–15  
–20  
Parameter  
Write cycle time  
Symbol Min Max Min Max Min Max Min Max Unit Note  
t
t
t
10  
7
5
12  
8
15  
10  
10  
0
7
20  
12  
12  
0
9
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
WC  
CW  
AW  
Chip enable (CE) to write end  
Address setup to write end  
Address setup time  
7
8
t
0
0
AS  
Write pulse width (OE = High)  
Write pulse width (OE = Low)  
Write recovery time  
t
t
7
8
10  
15  
0
12  
20  
0
WP1  
WP2  
10  
0
12  
0
t
WR  
Address hold from end of write  
Data valid to write end  
t
0
0
0
0
AH  
t
5
6
7
9
DW  
Data hold time  
t
0
0
6
0
0
4, 5  
4, 5  
4, 5  
4, 5  
DH  
WZ  
OW  
Write enable to output in High-Z  
Output active from write end  
Byte enable Low to write end  
t
0
0
0
0
t
3
3
3
3
t
7
8
10  
12  
BW  
1/13/05; v.1.9  
Alliance Semiconductor  
P. 5 of 10  

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