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ADM8840ACP-REEL7

更新时间： 2024-01-14 12:38:29

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罗彻斯特 - ROCHESTER		/
页数	文件大小	规格书
11页	847K
描述
SWITCHED CAPACITOR REGULATOR, CQCC32, 5 X 5 MM, LFCSP-32

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ADM8840ACP-REEL7 技术参数

是否无铅：	含铅	是否Rohs认证：	不符合
生命周期：	Active	零件包装代码：	QFN
包装说明：	VQCCN,	针数：	32
Reach Compliance Code：	unknown	风险等级：	5.23
Is Samacsys：	N	模拟集成电路 - 其他类型：	SWITCHED CAPACITOR REGULATOR
最大输入电压：	3.6 V	最小输入电压：	2.7 V
标称输入电压：	3.3 V	JESD-30 代码：	S-CQCC-N32
JESD-609代码：	e0	长度：	5 mm
湿度敏感等级：	3	功能数量：	1
端子数量：	32	最高工作温度：	85 °C
最低工作温度：	-40 °C	封装主体材料：	CERAMIC, METAL-SEALED COFIRED
封装代码：	VQCCN	封装形状：	SQUARE
封装形式：	CHIP CARRIER, VERY THIN PROFILE	峰值回流温度（摄氏度）：	240
认证状态：	COMMERCIAL	座面最大高度：	0.9 mm
表面贴装：	YES	切换器配置：	TRIPLER
技术：	CMOS	温度等级：	INDUSTRIAL
端子面层：	TIN LEAD	端子形式：	NO LEAD
端子节距：	0.5 mm	端子位置：	QUAD
处于峰值回流温度下的最长时间：	NOT SPECIFIED	宽度：	5 mm
Base Number Matches：	1

ADM8840ACP-REEL7 数据手册

浏览型号ADM8840ACP-REEL7的Datasheet PDF文件第10页

PRELIMINARY TECHNICAL DATA

ADM8840

SERIAL INTERFACE

DAC ± which sets the Centre Voltage of the output. The

individual data bits are then read in one by one on the DATA

line. After the DAC_SEL bit and the 8 data bits have been

read there is a pause to ensure the shift register outputs are

stable. Then a rising edge on the CS/LDAC input loads the

8 bits on the shift register outputs into the relevent DAC (and

the DAC outputs will change accordingly). Note that if CS/

LDAC goes high before all 8 data bits are read in then

incorrect data will be loaded into the DACs. All bits on the

DATA line are read in on each rising edge of the SCLK

signal.

The COM Driver section of the ADM8840 uses a serial

interface to input data and transfer it into the DACs. Figure

3ꢀ belowꢀ shows the operation of the serial interface. The data

is transmitted along the serial DATA lineꢀ along with a serial

clock signalꢀ SCLK. This data is read into a Shift Register.

When the 8 bits are sucessfully stored in the Shift Register a

low-to-high transition on the CS/LDAC input causes the

latch to load the 8-bits of data into the relevent DAC.

This function is also shown in the waveforms in Figure 4

below. A falling edge on the CS/LDAC input initiates the

data read into the shift register. The first bit of the datastream

is the DAC Select Bit (DAC_SEL) which determines which

internal DAC the data will be written to. A ‘1’ selects DAC

1 which sets the Amplitude of the output and a ‘0’ selects

When the ADM8840 comes out of shutdown the DACs

are preset with default values generating a COM_OUT

Amplitude of 6V with a Centre voltage of 1.5V.

8 DATABITS

DATA

DAC 1

LATCH

SHIFT

DAC 1 OUT

DAC 1

(AMPLITUDE)

SCLK

DAC_SEL BIT

DAC 2

LATCH

DAC 2 OUT

DAC 2

DAC

SELECT

(CENTRE VOLTAGE)

CS/LDAC

Figure 3. Serial Interface Diagram

t₄

t₁

t₃

t₂

CS / LDAC

SCLK

DATA

DAC

SEL

t₇

t₆

t₅

Figure 4. Serial Interface Waveforms

REV. PrG 2/03

–7–

1...5 6 789 10 11

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型号	品牌	获取价格	描述	数据表
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ADM8845ACP	ADI	获取价格	Charge Pump Driver for LCD White LED Backlights
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ADM8845ACP-REEL7	ADI	获取价格	Charge Pump Driver for LCD White LED Backlights
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