ADCLK950

更新时间： 2024-02-13 16:56:55

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亚德诺 - ADI		半导体时钟
页数	文件大小	规格书
12页	368K
描述
Two Selectable Inputs, 10 LVPECL Outputs, SiGe Clock Fanout Buffer

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ADCLK950 技术参数

生命周期：	Active	零件包装代码：	QFN
包装说明：	HVQCCN,	针数：	40
Reach Compliance Code：	unknown	风险等级：	5.76
系列：	950	输入调节：	DIFFERENTIAL
JESD-30 代码：	S-XQCC-N40	长度：	6 mm
逻辑集成电路类型：	LOW SKEW CLOCK DRIVER	功能数量：	1
反相输出次数：		端子数量：	40
实输出次数：	10	最高工作温度：	85 °C
最低工作温度：	-40 °C	封装主体材料：	UNSPECIFIED
封装代码：	HVQCCN	封装形状：	SQUARE
封装形式：	CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE	传播延迟（tpd）：	0.21 ns
认证状态：	COMMERCIAL	Same Edge Skew-Max（tskwd）：	0.045 ns
座面最大高度：	1 mm	最大供电电压 (Vsup)：	3.63 V
最小供电电压 (Vsup)：	2.97 V	标称供电电压 (Vsup)：	3.3 V
表面贴装：	YES	技术：	BIPOLAR
温度等级：	INDUSTRIAL	端子面层：	NOT SPECIFIED
端子形式：	NO LEAD	端子节距：	0.5 mm
端子位置：	QUAD	宽度：	6 mm
Base Number Matches：	1

ADCLK950 数据手册

ADCLK950

INPUT TERMINATION OPTIONS

REF

V x

50Ω

CLKx

ADCLK950

CONNECT V x TO V

REF

Figure 19. DC-Coupled CML Input Termination

Figure 21. AC-Coupled Input Termination, Such as LVDS and LVPECL

REF

V x

50Ω

CLKx

REF

0.01µF

(OPTIONAL)

V x

CLKx

50Ω

ADCLK950

50Ω

CLKx

CONNECT V x, V

x, AND CLKx. PLACE A

BYPASS CAPACITOR FROM V x TO GROUND.

CLKx

REF

ALTERNATIVELY, V x, V

x, AND CLKx CAN BE

REF

CONNECTED, GIVING A CLEANER LAYOUT AND

A 180º PHASE SHIFT.

ADCLK950

Figure 20. DC-Coupled LVPECL Input Termination

Figure 22. AC-Coupled Single-Ended Input Termination

REF

V x

50Ω

CLKx

ADCLK950

Figure 23. DC-Coupled 3.3 V CMOS Input Termination

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