ADCLK950

更新时间： 2024-01-03 11:53:34

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亚德诺 - ADI		半导体时钟
页数	文件大小	规格书
12页	368K
描述
Two Selectable Inputs, 10 LVPECL Outputs, SiGe Clock Fanout Buffer

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ADCLK950 技术参数

生命周期：	Active	零件包装代码：	QFN
包装说明：	HVQCCN,	针数：	40
Reach Compliance Code：	unknown	风险等级：	5.76
系列：	950	输入调节：	DIFFERENTIAL
JESD-30 代码：	S-XQCC-N40	长度：	6 mm
逻辑集成电路类型：	LOW SKEW CLOCK DRIVER	功能数量：	1
反相输出次数：		端子数量：	40
实输出次数：	10	最高工作温度：	85 °C
最低工作温度：	-40 °C	封装主体材料：	UNSPECIFIED
封装代码：	HVQCCN	封装形状：	SQUARE
封装形式：	CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE	传播延迟（tpd）：	0.21 ns
认证状态：	COMMERCIAL	Same Edge Skew-Max（tskwd）：	0.045 ns
座面最大高度：	1 mm	最大供电电压 (Vsup)：	3.63 V
最小供电电压 (Vsup)：	2.97 V	标称供电电压 (Vsup)：	3.3 V
表面贴装：	YES	技术：	BIPOLAR
温度等级：	INDUSTRIAL	端子面层：	NOT SPECIFIED
端子形式：	NO LEAD	端子节距：	0.5 mm
端子位置：	QUAD	宽度：	6 mm
Base Number Matches：	1

ADCLK950 数据手册

ADCLK950

OUTLINE DIMENSIONS

6.00

BSC SQ

0.60 MAX

PIN 1

INDICATOR

0.50

BSC

PIN 1

INDICATOR

3.05

2.90 SQ

2.75

5.75

BSC SQ

EXPOSED

PAD

0.50

0.40

0.30

0.25 MIN

BOTTOM VIEW

TOP VIEW

0.80 MAX

0.65 TYP

4.50

REF

12° MAX

1.00

0.85

0.80

0.05 MAX

0.02 NOM

COPLANARITY

0.08

FOR PROPER CONNECTION OF

THE EXPOSED PAD, REFER TO

THE PIN CONFIGURATION AND

FUNCTION DESCRIPTIONS

0.30

0.23

0.18

SEATING

PLANE

0.20 REF

SECTION OF THIS DATA SHEET.

COMPLIANT TO JEDEC STANDARDS MO-220-VJJD-2

Figure 24. 40-Lead Lead Frame Chip Scale Package [LFCSP_VQ]

6 mm × 6 mm Body, Very Thin Quad

(CP-40-8)

Dimensions shown in millimeters

ORDERING GUIDE

Model

ADCLK950BCPZ¹

ADCLK950BCPZ-REELꢀ¹

ADCLK950/PCBZ¹

Temperature Range

−40°C to +85°C

Package Description

40-Lead LFCSP_VQ

Evaluation Board

Package Option

CP-40-8

¹Z = RoHS Compliant Part.

registered trademarks are the property of their respective owners.

D08279-0-7/09(0)

Rev. 0 | Page 12 of 12

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型号	品牌	描述	获取价格	数据表
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