ADCLK944BCPZ-R7

更新时间： 2024-01-15 20:47:29

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亚德诺 - ADI		时钟驱动器逻辑集成电路 PC
页数	文件大小	规格书
12页	217K
描述
2.5 V/3.3 V, Four LVPECL Outputs, SiGe Clock Fanout Buffer

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ADCLK944BCPZ-R7 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Active	零件包装代码：	QFN
包装说明：	HVQCCN,	针数：	16
Reach Compliance Code：	unknown	风险等级：	5.74
Is Samacsys：	N	系列：	2400
输入调节：	DIFFERENTIAL	JESD-30 代码：	S-PQCC-N16
JESD-609代码：	e3	长度：	3 mm
逻辑集成电路类型：	LOW SKEW CLOCK DRIVER	湿度敏感等级：	NOT APPLICABLE
功能数量：	1	反相输出次数：
端子数量：	16	实输出次数：	4
最高工作温度：	85 °C	最低工作温度：	-40 °C
封装主体材料：	PLASTIC/EPOXY	封装代码：	HVQCCN
封装形状：	SQUARE	封装形式：	CHIP CARRIER
峰值回流温度（摄氏度）：	260	传播延迟（tpd）：	0.13 ns
认证状态：	COMMERCIAL	Same Edge Skew-Max（tskwd）：	0.015 ns
座面最大高度：	0.8 mm	最大供电电压 (Vsup)：	3.63 V
最小供电电压 (Vsup)：	2.375 V	标称供电电压 (Vsup)：	2.5 V
表面贴装：	YES	技术：	CMOS
温度等级：	INDUSTRIAL	端子面层：	MATTE TIN
端子形式：	NO LEAD	端子节距：	0.5 mm
端子位置：	QUAD	处于峰值回流温度下的最长时间：	40
宽度：	3 mm	最小 fmax：	6200 MHz
Base Number Matches：	1

ADCLK944BCPZ-R7 数据手册

ADCLK944

SPECIFICATIONS

Typical values are given for V_CC− V_EE= 3.3 V and T_A= 25°C, unless otherwise noted. Minimum and maximum values are given for the

full V_CC− V_EE= 3.3 V + 10% to 2.5 V − 5% and T_A= −40°C to +85°C variation, unless otherwise noted.

CLOCK INPUTS AND OUTPUTS

Table 1.

Parameter

Symbol

Min

Typ

Max

Unit

Test Conditions/Comments

DC INPUT CHARACTERISTICS

Input Common-Mode Voltage V_ICM

V_EE+ 1.35

0.4

V_CC− 0.1

3.4

V p-p

Input Differential Voltage

Input Capacitance

V_ID

C_IN

R_IN

1.ꢀ V between input pins

0.4

Input Resistance

Single-Ended Mode

Differential Mode

Common Mode

100

kΩ

μA

V_Topen

Input Bias Current

DC OUTPUT CHARACTERISTICS

Output Voltage High Level

Output Voltage Low Level

V_OH

V_OL

V_CC− 1.26

V_CC− 1.99

600

V_CC− 0.ꢀ6

V_CC− 1.54

960

Load = 50 Ω to (V_CC− 2.0 V)

V_OH− V_OL, output static

Output Voltage, Single-Ended V_O

Voltage Reference

Output Voltage

Output Resistance

V_REF

(V_CC+ 1)/2

250

−500 μA to +500 μA

TIMING CHARACTERISTICS

Table 2.

Parameter

Symbol

Min

Typ

Max

Unit

Test Conditions/Comments

AC PERFORMANCE

Maximum Output Frequency

6.2

ꢀ.0

GHz

Differential output voltage swing > 0.8 V

(see Figure 4)

Output Rise/Fall Time

Propagation Delay

Temperature Coefficient

Output-to-Output Skew¹

Part-to-Part Skew

t_R

t_PD

ꢀ0

100

ꢀ5

130

fs/°C

20% to 80%, measured differentially

V_ID= 1.6 V p-p

Additive Time Jitter

Integrated Random Jitter

Broadband Random Jitter²

CLOCK OUTPUT PHASE NOISE

Absolute Phase Noise

f_IN= 1 GHz

fs rms

BW = 12 kHz to 20 MHz, CLK = 1 GHz

V_ID= 1.6 V p-p, 8 V/ns, V_ICM= 2 V

Input slew rate > 1 V/ns (see Figure 11)

100 Hz offset

1 kHz offset

10 kHz offset

100 kHz offset

−118

−135

−144

−150

dBc/Hz

>1 MHz offset

¹The output-to-output skew is the difference between any two similar delay paths while operating at the same voltage and temperature.

²Measured at the rising edge of the clock signal; calculated using the SNR of the ADC method.

Rev. 0 | Page 3 of 12

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型号	品牌	描述	获取价格	数据表
ADCLK944BCPZ-WP	ADI	2.5 V/3.3 V, Four LVPECL Outputs, SiGe Clock Fanout Buffer	获取价格
ADCLK946	ADI	Six LVPECL Outputs, SiGe Clock Fanout Buffer	获取价格
ADCLK946/PCBZ	ADI	Six LVPECL Outputs, SiGe Clock Fanout Buffer	获取价格
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ADCLK946BCPZ-REEL7	ADI	Six LVPECL Outputs, SiGe Clock Fanout Buffer	获取价格
ADCLK948	ADI	Two Selectable Inputs, 8 LVPECL Outputs, SiGe Clock Fanout Buffer	获取价格

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