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ADC1412D080HN/C1

更新时间： 2024-11-26 06:36:19

品牌	Logo	应用领域
恩智浦 - NXP		转换器模数转换器双倍数据速率
页数	文件大小	规格书
37页	286K
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Dual 14-bit ADC 65, 80, 105 or 125 Msps CMOS or LVDS DDR digital outputs

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ADC1412D080HN/C1 技术参数

生命周期：	Transferred	零件包装代码：	QFN
包装说明：	HVQCCN,	针数：	64
Reach Compliance Code：	unknown	ECCN代码：	3A991.C.3
HTS代码：	8542.39.00.01	风险等级：	5.7
Is Samacsys：	N	最大模拟输入电压：	2 V
最小模拟输入电压：	1 V	转换器类型：	ADC, PROPRIETARY METHOD
JESD-30 代码：	S-PQCC-N64	长度：	9 mm
最大线性误差 (EL)：	0.0305%	模拟输入通道数量：	2
位数：	14	功能数量：	1
端子数量：	64	最高工作温度：	85 °C
最低工作温度：	-40 °C	输出位码：	OFFSET BINARY, 2'S COMPLEMENT BINARY, GRAY CODE
输出格式：	PARALLEL, WORD	封装主体材料：	PLASTIC/EPOXY
封装代码：	HVQCCN	封装形状：	SQUARE
封装形式：	CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE	认证状态：	Not Qualified
采样速率：	80 MHz	采样并保持/跟踪并保持：	SAMPLE
座面最大高度：	1 mm	标称供电电压：	3 V
表面贴装：	YES	温度等级：	INDUSTRIAL
端子形式：	NO LEAD	端子节距：	0.5 mm
端子位置：	QUAD	宽度：	9 mm
Base Number Matches：	1

ADC1412D080HN/C1 数据手册

ADC1412D065/080/105/125

Dual 14-bit ADC 65, 80, 105 or 125 Msps

CMOS or LVDS DDR digital outputs

Rev. 02 — 4 June 2009

Objective data sheet

1. General description

The ADC1412D is a dual channel 14-bit Analog-to-Digital Converter (ADC) optimized for

high dynamic performances and low power consumption at sample rates up to 125 Msps.

Pipelined architecture and output error correction ensure the ADC1412D is accurate

enough to guarantee zero missing codes over the entire operating range. Supplied from a

single 3 V source, it can handle output logic levels from 1.8 V to 3.3 V in CMOS mode,

thanks to a separate digital output supply. It supports the LVDS (Low Voltage Differential

Signalling) DDR (Double Data Rate) output standard. An integrated SPI (Serial Peripheral

Interface) allows the user to easily conﬁgure the ADC. The device also includes a

programmable gain ampliﬁer with a ﬂexible input voltage range. With excellent dynamic

performance from the baseband to input frequencies of 170 MHz or more, the ADC1412D

is ideal for use in communications, imaging and medical applications.

005aaa042

005aaa040

005aaa041

1.5

0.5

-40

0.5

-80

-0.5

-1

-0.5

-1

-120

-1.5

4000

8000

12000

16000

4000

8000

12000

16000

f (MHz)

Fig 1. Integral Non-Linearity (INL) Fig 2. Differential Non-Linearity

(DNL)

Fig 3. Output spectrum: −1 dBFS,

80 Msps, f_i= 4.43 MHz

2. Features

I SNR, 73 dB

I Input bandwidth, 650 MHz

I SFDR, 90 dBc

I Power dissipation, 775 mW at 80 Msps

I SPI Interface

I Sample rate up to 125 Msps

I Dual-channel14-bit pipelined ADC core I Duty cycle stabilizer

I Single 3 V supply I Fast OTR detection

I Flexible input voltage range: 1 V to 2 V I Offset binary, 2’s complement, gray

(p-p) with 6 dB programmable ﬁne gain

I CMOS or LVDS DDR digital outputs

I INL ±1 LSB, DNL ±0.5 LSB (typical)

code

I Power-down and Sleep modes

I HVQFN64 package

12 3 4 5 6 7...37

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型号	品牌	获取价格	描述	数据表
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ADC1412D105	NXP	获取价格	Dual 14-bit ADC 65, 80, 105 or 125 Msps CMOS or LVDS DDR digital outputs
ADC1412D105HN/C1	NXP	获取价格	Dual 14-bit ADC 65, 80, 105 or 125 Msps CMOS or LVDS DDR digital outputs
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ADC1413D	IDT	获取价格	Dual 14-bit ADC; 65 Msps, 80 Msps, 105 Msps or 125 Msps; serial JESD204A interface
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