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ADC12C080CISQE

更新时间： 2024-01-25 17:58:17
品牌 Logo 应用领域
美国国家半导体 - NSC 转换器
页数 文件大小 规格书
24页 449K
描述
12-Bit, 65/80 MSPS A/D Converter

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ADC12C080CISQE 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
零件包装代码：QFN包装说明：HVQCCN,
针数：32Reach Compliance Code：compliant
ECCN代码：EAR99HTS代码：8542.39.00.01
风险等级：5.8最大模拟输入电压：1.6 V
最小模拟输入电压：1.4 V最长转换时间：0.0125 µs
转换器类型：ADC, PROPRIETARY METHODJESD-30 代码：S-XQCC-N32
JESD-609代码：e0长度：5 mm
最大线性误差 (EL)：0.0293%湿度敏感等级：3
模拟输入通道数量：1位数：12
功能数量：1端子数量：32
最高工作温度：85 °C最低工作温度：-40 °C
输出位码：OFFSET BINARY, 2'S COMPLEMENT BINARY输出格式：PARALLEL, WORD
封装主体材料：UNSPECIFIED封装代码：HVQCCN
封装形状：SQUARE封装形式：CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE
峰值回流温度（摄氏度）：260采样速率：80 MHz
采样并保持/跟踪并保持：SAMPLE座面最大高度：0.8 mm
标称供电电压：3 V表面贴装：YES
技术：CMOS温度等级：INDUSTRIAL
端子面层：TIN LEAD端子形式：NO LEAD
端子节距：0.5 mm端子位置：QUAD
处于峰值回流温度下的最长时间：40宽度：5 mm
Base Number Matches：1

ADC12C080CISQE 数据手册

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August 2007  
ADC12C080  
12-Bit, 65/80 MSPS A/D Converter  
General Description  
Features  
The ADC12C080 is a high-performance CMOS analog-to-  
digital converter capable of converting analog input signals  
into 12-bit digital words at rates up to 80 Mega Samples Per  
Second (MSPS). This converter uses a differential, pipelined  
architecture with digital error correction and an on-chip sam-  
ple-and-hold circuit to minimize power consumption and the  
external component count, while providing excellent dynamic  
performance. A unique sample-and-hold stage yields a full-  
power bandwidth of 1 GHz. The ADC12C080 may be oper-  
ated from a single +3.0V power supply and consumes low  
power. A separate +2.5V supply may be used for the digital  
output interface which allows lower power operation with re-  
duced noise. A power-down feature reduces the power con-  
sumption to very low levels while still allowing fast wake-up  
time to full operation. The differential inputs accept a 2V full  
scale differential input swing. A stable 1.2V internal voltage  
reference is provided, or the ADC12C080 can be operated  
with an external 1.2V reference. Output data format (offset  
binary versus 2's complement) and duty cycle stabilizer are  
pin-selectable. The duty cycle stabilizer maintains perfor-  
mance over a wide range of clock duty cycles.  
1 GHz Full Power Bandwidth  
■
■
■
■
■
■
■
■
Internal reference and sample-and-hold circuit  
Low power consumption  
Data Ready output clock  
Clock Duty Cycle Stabilizer  
Single +3.0V supply operation  
Power-down mode  
32-pin LLP package, (5x5x0.8mm, 0.5mm pin-pitch)  
Key Specifications  
Resolution  
Conversion Rate  
SNR (fIN = 170 MHz)  
SFDR (fIN = 170 MHz)  
Full Power Bandwidth  
Power Consumption  
12 Bits  
80 MSPS  
68 dBFS (typ)  
86 dBFS (typ)  
1 GHz (typ)  
■
■
■
■
■
300 mW (typ)  
■
Applications  
The ADC12C080 is available in a 32-lead LLP package and  
operates over the industrial temperature range of −40°C to  
+85°C.  
High IF Sampling Receivers  
■
■
■
■
Wireless Base Station Receivers  
Test and Measurement Equipment  
Communications Instrumentation  
Portable Instrumentation  
■
Connection Diagram  
20211101  
© 2007 National Semiconductor Corporation  
202111  
www.national.com  
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型号 品牌 获取价格 描述 数据表
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