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9FG108CGLFT

更新时间： 2024-01-05 19:14:35
品牌 Logo 应用领域
艾迪悌 - IDT 时钟光电二极管外围集成电路晶体
页数 文件大小 规格书
21页 263K
描述
Processor Specific Clock Generator, 400MHz, PDSO48, 6.10 MM WIDTH, 0.50 MM PITCH, ROHS COMPLIANT, MO-153, TSSOP-48

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9FG108CGLFT 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Obsolete零件包装代码：TSSOP
包装说明：6.10 MM WIDTH, 0.50 MM PITCH, ROHS COMPLIANT, MO-153, TSSOP-48针数：48
Reach Compliance Code：compliantECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：5.73
JESD-30 代码：R-PDSO-G48JESD-609代码：e3
长度：12.5 mm端子数量：48
最高工作温度：70 °C最低工作温度：
最大输出时钟频率：400 MHz封装主体材料：PLASTIC/EPOXY
封装代码：TSSOP封装形状：RECTANGULAR
封装形式：SMALL OUTLINE, THIN PROFILE, SHRINK PITCH峰值回流温度（摄氏度）：260
主时钟/晶体标称频率：25 MHz认证状态：Not Qualified
座面最大高度：1.2 mm最大供电电压：3.465 V
最小供电电压：3.135 V标称供电电压：3.3 V
表面贴装：YES技术：CMOS
温度等级：COMMERCIAL端子面层：Matte Tin (Sn)
端子形式：GULL WING端子节距：0.5 mm
端子位置：DUAL处于峰值回流温度下的最长时间：30
宽度：6.1 mmuPs/uCs/外围集成电路类型：CLOCK GENERATOR, PROCESSOR SPECIFIC
Base Number Matches：1

9FG108CGLFT 数据手册

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ICS9FG108  
Frequency Generator for CPU, FBD, PCIe Gen 1/2 & SATA  
Absolute Max (Industrial)  
Symbol  
Parameter  
Min  
Max  
Units  
VDD_A  
3.3V Core Supply Voltage  
V
V
DD + 0.5V  
DD + 0.5V  
V
V
VDD_In 3.3V Logic Input Supply Voltage GND - 0.5  
Ts  
Tambient  
Tcase  
Storage Temperature  
Ambient Operating Temp  
Case Temperature  
-65  
-40  
150  
85  
115  
°C  
°C  
°C  
Input ESD protection  
human body model  
ESD prot  
2000  
V
Electrical Characteristics - Input/Supply/Common Output Parameters (Industrial)  
TA = -40 - 85°C; Supply Voltage VDD = 3.3 V +/-5%  
PARAMETER  
Input High Voltage  
Input Low Voltage  
Input High Current  
SYMBOL  
VIH  
CONDITIONS  
MIN  
TYP MAX UNITS NOTES  
VDD + 0.3  
3.3 V +/-5%  
3.3 V +/-5%  
2
V
VSS - 0.3  
VIL  
0.8  
5
V
IIH  
VIN = VDD  
-5  
-5  
uA  
VIN = 0 V; Inputs with no pull-  
up resistors  
IIL1  
uA  
Input Low Current  
VIN = 0 V; Inputs with pull-up  
resistors  
IIL2  
-200  
uA  
Full Active, CL = Full load;  
230  
190  
250  
200  
mA  
mA  
1
1
f = 400 MHz  
Full Active, CL = Full load;  
f = 100 MHz  
IDD3.3OP  
Operating Supply Current  
Input Frequency3  
All outputs stopped driven  
All outputs stopped Hi-Z  
VDD = 3.3 V  
185  
55  
200  
60  
25  
7
mA  
mA  
MHz  
nH  
1
1
3
1
1
1
IDD3.3STOP  
Fi  
14  
Pin Inductance1  
Input/Output  
Capacitance1  
Lpin  
CIN  
Logic Inputs  
1.5  
5
pF  
COUT  
Output pin capacitance  
6
pF  
From VDD Power-Up and after  
input clock stabilization to 1st  
clock  
Clk Stabilization1,2  
TSTAB  
1.8  
ms  
1,2  
Modulation Frequency  
DIF output enable  
fMOD  
Triangular Modulation  
DIF output enable after  
DIF_Stop# de-assertion  
30  
33  
15  
kHz  
ns  
1
1
tDIFOE  
Input Rise and Fall times  
tR/tF  
20% to 80% of VDD  
5
ns  
1
1Guaranteed by design and characterization, not 100% tested in production.  
2See timing diagrams for timing requirements.  
3 Input frequency should be measured at the REFOUT pin and tuned to ideal 14.31818MHz or 25 MHz  
to meet ppm frequency accuracy on PLL outputs.  
IDTTM/ICSTM Frequency Generator for CPU, FBD, PCIe Gen 1/2 & SATA  
ICS9FG108  
REV J 02/20/09  
8
1...567891011...21

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型号 品牌 获取价格 描述 数据表
9FG108DFILF IDT

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