874001AGI-05LF

更新时间： 2024-01-19 15:10:54

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艾迪悌 - IDT		时钟驱动器逻辑集成电路光电二极管衰减器 PC
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PCI EXPRESS™ JITTER ATTENUATOR

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874001AGI-05LF 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Lifetime Buy	零件包装代码：	TSSOP
包装说明：	TSSOP,	针数：	20
Reach Compliance Code：	compliant	ECCN代码：	EAR99
HTS代码：	8542.39.00.01	风险等级：	5.45
Samacsys Confidence：	3	Samacsys Status：	Released
Samacsys PartID：	11129382	Samacsys Pin Count：	20
Samacsys Part Category：	Integrated Circuit	Samacsys Package Category：	Small Outline Packages
Samacsys Footprint Name：	PGG20	Samacsys Released Date：	2020-01-31 03:24:48
Is Samacsys：	N	系列：	874001
输入调节：	DIFFERENTIAL MUX	JESD-30 代码：	R-PDSO-G20
JESD-609代码：	e3	长度：	6.5 mm
逻辑集成电路类型：	PLL BASED CLOCK DRIVER	湿度敏感等级：	1
功能数量：	1	反相输出次数：
端子数量：	20	实输出次数：	1
最高工作温度：	85 °C	最低工作温度：	-40 °C
封装主体材料：	PLASTIC/EPOXY	封装代码：	TSSOP
封装形状：	RECTANGULAR	封装形式：	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
峰值回流温度（摄氏度）：	260	认证状态：	Not Qualified
座面最大高度：	1.2 mm	最大供电电压 (Vsup)：	3.6 V
最小供电电压 (Vsup)：	3 V	标称供电电压 (Vsup)：	3.3 V
表面贴装：	YES	温度等级：	INDUSTRIAL
端子面层：	Matte Tin (Sn) - annealed	端子形式：	GULL WING
端子节距：	0.65 mm	端子位置：	DUAL
处于峰值回流温度下的最长时间：	30	宽度：	4.4 mm
最小 fmax：	640 MHz	Base Number Matches：	1

874001AGI-05LF 数据手册

ICS874001I-05

PCI EXPRESS™ JITTER ATTENUATOR

PCI EXPRESS APPLICATION NOTE

PCI Express jitter analysis methodology models the system

response to reference clock jitter. The below block diagram

shows the most frequently used Common Clock Architecture

in which a copy of the reference clock is provided ot both ends

of the PCI Express Link.

In order to generate time domain jitter numbers, an inverse

Fourier Transform is performed on X(s) * H3(s) * [H1(s) - H2(s)].

For PCI Express Gen 1, one transfer function is defined and

the evaluation is performed over the entire spectrum: DC to

Nyquist (e.g for a 100MHz reference clock: 0Hz to 50MHz) and

the jitter result is reported in peak-peak. For PCI Express Gen2,

two transfer functions are defined with 2 evaluation ranges and

the final jitter number is reported in rms. The two evaluation

ranges for PCI Express Gen 2 are 10kHz - 1.5MHz (Low Band)

and 1.5MHz - Nyquist (High Band). The below plots show the

individual transfer functions as function H1, F2 for H2, and f#

for H3. For a more thorough overivew of PCI Express jitter

analysis methodology, please refer to IDT Application Note, PCI

Express Reference Clock Requirements.

In the jitter analysis, the Tx and Rx serdes PLLs are modeled

as well as the phase interpolator in the receiver. These ransfer

functions are called H1, H2 and H3 respectively. The overall

system transfer function at the receiver is:

Ht(s) = H3(s) * [H1(s) - H2(s)]

The jitter spectrum seen by the receiver is the result of applying

this system transfer function to the clock spectrum X(s) and is:

Y(s) = X(s) * H3(s) * [H1(s) - H2(s)]

Y(s)

Tx Serdes

2.5 GHz

Rx Serdes

Phase

Aligner

H3(s)

PLL

x25 Mult

H1(s)

PLL

x25 Mult

H2(s) 2.5 GHz

100 MHz

X(s)

100 MHz

X(s)

Reference

Clock

System Transfer Function, Ht(s) = H3(s) * [H1(s) - H2(s)]

Reference Clock Spectrum seen by Receiver Sample Latch,Y(s) = X(s) * Ht(s)

IDT^™/ ICS^™PCI EXPRESS JITTERATTENUATOR

ICS874001AGI-05 REV. A APRIL 20, 2009

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