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8430S10AYI-02LFT

更新时间： 2024-02-09 11:43:04

品牌	Logo	应用领域
艾迪悌 - IDT		时钟外围集成电路晶体
页数	文件大小	规格书
28页	1025K
描述
Processor Specific Clock Generator, 133.333MHz, PQFP48, 7 X 7 MM, 1 MM HEIGHT, ROHS COMPLIANT, MO-026ABC, TQFP-48

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8430S10AYI-02LFT 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Active	零件包装代码：	QFP
包装说明：	HTFQFP,	针数：	48
Reach Compliance Code：	compliant	ECCN代码：	EAR99
HTS代码：	8542.39.00.01	风险等级：	5.8
JESD-30 代码：	S-PQFP-G48	JESD-609代码：	e3
长度：	7 mm	端子数量：	48
最高工作温度：	85 °C	最低工作温度：	-40 °C
最大输出时钟频率：	133.333 MHz	封装主体材料：	PLASTIC/EPOXY
封装代码：	HTFQFP	封装形状：	SQUARE
封装形式：	FLATPACK, HEAT SINK/SLUG, THIN PROFILE, FINE PITCH	峰值回流温度（摄氏度）：	260
主时钟/晶体标称频率：	25 MHz	认证状态：	Not Qualified
座面最大高度：	1.2 mm	最大供电电压：	3.465 V
最小供电电压：	3.135 V	标称供电电压：	3.3 V
表面贴装：	YES	技术：	CMOS
温度等级：	INDUSTRIAL	端子面层：	MATTE TIN
端子形式：	GULL WING	端子节距：	0.5 mm
端子位置：	QUAD	处于峰值回流温度下的最长时间：	30
宽度：	7 mm	uPs/uCs/外围集成电路类型：	CLOCK GENERATOR, PROCESSOR SPECIFIC
Base Number Matches：	1

8430S10AYI-02LFT 数据手册

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ICS8430S10I-02

CLOCK GENERATOR FOR CAVIUM PROCESSORS

PRELIMINARY

AC Electrical Characteristics

Table 6. AC Characteristics, V_DD= 3.3V 5%, V_{DDO_X}= 3.3V 5% or 2.5V 5%, T_A= -40°C to 85°C

Parameter Symbol

Test Conditions

DDR_SEL[1:0] = 00

DDR_SEL[1:0] = 01

DDR_SEL[1:0] = 10

DDR_SEL[1:0] = 11

CORE_SEL = 0

Minimum

Typical

133.333

100

Maximum Units

QA/nQA

QBx

MHz

83.333

125

f_MAX

Output Frequency

QBx

CORE_SEL = 1

33.333

133.333

100

PCI_SEL[1:0] = 00

PCI_SEL[1:0] = 01

PCI_SEL[1:0] = 10

PCI_SEL[1:0] = 11

66.667

33.333

Bank Skew;

NOTE 2, 4

tsk(b)

QREFx

Part-to-Part Skew;

NOTE 3, 4

tsk(pp)

QBx, QC, QDx

QA/nQA

Cycle-to-Cycle

Jitter

tjit(cc)

measured at crosspoint

tjit(per)

Period Jitter

QA/nQA

QREFx

measured at crosspoint

tjit(hper)

Half-period Jitter

25MHz (10kHz to 5MHz)

125MHz (1.875MHz to 20MHz)

0.58

0.72

800

235

800

RMS Phase Jitter,

(Random); NOTE 1

tjit(Ø)

t_R/ t_F

QBx

QA/nQA

QC, QE, QREFx

QDx

Output

Rise/Fall Time

20% to 80%

QA/nQA

odc

Output Duty Cycle

QBx, QC, QDx,

QE, QREFx

All parameters measured at f_MAXunless noted otherwise.

NOTE: V_{DDO_X}denotes V_{DDO_B}, V_{DDO_CD,}V_{DDO_E}and V_{DDO_REF.}

NOTE 1: Refer to the phase noise plot.

NOTE 2: Defined as skew within a bank of outputs at the same supply voltage and with equal load conditions.

NOTE 3: Defined as skew between outputs on different devices operating at the same supply voltages and with equal load conditions.

Using the same type of inputs on each device, the outputs are measured at the differential cross points.

NOTE 4: This parameter is defined in accordance with JEDEC Standard 65.

IDT™ / ICS™ CLOCK GENERATOR

ICS8430S10BYI-02 REV. A AUGUST 25, 2008

1...6 7 8910 11 12...28

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