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831721AGILF

更新时间： 2024-09-17 08:08:35
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艾迪悌 - IDT 时钟
页数 文件大小 规格书
17页 360K
描述
Differential Clock/Data Multiplexer

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831721AGILF 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Obsolete零件包装代码：TSSOP
包装说明：4.40 X 5 MM, 0.925 MM HEIGHT, ROHS COMPLIANT, MO-153, TSSOP-16针数：16
Reach Compliance Code：compliantECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：8.01
系列：831721输入调节：DIFFERENTIAL MUX
JESD-30 代码：R-PDSO-G16JESD-609代码：e3
长度：5 mm逻辑集成电路类型：PLL BASED CLOCK DRIVER
湿度敏感等级：1功能数量：1
反相输出次数：端子数量：16
实输出次数：1最高工作温度：85 °C
最低工作温度：-40 °C封装主体材料：PLASTIC/EPOXY
封装代码：TSSOP封装等效代码：TSSOP16,.25
封装形状：RECTANGULAR封装形式：SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
峰值回流温度（摄氏度）：260电源：3.3 V
Prop。Delay @ Nom-Sup：2.4 ns传播延迟（tpd）：2.4 ns
认证状态：Not QualifiedSame Edge Skew-Max（tskwd）：0.55 ns
座面最大高度：1.2 mm子类别：Clock Drivers
最大供电电压 (Vsup)：3.6 V最小供电电压 (Vsup)：3 V
标称供电电压 (Vsup)：3.3 V表面贴装：YES
技术：CMOS温度等级：INDUSTRIAL
端子面层：Matte Tin (Sn) - annealed端子形式：GULL WING
端子节距：0.65 mm端子位置：DUAL
处于峰值回流温度下的最长时间：NOT SPECIFIED宽度：4.4 mm
最小 fmax：700 MHzBase Number Matches：1

831721AGILF 数据手册

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ICS831721I  
Differential Clock/Data Multiplexer  
DATA SHEET  
General Description  
Features  
The ICS831721I is a high-performance, differential HCSL clock/data  
multiplexer and fanout buffer. The device is designed for the  
multiplexing of high-frequency clock and data signals. The device has  
two differential, selectable clock/data inputs. The selected input  
signal is output at one differential HCSL output. Each input pair  
accepts HCSL, LVDS, and LVPECL levels. The ICS831721I is  
characterized to operate from a 3.3V power supply. Guaranteed  
input, output-to-output and part-to-part skew characteristics make  
the ICS831721I ideal for those clock and data distribution  
applications demanding well-defined performance and repeatability.  
The ICS831721I supports the clock multiplexing and distribution of  
PCI Express Generation 1, 2 and 3 clock signals.  
• 2:1 differential clock/data multiplexer with fanout  
• Two selectable, differential inputs  
• Each differential input pair can accept the following levels: HCSL,  
LVHSTL, LVDS and LVPECL  
• One differential HCSL output  
• Maximum input/output clock frequency: 700MHz (maximum)  
• Maximum input/output data rate: 1400Mb/s (NRZ)LVCMOS  
interface levels for all control inputs  
• Input skew: 55ps (maximum)  
• Part-to-part skew: 400ps (maximum)  
• Full 3.3V supply voltage  
• Available in lead-free (RoHS 6) 16 TSSOP package  
• -40°C to 85°C ambient operating temperature  
Block Diagram  
Pin Assignment  
CLK0  
nCLK0  
VDD  
1
2
16 IREF  
15  
14  
13  
12  
11  
SEL  
VDD  
nQ  
IREF  
3
4
5
6
CLK1  
nCLK1  
GND  
nc  
Q
Pulldown  
CLK0  
nCLK0  
VDD  
0
1
Pullup/down  
7
8
10 GND  
Q
nQ  
VDD  
9
nOE  
Pulldown  
CLK1  
nCLK1  
ICS831721I  
Pullup/down  
16 Lead TSSOP  
4.4mm x 5.0mm x 0.925mm package body  
G Package  
Pulldown  
Pullup  
SEL  
nOE  
Top View  
ICS831721AGI REVISION A AUGUST 19, 2011  
1
©2011 Integrated Device Technology, Inc.  
1234567...17

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831721AGILF 替代型号

型号 品牌 替代类型 描述 数据表
831721AGILFT IDT

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 Differential Clock/Data Multiplexer

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