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74LVC1G57GN

更新时间： 2024-02-06 11:54:14

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安世 - NEXPERIA		光电二极管逻辑集成电路
页数	文件大小	规格书
18页	264K
描述
Low-power configurable multiple function gateProduction

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技术参数
数据手册

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74LVC1G57GN 技术参数

是否Rohs认证：	符合	生命周期：	Transferred
零件包装代码：	SON	包装说明：	0.90 X 1 MM, 0.35 MM HEIGHT, SOT-1115, SON-6
针数：	6	Reach Compliance Code：	unknown
HTS代码：	8542.39.00.01	风险等级：	5.65
系列：	LVC/LCX/Z	JESD-30 代码：	R-PDSO-N6
JESD-609代码：	e3	长度：	1 mm
逻辑集成电路类型：	LOGIC CIRCUIT	湿度敏感等级：	1
功能数量：	1	端子数量：	6
最高工作温度：	125 °C	最低工作温度：	-40 °C
封装主体材料：	PLASTIC/EPOXY	封装代码：	SON
封装形状：	RECTANGULAR	封装形式：	SMALL OUTLINE
峰值回流温度（摄氏度）：	260	认证状态：	Not Qualified
座面最大高度：	0.35 mm	最大供电电压 (Vsup)：	5.5 V
最小供电电压 (Vsup)：	1.65 V	标称供电电压 (Vsup)：	1.8 V
表面贴装：	YES	技术：	CMOS
温度等级：	AUTOMOTIVE	端子面层：	PURE TIN
端子形式：	NO LEAD	端子节距：	0.3 mm
端子位置：	DUAL	处于峰值回流温度下的最长时间：	30
宽度：	0.9 mm	Base Number Matches：	1

74LVC1G57GN 数据手册

Nexperia

74LVC1G57

Low-power configurable multiple function gate

7.1. Logic configurations

Table 5. Function selection table

Logic function

Figure

2-input AND

see Fig. 5

2-input AND with both inputs inverted

2-input NAND with inverted input

2-input OR with inverted input

2-input NOR

see Fig. 8

see Fig. 6 and Fig. 7

see Fig. 8

2-input NOR with both inputs inverted

2-input XNOR

see Fig. 5

see Fig. 9

Inverter

see Fig. 10

Buffer

see Fig. 11

001aab584

001aab585

Fig. 5. 2-input AND gate or

2-input NOR gate with both inputs inverted

Fig. 6. 2-input NAND gate with input B inverted or

2-input OR gate with inverted C input

001aab586

001aab587

Fig. 7. 2-input NAND gate with input C inverted or

2-input OR gate with inverted A input

Fig. 8. 2-input NOR gate or

2-input AND gate with both inputs inverted

001aab588

001aab589

Fig. 9. 2-input XNOR gate

Fig. 10. Inverter

001aab590

Fig. 11. Buffer

74LVC1G57

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Product data sheet

Rev. 10 — 1 February 2022

4 / 18

1 2 345 6 7...18

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